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• VGA的verilog hdl 程序免費(fèi)下載

  資源簡(jiǎn)介：VGA的verilog hdl 程序，完成顯示長(zhǎng)條狀顯示不同顏色

  標(biāo)簽： verilog VGA hdl 程序

  上傳時(shí)間： 2017-01-02

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• 王金明的verilog hdl程序集合免費(fèi)下載

  資源簡(jiǎn)介：王金明的verilog hdl程序集合，包含各個(gè)常用的程序

  標(biāo)簽： verilog hdl 程序

  上傳時(shí)間： 2013-11-26

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• I2C to GPIO Port expander的verilog hdl 程序原碼免費(fèi)下載

  資源簡(jiǎn)介：I2C to GPIO Port expander的verilog hdl 程序原碼，直接可在Quartus環(huán)境下運(yùn)行。

  標(biāo)簽： expander verilog GPIO Port

  上傳時(shí)間： 2016-05-19

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• SDRAM的verilog hdl程序免費(fèi)下載

  資源簡(jiǎn)介：SDRAM的verilog hdl程序，適合DE2開(kāi)發(fā)板，和TRDB-LCM顯示器，很好哦

  標(biāo)簽： verilog SDRAM hdl 程序

  上傳時(shí)間： 2014-01-03

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• 包含了四位計(jì)數(shù)器等基本數(shù)字模塊的的verilog hdl程序代碼,該功能實(shí)現(xiàn),可以直接利用DC進(jìn)行綜合,得到硬件電路,亦能夠轉(zhuǎn)換成Vhdl語(yǔ)言進(jìn)行綜合免費(fèi)下載

  資源簡(jiǎn)介：包含了四位計(jì)數(shù)器等基本數(shù)字模塊的的verilog hdl程序代碼,該功能實(shí)現(xiàn),可以直接利用DC進(jìn)行綜合,得到硬件電路,亦能夠轉(zhuǎn)換成Vhdl語(yǔ)言進(jìn)行綜合

  標(biāo)簽： verilog Vhdl hdl 計(jì)數(shù)器

  上傳時(shí)間： 2013-12-19

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• BCD編碼的verilog hdl程序免費(fèi)下載

  資源簡(jiǎn)介：BCD編碼的verilog hdl程序，能夠?qū)崿F(xiàn)BCD編碼與卷積碼。

  標(biāo)簽： verilog BCD hdl 編碼

  上傳時(shí)間： 2014-02-18

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• FPGA開(kāi)發(fā)入門的verilog hdl程序---流水燈,真實(shí)可用免費(fèi)下載

  資源簡(jiǎn)介：FPGA開(kāi)發(fā)入門的verilog hdl程序---流水燈,真實(shí)可用，驗(yàn)證通過(guò)，工程環(huán)境為Altera Quartus

  標(biāo)簽： verilog FPGA hdl 程序

  上傳時(shí)間： 2016-09-01

  上傳用戶：VRMMO

• FPGA開(kāi)發(fā)入門的verilog hdl程序2---梁祝音樂(lè)播放,真實(shí)可用免費(fèi)下載

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  標(biāo)簽： verilog FPGA hdl 程序

  上傳時(shí)間： 2014-01-09

  上傳用戶：Altman

• 步進(jìn)電機(jī)位置系統(tǒng) 步進(jìn)電機(jī)位置系統(tǒng)block symbol file 步進(jìn)電機(jī)位置系統(tǒng)的verilog hdl程序設(shè)計(jì) 已編譯通過(guò)免費(fèi)下載

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  標(biāo)簽： verilog symbol block file

  上傳時(shí)間： 2014-01-03

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• FPGA與PC串口通信的verilog hdl 程序免費(fèi)下載

  資源簡(jiǎn)介：FPGA與PC串口通信的verilog hdl 程序

  標(biāo)簽： verilog FPGA hdl PC串口

  上傳時(shí)間： 2016-11-16

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• verilog hdl 程序 雙路脈沖發(fā)生器的代碼 包含了鍵盤控制免費(fèi)下載

  資源簡(jiǎn)介：verilog hdl 程序 雙路脈沖發(fā)生器的代碼 包含了鍵盤控制，LED顯示，脈沖發(fā)生，脈沖頻率測(cè)量模塊 是我自己寫(xiě)得，希望能對(duì)你有幫助，有問(wèn)題可以mail：shaojunwu1@163.com

  標(biāo)簽： verilog hdl 程序 代碼

  上傳時(shí)間： 2015-04-26

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• 是關(guān)于dct的verilog hdl源代碼和測(cè)試程序免費(fèi)下載

  資源簡(jiǎn)介：是關(guān)于dct的verilog hdl源代碼和測(cè)試程序

  標(biāo)簽： verilog dct hdl 源代碼

  上傳時(shí)間： 2014-06-15

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• 用于生成GF(2^m)有限域中乘法器的verilog hdl源文件的C程序免費(fèi)下載

  資源簡(jiǎn)介：用于生成GF(2^m)有限域中乘法器的verilog hdl源文件的C程序

  標(biāo)簽： verilog hdl GF C程序

  上傳時(shí)間： 2016-01-15

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• 用于生成GF(2^m)有限域中常數(shù)乘法器的verilog hdl源文件的C程序免費(fèi)下載

  資源簡(jiǎn)介：用于生成GF(2^m)有限域中常數(shù)乘法器的verilog hdl源文件的C程序

  標(biāo)簽： verilog hdl GF C程序

  上傳時(shí)間： 2016-01-15

  上傳用戶：chenbhdt

• 用于生成GF(2^m)有限域元素求逆器的verilog hdl源文件的C程序免費(fèi)下載

  資源簡(jiǎn)介：用于生成GF(2^m)有限域元素求逆器的verilog hdl源文件的C程序

  標(biāo)簽： verilog hdl GF C程序

  上傳時(shí)間： 2014-01-13

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• VGA實(shí)驗(yàn)的verilog hdl代碼用于FPGA免費(fèi)下載

  資源簡(jiǎn)介：VGA實(shí)驗(yàn)的verilog hdl代碼用于FPGA

  標(biāo)簽： verilog FPGA VGA hdl

  上傳時(shí)間： 2014-12-07

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• LVDS的應(yīng)用的verilog hdl例子程序免費(fèi)下載

  資源簡(jiǎn)介：LVDS的應(yīng)用的verilog hdl例子程序，由altera公司提供。

  標(biāo)簽： verilog LVDS hdl 程序

  上傳時(shí)間： 2013-12-31

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• 王金明編寫(xiě)的《verilog hdl程序設(shè)計(jì)教程》書(shū)中的例子原碼免費(fèi)下載

  資源簡(jiǎn)介：王金明編寫(xiě)的《verilog hdl程序設(shè)計(jì)教程》書(shū)中的例子原碼，適合于初學(xué)者。

  標(biāo)簽： verilog hdl 編寫(xiě) 程序設(shè)計(jì)

  上傳時(shí)間： 2016-05-19

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• 有用的verilog hdl實(shí)驗(yàn)用程序 配有截圖免費(fèi)下載

  資源簡(jiǎn)介：有用的verilog hdl實(shí)驗(yàn)用程序 配有截圖

  標(biāo)簽： verilog hdl 實(shí)驗(yàn) 程序

  上傳時(shí)間： 2013-12-23

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• verilog hdl程序設(shè)計(jì)教程,以可綜合的設(shè)計(jì)為重點(diǎn)免費(fèi)下載

  資源簡(jiǎn)介：verilog hdl程序設(shè)計(jì)教程,以可綜合的設(shè)計(jì)為重點(diǎn)，同時(shí)對(duì)仿真和模擬也作了深入闡述。全面介紹了verilog hdl 詞法，語(yǔ)法。

  標(biāo)簽： verilog hdl 程序設(shè)計(jì) 教程

  上傳時(shí)間： 2014-01-19

  上傳用戶：zhangyi99104144

• 本程序包含：EEPROM的功能模型(eeprom.v)、讀/寫(xiě)EEPROM的verilog hdl 行為模塊（eeprom_wr.v）、信號(hào)產(chǎn)生模塊（signal.v）和頂層模塊(top.v)免費(fèi)下載

  資源簡(jiǎn)介：本程序包含：EEPROM的功能模型(eeprom.v)、讀/寫(xiě)EEPROM的verilog hdl 行為模塊（eeprom_wr.v）、信號(hào)產(chǎn)生模塊（signal.v）和頂層模塊(top.v) ，這樣可以有一個(gè)完整的EEPROM的控制模塊和測(cè)試文件，本文件通過(guò)測(cè)試。

  標(biāo)簽： EEPROM eeprom_wr verilog eeprom

  上傳時(shí)間： 2017-01-22

  上傳用戶：lanjisu111

• 本書(shū)介紹了大量verilog hdl程序設(shè)計(jì)的實(shí)例免費(fèi)下載

  資源簡(jiǎn)介：本書(shū)介紹了大量verilog hdl程序設(shè)計(jì)的實(shí)例，對(duì)于verilog語(yǔ)言學(xué)習(xí)者和從事相關(guān)工作的工程師來(lái)說(shuō)，都有一定的學(xué)習(xí)和參考價(jià)值。

  標(biāo)簽： verilog hdl 程序設(shè)計(jì)

  上傳時(shí)間： 2014-01-17

  上傳用戶：czl10052678

• verilog hdl程序設(shè)計(jì)教程免費(fèi)下載

  資源簡(jiǎn)介：verilog hdl程序設(shè)計(jì)教程,一本實(shí)用的教程，值得一看。

  標(biāo)簽： verilog hdl 程序設(shè)計(jì) 教程

  上傳時(shí)間： 2013-05-26

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• 《verilog hdl程序設(shè)計(jì)與應(yīng)用》免費(fèi)下載

  資源簡(jiǎn)介：《verilog hdl程序設(shè)計(jì)與實(shí)踐》系統(tǒng)講解了verilog hdl的基本語(yǔ)法和高級(jí)應(yīng)用技巧，對(duì)于每個(gè)知識(shí)點(diǎn)都按照開(kāi)門見(jiàn)山、自頂向下的方式來(lái)組織內(nèi)容，在介紹相關(guān)知識(shí)點(diǎn)之前，先告訴讀者其出現(xiàn)的背景、本質(zhì)特征以及應(yīng)用場(chǎng)景，讓讀者不僅掌握基本語(yǔ)法，還能夠獲得深層次...

  標(biāo)簽： verilog hdl 程序設(shè)計(jì)

  上傳時(shí)間： 2013-11-22

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• 《verilog hdl程序設(shè)計(jì)與應(yīng)用》免費(fèi)下載

  資源簡(jiǎn)介：《verilog hdl程序設(shè)計(jì)與實(shí)踐》系統(tǒng)講解了verilog hdl的基本語(yǔ)法和高級(jí)應(yīng)用技巧，對(duì)于每個(gè)知識(shí)點(diǎn)都按照開(kāi)門見(jiàn)山、自頂向下的方式來(lái)組織內(nèi)容，在介紹相關(guān)知識(shí)點(diǎn)之前，先告訴讀者其出現(xiàn)的背景、本質(zhì)特征以及應(yīng)用場(chǎng)景，讓讀者不僅掌握基本語(yǔ)法，還能夠獲得深層次...

  標(biāo)簽： verilog hdl 程序設(shè)計(jì)

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• verilog hdl程序免費(fèi)下載

  資源簡(jiǎn)介：verilog hdl程序，對(duì)硬件開(kāi)發(fā)有興趣或需要的朋友趕快down下來(lái)

  標(biāo)簽： verilog hdl 程序

  上傳時(shí)間： 2014-12-09

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• 占用資源少的verilog hdl uart接口；采用固定波特率115200免費(fèi)下載

  資源簡(jiǎn)介：占用資源少的verilog hdl uart接口；采用固定波特率115200，可以修改程序中的分頻來(lái)修改波特率，模式為1個(gè)啟始位，8位數(shù)據(jù)位，1個(gè)停止位；帶1字節(jié)緩存；當(dāng)緩存空時(shí)輸出空信號(hào)

  標(biāo)簽： verilog 115200 uart hdl

  上傳時(shí)間： 2013-12-28

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• 基于FPGA的多功能數(shù)字鐘的設(shè)計(jì)與實(shí)現(xiàn) 內(nèi)附有詳盡的verilog hdl源碼免費(fèi)下載

  資源簡(jiǎn)介：基于FPGA的多功能數(shù)字鐘的設(shè)計(jì)與實(shí)現(xiàn) 內(nèi)附有詳盡的verilog hdl源碼，其功能主要有：時(shí)間設(shè)置，時(shí)間顯示，跑表，分頻，日期設(shè)置，日期顯示等

  標(biāo)簽： verilog FPGA hdl 多功能

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• verilog hdl程序設(shè)計(jì)教程免費(fèi)下載

  資源簡(jiǎn)介：verilog hdl程序設(shè)計(jì)教程

  標(biāo)簽： verilog hdl 程序設(shè)計(jì) 教程

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• verilog hdl程序設(shè)計(jì)教程免費(fèi)下載

  資源簡(jiǎn)介：verilog hdl程序設(shè)計(jì)教程

  標(biāo)簽： verilog hdl 程序設(shè)計(jì) 教程

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