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Verilog HDL 編寫的CY7C68013 SLAVE FIFO接口程序

  • 資源大小:650 K
  • 上傳時間: 2016-10-13
  • 上傳用戶:karon9999
  • 資源積分:2 下載積分
  • 標      簽: Verilog C68013 68013 SLAVE

資 源 簡 介

Verilog HDL 編寫的CY7C68013 SLAVE FIFO接口程序,實際測試可用。可以直接跟上位機連接,傳輸數據。

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