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用verilog hdl編寫的一些例程

  • 資源大小:5 K
  • 上傳時間: 2013-12-20
  • 上傳用戶:xiao11tian
  • 資源積分:2 下載積分
  • 標      簽: verilog hdl 編寫

資 源 簡 介

用verilog hdl編寫的一些例程,包括加法器/減法器等等,例子較多就不一一列舉了

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