Verilog HDL源碼,顯示器段數碼管數字累加,測試通過
資源簡介:基于FPGA的交通燈的設計 有Verilog HDL 源碼、仿真圖與引腳配置圖,已下載實現\r\n
上傳時間: 2013-08-18
上傳用戶:BOBOniu
資源簡介:基于FPGA的多功能數字鐘的設計與實現 內附有詳盡的Verilog HDL源碼,其功能主要有:時間設置,時間顯示,跑表,分頻,日期設置,日期顯示等
上傳時間: 2013-08-18
上傳用戶:問題問題
資源簡介:用于計算CRC的Verilog HDL源碼
上傳時間: 2015-02-07
上傳用戶:569342831
資源簡介:關于雙口RAM的Verilog HDL源碼
上傳時間: 2016-04-17
上傳用戶:爺的氣質
資源簡介:清華大學Verilog HDL源碼例子,作業,內含源代碼,詳細的文檔說明,非常有用
上傳時間: 2013-12-27
上傳用戶:cc1
資源簡介:基于FPGA的交通燈的設計 有Verilog HDL 源碼、仿真圖與引腳配置圖,已下載實現
上傳時間: 2016-09-05
上傳用戶:ggwz258
資源簡介:基于FPGA的多功能數字鐘的設計與實現 內附有詳盡的Verilog HDL源碼,其功能主要有:時間設置,時間顯示,跑表,分頻,日期設置,日期顯示等
上傳時間: 2016-09-06
上傳用戶:1583060504
資源簡介:Verilog HDL源碼,顯示器段數碼管數字累加,測試通過
上傳時間: 2016-11-23
上傳用戶:Breathe0125
資源簡介:清華大學Verilog HDL源碼作業實驗,適合感興趣的學習者學習,可以提高自己的能力,大家可以多交流哈
上傳時間: 2022-05-17
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資源簡介:TMS3205402Verilog HDL源碼
上傳時間: 2013-08-17
上傳用戶:shizhanincc
資源簡介:sdram的Verilog的源碼實現
上傳時間: 2015-01-09
上傳用戶:huangld
資源簡介:一個嵌入式RISC CPU 的Verilog 設計源碼,可綜合。內含詳細的設計文擋。
上傳時間: 2015-04-16
上傳用戶:tianjinfan
資源簡介:FPGA/CPLD應用,uart的Verilog HDL原碼
上傳時間: 2013-12-28
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資源簡介:Verilog HDL原碼 一種簡單的同步FIFO原碼,可以被綜合
上傳時間: 2013-12-28
上傳用戶:qwe1234
資源簡介:I2C總線Verilog實現源碼,可以完整實現I2C bus的基本功能
上傳時間: 2015-08-13
上傳用戶:anng
資源簡介:PWM Verilog HDL原碼和底層C驅動,即測試程序,可直接使用
上傳時間: 2013-12-19
上傳用戶:ggwz258
資源簡介:有關Verilog的源碼程序,希望對大家有幫助,謝謝啦
上傳時間: 2014-01-19
上傳用戶:ywqaxiwang
資源簡介:TMS3205402Verilog HDL源碼
上傳時間: 2013-12-14
上傳用戶:妄想演繹師
資源簡介:DW8051 Verilog VHDL 源碼和文檔
上傳時間: 2014-12-20
上傳用戶:zl5712176
資源簡介:Verilog SPI 源碼(來自網絡)
上傳時間: 2017-07-11
上傳用戶:z754970244
資源簡介:一個Verilog的源碼程序,用于加法器實驗程序
上傳時間: 2013-12-17
上傳用戶:www240697738
資源簡介:lm75A溫度數字轉換器 FPGA讀寫實驗Verilog邏輯源碼Quartus工程文件+文檔資料,FPGA為CYCLONE4系列中的EP4CE6E22C8. 完整的工程文件,可以做為你的學習設計參考。LM75A 是一個使用了內置帶隙溫度傳感器和模數轉換技術的溫度數字轉換器。它也是一個溫度檢測器,...
上傳時間: 2021-10-27
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資源簡介:FPGA采樣AD9238數據并通過VGA波形顯示例程 Verilog邏輯源碼Quartus工程文件+文檔說明,FPGA型號Cyclone4E系列中的EP4CE6F17C8,Quartus版本17.1。ADC 模塊型號為 AN9238,最大采樣率 65Mhz,精度為12 位。實驗中把 AN9238 的 2 路輸入以波形方式在 HDMI 上顯示...
上傳時間: 2021-10-27
上傳用戶:qingfengchizhu
資源簡介:FPGA讀寫SD卡讀取BMP圖片通過LCD顯示例程實驗 Verilog邏輯源碼Quartus工程文件+文檔說明,FPGA型號Cyclone4E系列中的EP4CE6F17C8,Quartus版本17.1。1 實驗簡介在前面的實驗中我們練習了 SD 卡讀寫,VGA 視頻顯示等例程,本實驗將 SD 卡里的 BMP 圖片讀出,寫...
上傳時間: 2021-10-27
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資源簡介:IIC接口E2PROM(AT24C64) 讀寫Verilog 驅動源碼+仿真激勵文件:module i2c_dri? ? #(? ? ? parameter? ?SLAVE_ADDR = 7'b1010000? ?,? //EEPROM從機地址? ? ? parameter? ?CLK_FREQ? ?= 26'd50_000_000, //模塊輸入的時鐘頻率? ? ? paramet...
上傳時間: 2021-11-05
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資源簡介:FPGA讀取OV5640攝像頭數據并通過VGA或LCD屏顯示輸出的Verilog邏輯源碼Quartus工程文件+文檔說明,FPGA型號Cyclone4E系列中的EP4CE6F17C8,Quartus版本17.1。module top( input? ? ? ? ? ? ? ? ? ? ? ?clk, input? ? ? ? ? ? ? ? ? ? ?...
上傳時間: 2021-12-18
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資源簡介:基于FPGA設計的字符VGA? LCD顯示實驗Verilog邏輯源碼Quartus工程文件+文檔說明,通過字符轉換工具將字符轉換為 8 進制 mif 文件存放到單端口的 ROM IP 核中,再從ROM 中把轉換后的數據讀取出來顯示到 VGA 上,FPGA型號Cyclone4E系列中的EP4CE6F17C8,Quartus...
上傳時間: 2021-12-18
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資源簡介:基于FPGA設計的sdram讀寫測試實驗Verilog邏輯源碼Quartus工程文件+文檔說明,DRAM選用海力士公司的 HY57V2562 型號,容量為的 256Mbit,采用了 54 引腳的TSOP 封裝, 數據寬度都為 16 位, 工作電壓為 3.3V,并丏采用同步接口方式所有的信號都是時鐘信號。FPGA型號...
上傳時間: 2021-12-18
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資源簡介:基于FPGA設計的vga顯示測試實驗Verilog邏輯源碼Quartus工程文件+文檔說明,FPGA型號Cyclone4E系列中的EP4CE6F17C8,Quartus版本17.1。module top( input? ? ? ? ? ? ? ? ? ? ? ?clk, input? ? ? ? ? ? ? ? ? ? ? ?rst_n, //vga outpu...
上傳時間: 2021-12-19
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資源簡介:FPGA片內FIFO讀寫測試Verilog邏輯源碼Quartus工程文件+文檔說明,使用 FPGA 內部的 FIFO 以及程序對該 FIFO 的數據讀寫操作。FPGA型號Cyclone4E系列中的EP4CE6F17C8,Quartus版本17.1。timescale 1ns / 1ps/////////////////////////////////////////////////...
上傳時間: 2021-12-19
上傳用戶:20125101110