一個用verilog實現(xiàn)的fpga上的uart接口模塊,包括測試模塊和實體,并實現(xiàn)了輸出接口和狀態(tài)接口。
資源簡介:一個用verilog實現(xiàn)的fpga上的uart接口模塊,包括測試模塊和實體,并實現(xiàn)了輸出接口和狀態(tài)接口。
上傳時間: 2014-07-19
上傳用戶:gengxiaochao
資源簡介:用verilog實現(xiàn)基于fpga的通用分頻器
上傳時間: 2013-08-30
上傳用戶:xingyuewubian
資源簡介:用JAVA實現(xiàn)控制面板上的字體特性 比如:控制字體大小,控制字體顏色.當(dāng)然讀者可以自己再依此補充 這是課后的一個習(xí)題的答案
上傳時間: 2013-12-23
上傳用戶:lxm
資源簡介:用verilog實現(xiàn)基于fpga的通用分頻器
上傳時間: 2015-08-20
上傳用戶:songrui
資源簡介:這是我下的一個用verilog實現(xiàn)的除法代碼
上傳時間: 2015-10-01
上傳用戶:zhuoying119
資源簡介:這是一個用verilog實現(xiàn)的除法器代碼。
上傳時間: 2013-12-28
上傳用戶:wmwai1314
資源簡介:一個用VC實現(xiàn)對XML編譯的源碼。在VC6中開發(fā)。MSXML為4.0版,在微軟網(wǎng)上可以下到,是免費的。有問題聯(lián)系nomygod163@163.com
上傳時間: 2013-12-31
上傳用戶:cx111111
資源簡介:一個用JAVA實現(xiàn)生成PDF文件的例子。
上傳時間: 2015-12-15
上傳用戶:曹云鵬
資源簡介:用java實現(xiàn)了數(shù)學(xué)上的排列組合問題,包括Cmn,Pmn,Pnn三種排列組合的情況
上傳時間: 2016-01-24
上傳用戶:佳期如夢
資源簡介:這是一個用來實現(xiàn)自動報站的程序,愿意的來下載吧!
上傳時間: 2016-07-12
上傳用戶:lps11188
資源簡介:這是一個用Flash實現(xiàn)飄雪效果的程序!
上傳時間: 2017-04-11
上傳用戶:yulg
資源簡介:這是用pci-wishbone核和16450串口核在xilinx的fpga上實現(xiàn)的串口程序,用verilog實現(xiàn),ise7.1,不知道這里可不可以上傳硬件的程序~
上傳時間: 2015-09-19
上傳用戶:風(fēng)之驕子
資源簡介:一個用verilog語言實現(xiàn)的包含:鍵盤掃描,led驅(qū)動、vga視頻輸出的例子。功能為用鍵盤控制一個方塊的顯示位置。需要有fpga板子支持。
上傳時間: 2014-01-10
上傳用戶:pompey
資源簡介:本文著重研究了OFDM調(diào)制解調(diào)技術(shù)在fpga上的實現(xiàn)。全文內(nèi)容安排如下: 第一章介紹了PLD(可編程邏輯器件)和OFDM(正交頻分復(fù)用)技術(shù)的發(fā)展歷史?! 〉诙陆榻B了PLD的分類、工藝和結(jié)構(gòu)特點,以及fpga的開發(fā)環(huán)境、開發(fā)流程和verilog語言的特點。 第三章就O...
上傳時間: 2013-08-05
上傳用戶:躍躍,,
資源簡介:本人親手實現(xiàn)且用在一商用產(chǎn)品上的一個簡單的ppp協(xié)議,針對Arm7TDMI
上傳時間: 2015-02-24
上傳用戶:tyler
資源簡介:用verilog編寫在FLEX10K上實現(xiàn)的簡易CPU
上傳時間: 2015-03-09
上傳用戶:vodssv
資源簡介:用verilog實現(xiàn)的四乘四鍵盤程序,在Quartus II上編譯通過并成功
上傳時間: 2015-05-13
上傳用戶:ruan2570406
資源簡介:此代碼是用verilog實現(xiàn)的以太網(wǎng)接口,在此基礎(chǔ)上做修改,可以作為一般的以太網(wǎng)接口程序開發(fā).
上傳時間: 2014-01-20
上傳用戶:zhichenglu
資源簡介:用C51實現(xiàn)的拼音輸入法,這是改寫的網(wǎng)友 embuffalo、獨步上載在www.21ic.com自由發(fā)布區(qū)的由張凱原作的51上的拼音輸入法程序。 原作使用了一個二維數(shù)組用以查表,我認為這樣比較的浪費空間,而且每個字表的索引地址要手工輸入,效率不高。所以我用結(jié)構(gòu)體將其...
上傳時間: 2014-01-26
上傳用戶:semi1981
資源簡介:fpga上的verilog語言編程。通過查找表實現(xiàn)直接數(shù)字頻率合成。在主控部分通過鍵盤選擇正弦波,方波,三角波,斜波,以及四種波形的任意兩種的疊加,以及四種波形的疊加;通過控制頻率控制字C的大小,以控制輸出波形頻率,實現(xiàn)1Hz的微調(diào);通過地址變換實現(xiàn)波形...
上傳時間: 2015-09-27
上傳用戶:songrui
資源簡介:用verilog實現(xiàn)了一個數(shù)字秒表的設(shè)計
上傳時間: 2015-11-15
上傳用戶:小眼睛LSL
資源簡介:用verilog實現(xiàn)的電子日歷程序,在Quartus II上編譯通過并成功實現(xiàn)
上傳時間: 2014-01-08
上傳用戶:fhzm5658
資源簡介:用verilog實現(xiàn)的記時器程序,在Quartus II上編譯通過并成功運行
上傳時間: 2013-12-17
上傳用戶:GHF
資源簡介:用verilog實現(xiàn)的搶答器程序,在Quartus II上編譯通過并成功運行
上傳時間: 2014-01-14
上傳用戶:sunjet
資源簡介:用最少的CPLD資源,用verilog在QuartusII7.1上實現(xiàn)的1280分頻.
上傳時間: 2016-03-18
上傳用戶:253189838
資源簡介:以靜態(tài)化的地址來訪問動態(tài)頁面 我曾經(jīng)上傳個一個用servlet實現(xiàn)的,用servlet實現(xiàn)的不好和struts整合 所以我有開發(fā)另外一個用過濾器Filter實現(xiàn)的小框架以便于和struts整合 如: http://localhost:8080/index.jsp?param1=第一個參數(shù)¶m2=第二個參數(shù)¶...
上傳時間: 2014-09-02
上傳用戶:cooran
資源簡介:fpga verilog 用DCFIFO實現(xiàn) 跨時鐘域的數(shù)據(jù)傳輸,已驗證,直接可用
上傳時間: 2014-01-07
上傳用戶:jichenxi0730
資源簡介:用verilog語言在fpga內(nèi)實現(xiàn)一256個采樣點的正弦波,已嘗試,挺好用的~~~
上傳時間: 2017-03-18
上傳用戶:685
資源簡介:用verilog實現(xiàn)的數(shù)字跑表,下載到fpga開發(fā)板上驗證通過。下載后從新分配引腳即可用。
上傳時間: 2014-01-13
上傳用戶:頂?shù)弥?/p>
資源簡介:運行在fpga上的verilog程序(實現(xiàn)對ADC的控制)...
上傳時間: 2013-12-28
上傳用戶:wyc199288