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FPGA VERILOG 用DCFIFO實現 跨時鐘域的數據傳輸

  • 資源大小:1005 K
  • 上傳時間: 2014-01-07
  • 上傳用戶:kuoiai
  • 資源積分:2 下載積分
  • 標      簽: VERILOG DCFIFO FPGA 時鐘域

資 源 簡 介

FPGA VERILOG 用DCFIFO實現 跨時鐘域的數據傳輸,已驗證,直接可用

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