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在C54X DSP下實(shí)現(xiàn)
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實(shí)驗(yàn)?zāi)康模赫莆侦o態(tài)
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的基本操作
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FPGA上的VERILOG語(yǔ)言編程。通過(guò)
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實(shí)現(xiàn)直接數(shù)字頻率合成。在主控部分通過(guò)鍵盤選擇正弦波
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用VHDL實(shí)現(xiàn)
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方式的FIR濾波器
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(2,1,9)卷積碼的一個(gè)
查找表
,用與(2,1,9)卷積碼的編碼,可以根據(jù)寄存器的狀態(tài)來(lái)判別輸出數(shù).
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FPGA中實(shí)現(xiàn)基于
查找表
方式(LUT)的DDS實(shí)現(xiàn)
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一個(gè)
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的程序
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利用平衡二叉樹(shù)實(shí)現(xiàn)一個(gè)動(dòng)態(tài)
查找表
實(shí)現(xiàn)動(dòng)態(tài)
查找表
的三種基本功能:查找、插入和刪除
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正弦值
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是用matlab代碼寫的
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基于改進(jìn)的
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的arctan計(jì)算模塊
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