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DDR控制器的VHDL源代碼.采用FPGA實現DDR接口控制器,適用于Altera的FPGA,最高頻率可到100M

  • 資源大小:759 K
  • 上傳時間: 2014-12-02
  • 上傳用戶:sunyuang
  • 資源積分:2 下載積分
  • 標      簽: FPGA DDR Altera 100M

資 源 簡 介

DDR控制器的VHDL源代碼.采用FPGA實現DDR接口控制器,適用于Altera的FPGA,最高頻率可到100M

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