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  資源簡介：Verilog-HDL編寫規范-非常全,非常適合初學者

  標簽： Verilog-HDL 編寫 初學者

  上傳時間： 2013-12-22

  上傳用戶：aappkkee

• 強調Verilog代碼編寫規范免費下載

  資源簡介：強調Verilog代碼編寫規范，經常是一個不太受歡迎的話題，但卻是非常有必要的。 每個代碼編寫者都有自己的編寫習慣，而且都喜歡按照自己的習慣去編寫

  標簽： Verilog 代碼 編寫

  上傳時間： 2015-05-12

  上傳用戶：13160677563

• verilog HDL 編寫的PWM免費下載

  資源簡介：verilog HDL 編寫的PWM，是初學CPLD者入門Z資源，epm7128stc100-10

  標簽： verilog HDL PWM 編寫

  上傳時間： 2013-08-30

  上傳用戶：aa54

• 這是一個Verilog HDL編寫的RISC cpu的程序免費下載

  資源簡介：這是一個Verilog HDL編寫的RISC cpu的程序，該程序共10個子程序，實現了簡單的RISC cpu，可供初學者參考，學習硬件描述語言，及設計方法。該程序通過了modelsim仿真驗證。

  標簽： Verilog RISC HDL cpu

  上傳時間： 2015-03-26

  上傳用戶：qiao8960

• 鍵盤鼠標的原代碼,用FPGA實現,使用Verilog HDL編寫,已經使用FPGA驗正過了,完全可以用免費下載

  資源簡介：鍵盤鼠標的原代碼,用FPGA實現,使用Verilog HDL編寫,已經使用FPGA驗正過了,完全可以用

  標簽： FPGA Verilog HDL 鍵盤

  上傳時間： 2013-12-12

  上傳用戶：athjac

• Verilog HDL編寫的CPU模型免費下載

  資源簡介：Verilog HDL編寫的CPU模型，很經典，比較通用

  標簽： Verilog HDL CPU 編寫

  上傳時間： 2013-12-24

  上傳用戶：龍飛艇

• Verilog HDL編寫的總線功能模型免費下載

  資源簡介：Verilog HDL編寫的總線功能模型，十分有用，需要的下載

  標簽： Verilog HDL 編寫 總線

  上傳時間： 2013-12-20

  上傳用戶：ls530720646

• 計數器 同步異步預置數清零 verilog hdl 編寫免費下載

  資源簡介：計數器 同步異步預置數清零 verilog hdl 編寫

  標簽： verilog hdl 計數器 編寫

  上傳時間： 2013-12-18

  上傳用戶：鳳臨西北

• Verilog HDL編寫的串并轉換。采用iout類型口。包含源文件和測試文件。用Modsim編譯。免費下載

  資源簡介：Verilog HDL編寫的串并轉換。采用iout類型口。包含源文件和測試文件。用Modsim編譯。

  標簽： Verilog Modsim iout HDL

  上傳時間： 2014-01-15

  上傳用戶：lanwei

• verilog HDL 編寫的PWM免費下載

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  標簽： verilog HDL PWM 編寫

  上傳時間： 2015-09-05

  上傳用戶：gdgzhym

• verilog hdl編寫,六段流水線CPU.程序完整免費下載

  資源簡介：verilog hdl編寫,六段流水線CPU.程序完整，功能強驚。分為多模塊編寫

  標簽： verilog hdl CPU 編寫

  上傳時間： 2013-12-10

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• verilog HDL編寫的出租車計費系統免費下載

  資源簡介：verilog HDL編寫的出租車計費系統

  標簽： verilog HDL 編寫 出租車計費系統

  上傳時間： 2015-11-20

  上傳用戶：nanshan

• verilog代碼編寫規范免費下載

  資源簡介：verilog代碼編寫規范，里面有一些小例子，很好的入門教材

  標簽： verilog 代碼 編寫

  上傳時間： 2014-01-25

  上傳用戶：maizezhen

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  資源簡介：實現簡單的UART功能,在QUARTUS4.0下編譯通過,采用VERILOG HDL編寫.

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  上傳時間： 2013-12-18

  上傳用戶：hfmm633

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  標簽： verilog hdl 編寫

  上傳時間： 2013-12-20

  上傳用戶：fhzm5658

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  上傳時間： 2013-11-29

  上傳用戶：頂得柱

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  資源簡介：Verilog HDL編寫的四位數碼管動態顯示程序,外圍電路用CPLD來實現

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  上傳時間： 2016-06-12

  上傳用戶：米卡

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  資源簡介：用Verilog HDL編寫的0832源程序，實現對0832實現D/A轉換。也可方便地轉換為vhdl源程序。

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  上傳時間： 2013-11-25

  上傳用戶：qiao8960

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  標簽： Verilog C68013 68013 SLAVE

  上傳時間： 2016-10-13

  上傳用戶：ljmwh2000

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  上傳時間： 2013-12-09

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  上傳時間： 2016-12-24

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  上傳時間： 2014-01-27

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  上傳時間： 2014-01-03

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  上傳時間： 2017-04-18

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  上傳時間： 2013-11-29

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  上傳時間： 2017-07-09

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  上傳時間： 2017-07-09

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