相 關(guān) 資 源

• VHDL語言實(shí)現(xiàn)三人表決器控制電路免費(fèi)下載

  資源簡介：VHDL語言實(shí)現(xiàn)三人表決器控制電路，有優(yōu)先級自主設(shè)定等功能

  標(biāo)簽： VHDL 語言 三人表決器 控制電路

  上傳時間： 2013-12-03

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• 用VHDL語言設(shè)計三人表決器 新建VHDL設(shè)計文件并保存 檢查編譯 波形仿真免費(fèi)下載

  資源簡介：用VHDL語言設(shè)計三人表決器 新建VHDL設(shè)計文件并保存 檢查編譯 波形仿真

  標(biāo)簽： VHDL 語言 三人表決器 設(shè)計文件

  上傳時間： 2014-12-07

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• 包含VHDL語言設(shè)計7人表決器電路和系檢測器列免費(fèi)下載

  資源簡介：包含VHDL語言設(shè)計7人表決器電路和系檢測器列

  標(biāo)簽： VHDL 語言 表決器 電路

  上傳時間： 2014-01-05

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• VHDL 語言編寫的一個AC0809控制電路,構(gòu)成采樣單片機(jī)的例子.免費(fèi)下載

  資源簡介：VHDL 語言編寫的一個AC0809控制電路,構(gòu)成采樣單片機(jī)的例子.

  標(biāo)簽： VHDL 0809 AC 語言

  上傳時間： 2014-12-22

  上傳用戶：BOBOniu

• 要求用VHDL語言設(shè)計7人表決器和系列檢測器免費(fèi)下載

  資源簡介：要求用VHDL語言設(shè)計7人表決器和系列檢測器，檢測“1111111101111110”

  標(biāo)簽： VHDL 語言 表決器 檢測器

  上傳時間： 2013-12-26

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• 本源碼用VHDL語言實(shí)現(xiàn)了用鍵盤控制米字管顯示十進(jìn)制免費(fèi)下載

  資源簡介：本源碼用VHDL語言實(shí)現(xiàn)了用鍵盤控制米字管顯示十進(jìn)制

  標(biāo)簽： VHDL 源碼 十進(jìn)制 語言

  上傳時間： 2014-01-18

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• 用VHDL語言實(shí)現(xiàn)一個10秒倒計時電路免費(fèi)下載

  資源簡介：用VHDL語言實(shí)現(xiàn)一個10秒倒計時電路，要求使用8*8點(diǎn)陣顯示計時結(jié)果

  標(biāo)簽： VHDL 語言 倒計時電路

  上傳時間： 2013-12-09

  上傳用戶：aa54

• 用VHDL語言編寫的三人表決器免費(fèi)下載

  資源簡介：用VHDL語言編寫的三人表決器，多數(shù)服從少數(shù)，或者一致通過。

  標(biāo)簽： VHDL 語言 編寫 三人表決器

  上傳時間： 2014-01-11

  上傳用戶：cc1915

• 本程序是用VHDL語言實(shí)現(xiàn)電子密碼鎖功能,整個系統(tǒng)分為三大模塊,一為控制模塊,二為鍵盤顯示模塊,三為處理模塊免費(fèi)下載

  資源簡介：本程序是用VHDL語言實(shí)現(xiàn)電子密碼鎖功能,整個系統(tǒng)分為三大模塊,一為控制模塊,二為鍵盤顯示模塊,三為處理模塊

  標(biāo)簽： VHDL 模塊 程序 電子密碼鎖

  上傳時間： 2014-01-15

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• VHDL實(shí)現(xiàn)的三人表決器免費(fèi)下載

  資源簡介：VHDL實(shí)現(xiàn)的三人表決器，大家一起交流一下，

  標(biāo)簽： VHDL 三人表決器

  上傳時間： 2017-01-31

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• 利用VHDL語言實(shí)現(xiàn)單穩(wěn)觸發(fā)電路免費(fèi)下載

  資源簡介：利用VHDL語言實(shí)現(xiàn)單穩(wěn)觸發(fā)電路，穩(wěn)態(tài)時間為系統(tǒng)時鐘的整數(shù)倍。

  標(biāo)簽： VHDL 語言 觸發(fā)電路

  上傳時間： 2015-06-01

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• 用VHDL語言實(shí)現(xiàn)的控制DS18B20構(gòu)成測溫儀表的程序免費(fèi)下載

  資源簡介：用VHDL語言實(shí)現(xiàn)的控制DS18B20構(gòu)成測溫儀表的程序，包含了全部代碼，可顯示最高精度

  標(biāo)簽： VHDL 18B B20 DS

  上傳時間： 2015-11-04

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• 本程序是用VHDL語言實(shí)現(xiàn)對AD控制免費(fèi)下載

  資源簡介：本程序是用VHDL語言實(shí)現(xiàn)對AD控制，內(nèi)含源代碼，仿真結(jié)果及解釋說明。相信大家看了就會明白

  標(biāo)簽： VHDL 程序 控制 語言

  上傳時間： 2013-11-29

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• 用VHDL語言實(shí)現(xiàn)交通燈控制的設(shè)計 這是學(xué)習(xí)VHDL語言的經(jīng)典例子免費(fèi)下載

  資源簡介：用VHDL語言實(shí)現(xiàn)交通燈控制的設(shè)計 這是學(xué)習(xí)VHDL語言的經(jīng)典例子

  標(biāo)簽： VHDL VHDL 語言 交通燈控制

  上傳時間： 2016-02-09

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• 本文詳細(xì)分析了COOLRUNNER系列CPLD的結(jié)構(gòu),特點(diǎn)及功能,使用VHDL語言實(shí)現(xiàn)數(shù)字邏輯,實(shí)現(xiàn)了水下沖擊波記錄儀電路的數(shù)字電路部分.免費(fèi)下載

  資源簡介：本文詳細(xì)分析了COOLRUNNER系列CPLD的結(jié)構(gòu),特點(diǎn)及功能,使用VHDL語言實(shí)現(xiàn)數(shù)字邏輯,實(shí)現(xiàn)了水下沖擊波記錄儀電路的數(shù)字電路部分.

  標(biāo)簽： COOLRUNNER CPLD VHDL 分

  上傳時間： 2013-12-18

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• 利用一塊芯片完成除時鐘源、按鍵、揚(yáng)聲器和顯示器（數(shù)碼管）之外的所有數(shù)字電路功能。所有數(shù)字邏輯功能都在CPLD器件上用VHDL語言實(shí)現(xiàn)。這樣設(shè)計具有體積小、設(shè)計周期短（設(shè)計過程中即可實(shí)現(xiàn)時序仿真）、調(diào)試免費(fèi)下載

  資源簡介：利用一塊芯片完成除時鐘源、按鍵、揚(yáng)聲器和顯示器（數(shù)碼管）之外的所有數(shù)字電路功能。所有數(shù)字邏輯功能都在CPLD器件上用VHDL語言實(shí)現(xiàn)。這樣設(shè)計具有體積小、設(shè)計周期短（設(shè)計過程中即可實(shí)現(xiàn)時序仿真）、調(diào)試方便、故障率低、修改升級容易等特點(diǎn)。 本設(shè)計采用...

  標(biāo)簽： CPLD VHDL 芯片 時鐘源

  上傳時間： 2014-01-02

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• 這是一個用VHDL語言實(shí)現(xiàn)的非常實(shí)用的表決器免費(fèi)下載

  資源簡介：這是一個用VHDL語言實(shí)現(xiàn)的非常實(shí)用的表決器

  標(biāo)簽： VHDL 語言 表決器

  上傳時間： 2016-11-10

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• 用VHDL語言實(shí)現(xiàn)的八個開關(guān)控制八個LED燈的亮滅免費(fèi)下載

  資源簡介：用VHDL語言實(shí)現(xiàn)的八個開關(guān)控制八個LED燈的亮滅，本程序經(jīng)過實(shí)驗(yàn)箱認(rèn)證，絕對可用。

  標(biāo)簽： VHDL LED 語言 開關(guān)控制

  上傳時間： 2013-11-28

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• 利用一塊芯片完成除時鐘源、按鍵、揚(yáng)聲器和顯示器（數(shù)碼管）之外的所有數(shù)字電路功能。所有數(shù)字邏輯功能都在CPLD器件上用VHDL語言實(shí)現(xiàn)。這樣設(shè)計具有體積小、設(shè)計周期短（設(shè)計過程中即可實(shí)現(xiàn)時序仿真）、調(diào)試免費(fèi)下載

  資源簡介：利用一塊芯片完成除時鐘源、按鍵、揚(yáng)聲器和顯示器（數(shù)碼管）之外的所有數(shù)字電路功能。所有數(shù)字邏輯功能都在CPLD器件上用VHDL語言實(shí)現(xiàn)。這樣設(shè)計具有體積小、設(shè)計周期短（設(shè)計過程中即可實(shí)現(xiàn)時序仿真）、調(diào)試方便、故障率低、修改升級容易等特點(diǎn)

  標(biāo)簽： CPLD VHDL 芯片 時鐘源

  上傳時間： 2013-12-26

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• 使用VHDL語言實(shí)現(xiàn)數(shù)字電路全加器功能免費(fèi)下載

  資源簡介：使用VHDL語言實(shí)現(xiàn)數(shù)字電路全加器功能，算法比較簡單，供初學(xué)者參考。

  標(biāo)簽： VHDL 語言 數(shù)字電路 全加器

  上傳時間： 2013-12-10

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• 常用數(shù)字邏輯功能都在CPLD器件上用VHDL語言實(shí)現(xiàn)免費(fèi)下載

  資源簡介：利用一塊芯片完成除時鐘源、按鍵、揚(yáng)聲器和顯示器（數(shù)碼管）之外的所有數(shù)字電路功能。所有數(shù)字邏輯功能都在CPLD器件上用VHDL語言實(shí)現(xiàn)。這樣設(shè)計具有體積小、設(shè)計周期短（設(shè)計過程中即可實(shí)現(xiàn)時序仿真）、調(diào)試方便、故障率低、修改升級容易等特點(diǎn)

  標(biāo)簽： CPLD VHDL 數(shù)字邏輯 器件

  上傳時間： 2013-08-11

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• VHDL語言編寫三分頻免費(fèi)下載

  資源簡介：VHDL語言編寫三分頻，可以擴(kuò)展實(shí)現(xiàn)任意奇數(shù)

  標(biāo)簽： VHDL 語言 編寫 三分頻

  上傳時間： 2013-12-01

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• 1.高精度數(shù)字秒表（0.01秒的VHDL語言實(shí)現(xiàn)） 2.具有定時免費(fèi)下載

  資源簡介：1.高精度數(shù)字秒表（0.01秒的VHDL語言實(shí)現(xiàn)） 2.具有定時，暫停，按鍵隨機(jī)存儲，翻頁回放功能； 3.對30M時鐘分頻產(chǎn)生顯示掃描時鐘 4.精度高達(dá)0.01s,并且可以通過改變主頻來更改分頻比和記數(shù)間隔，可控性高。 5.模塊化設(shè)計，其中的許多函數(shù)可以成為VHDL語言...

  標(biāo)簽： 0.01 VHDL 高精度 數(shù)字秒表

  上傳時間： 2015-08-16

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• 用 VHDL語言實(shí)現(xiàn)鬧鐘功能免費(fèi)下載

  資源簡介：用 VHDL語言實(shí)現(xiàn)鬧鐘功能，可用于數(shù)字鐘設(shè)計的單元電路，顯示電路程序。

  標(biāo)簽： VHDL 語言 鬧鐘

  上傳時間： 2016-06-13

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• 該程序是用VHDL語言實(shí)現(xiàn)的時鐘程序免費(fèi)下載

  資源簡介：該程序是用VHDL語言實(shí)現(xiàn)的時鐘程序，用六個數(shù)碼管分別顯示時分秒，而且可以實(shí)現(xiàn)控制功能。

  標(biāo)簽： VHDL 程序 時鐘程序 語言

  上傳時間： 2013-12-23

  上傳用戶：2525775

• 該程序是用VHDL語言實(shí)現(xiàn)的揚(yáng)聲器程序免費(fèi)下載

  資源簡介：該程序是用VHDL語言實(shí)現(xiàn)的揚(yáng)聲器程序，可以通過不同的按鍵控制發(fā)出不同頻率的聲音。

  標(biāo)簽： VHDL 程序 揚(yáng)聲器 語言

  上傳時間： 2014-01-23

  上傳用戶：xfbs821

• 用VHDL語言實(shí)現(xiàn)的基于FPGA的交換機(jī)設(shè)計免費(fèi)下載

  資源簡介：用VHDL語言實(shí)現(xiàn)的基于FPGA的交換機(jī)設(shè)計

  標(biāo)簽： VHDL FPGA 語言 交換機(jī)

  上傳時間： 2013-04-24

  上傳用戶：歸海惜雪

• 采用VHDL語言實(shí)現(xiàn)正弦波形的生成，主要使用的dds技術(shù)免費(fèi)下載

  資源簡介：采用VHDL語言實(shí)現(xiàn)正弦波形的生成。主要使用的dds技術(shù)。

  標(biāo)簽： VHDL dds 語言 正弦

  上傳時間： 2013-08-09

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• FPGA串口界面調(diào)試程序,用VHDL語言實(shí)現(xiàn)免費(fèi)下載

  資源簡介：FPGA串口界面調(diào)試程序,用VHDL語言實(shí)現(xiàn)

  標(biāo)簽： FPGA VHDL 串口 調(diào)試

  上傳時間： 2013-08-11

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• 此程序用通過PFGA用VHDL語言實(shí)現(xiàn)了傅立葉變換免費(fèi)下載

  資源簡介：此程序用通過PFGA用VHDL語言實(shí)現(xiàn)了傅立葉變換，希望對大家有用

  標(biāo)簽： PFGA VHDL 程序 傅立葉變換

  上傳時間： 2013-08-30

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