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  資源簡介：本源碼用VHDL語言實(shí)現(xiàn)了用鍵盤控制米字管顯示十進(jìn)制

  標(biāo)簽： VHDL 源碼 十進(jìn)制 語言

  上傳時間： 2014-01-18

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• 此程序用通過PFGA用VHDL語言實(shí)現(xiàn)了傅立葉變換免費(fèi)下載

  資源簡介：此程序用通過PFGA用VHDL語言實(shí)現(xiàn)了傅立葉變換，希望對大家有用

  標(biāo)簽： PFGA VHDL 程序 傅立葉變換

  上傳時間： 2013-08-30

  上傳用戶：tonyshao

• 此程序用通過PFGA用VHDL語言實(shí)現(xiàn)了傅立葉變換免費(fèi)下載

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  標(biāo)簽： PFGA VHDL 程序 傅立葉變換

  上傳時間： 2014-01-19

  上傳用戶：zhoujunzhen

• 這是一個用VHDL語言實(shí)現(xiàn)了DES加密功能的程序免費(fèi)下載

  資源簡介：這是一個用VHDL語言實(shí)現(xiàn)了DES加密功能的程序，由于DES加密的模式，解密時需把密要倒置

  標(biāo)簽： VHDL DES 語言 加密

  上傳時間： 2013-12-04

  上傳用戶：hebmuljb

• 用VHDL語言實(shí)現(xiàn)了DES加密算法免費(fèi)下載

  資源簡介：用VHDL語言實(shí)現(xiàn)了DES加密算法，其中包含了測試程序，能夠進(jìn)行仿真。

  標(biāo)簽： VHDL DES 語言 加密算法

  上傳時間： 2013-12-01

  上傳用戶：Miyuki

• 本源碼用MATLAB語言實(shí)現(xiàn)了自適應(yīng)LMS算法免費(fèi)下載

  資源簡介：本源碼用MATLAB語言實(shí)現(xiàn)了自適應(yīng)LMS算法，并附有FFT分析

  標(biāo)簽： MATLAB LMS 源碼 語言

  上傳時間： 2014-01-09

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• 本源碼用MATLAB語言實(shí)現(xiàn)了自適應(yīng)RLS算法免費(fèi)下載

  資源簡介：本源碼用MATLAB語言實(shí)現(xiàn)了自適應(yīng)RLS算法，并附有FFT分析

  標(biāo)簽： MATLAB RLS 源碼 語言

  上傳時間： 2017-07-04

  上傳用戶：ve3344

• 它用C語言實(shí)現(xiàn)了卷積碼的解編碼過程免費(fèi)下載

  資源簡介：它用C語言實(shí)現(xiàn)了卷積碼的解編碼過程，對各位學(xué)生做相關(guān)論文有幫助

  標(biāo)簽： C語言 卷積碼 編碼 過程

  上傳時間： 2016-06-12

  上傳用戶：weixiao99

• 用VHDL語言實(shí)現(xiàn)8421碼的十進(jìn)制計(jì)數(shù)器免費(fèi)下載

  資源簡介：用VHDL語言實(shí)現(xiàn)8421碼的十進(jìn)制計(jì)數(shù)器，狀態(tài)變化0000->0001->0010->0011->0100->0101->0110->0111->1000->0000.循環(huán)往復(fù)。

  標(biāo)簽： VHDL 8421 語言 十進(jìn)制計(jì)數(shù)器

  上傳時間： 2013-12-08

  上傳用戶：frank1234

• 用VHDL語言實(shí)現(xiàn)的控制DS18B20構(gòu)成測溫儀表的程序免費(fèi)下載

  資源簡介：用VHDL語言實(shí)現(xiàn)的控制DS18B20構(gòu)成測溫儀表的程序，包含了全部代碼，可顯示最高精度

  標(biāo)簽： VHDL 18B B20 DS

  上傳時間： 2015-11-04

  上傳用戶：agent

• 本程序是用VHDL語言實(shí)現(xiàn)對AD控制免費(fèi)下載

  資源簡介：本程序是用VHDL語言實(shí)現(xiàn)對AD控制，內(nèi)含源代碼，仿真結(jié)果及解釋說明。相信大家看了就會明白

  標(biāo)簽： VHDL 程序 控制 語言

  上傳時間： 2013-11-29

  上傳用戶：cx111111

• 8051開源IP核，用VHDL語言實(shí)現(xiàn)免費(fèi)下載

  資源簡介：經(jīng)過仿真驗(yàn)證的MC8051IP核源碼，用VHDL語言實(shí)現(xiàn)。

  標(biāo)簽： 8051 開源 IP核

  上傳時間： 2022-02-28

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• 用VHDL語言實(shí)現(xiàn)的基于FPGA的交換機(jī)設(shè)計(jì)免費(fèi)下載

  資源簡介：用VHDL語言實(shí)現(xiàn)的基于FPGA的交換機(jī)設(shè)計(jì)

  標(biāo)簽： VHDL FPGA 語言 交換機(jī)

  上傳時間： 2013-04-24

  上傳用戶：歸海惜雪

• 常用數(shù)字邏輯功能都在CPLD器件上用VHDL語言實(shí)現(xiàn)免費(fèi)下載

  資源簡介：利用一塊芯片完成除時鐘源、按鍵、揚(yáng)聲器和顯示器（數(shù)碼管）之外的所有數(shù)字電路功能。所有數(shù)字邏輯功能都在CPLD器件上用VHDL語言實(shí)現(xiàn)。這樣設(shè)計(jì)具有體積小、設(shè)計(jì)周期短（設(shè)計(jì)過程中即可實(shí)現(xiàn)時序仿真）、調(diào)試方便、故障率低、修改升級容易等特點(diǎn)

  標(biāo)簽： CPLD VHDL 數(shù)字邏輯 器件

  上傳時間： 2013-08-11

  上傳用戶：hn891122

• FPGA串口界面調(diào)試程序,用VHDL語言實(shí)現(xiàn)免費(fèi)下載

  資源簡介：FPGA串口界面調(diào)試程序,用VHDL語言實(shí)現(xiàn)

  標(biāo)簽： FPGA VHDL 串口 調(diào)試

  上傳時間： 2013-08-11

  上傳用戶：362279997

• Little C解釋程序源代碼用C語言實(shí)現(xiàn)了一個C語言的子集的解釋程序免費(fèi)下載

  資源簡介：Little C解釋程序源代碼用C語言實(shí)現(xiàn)了一個C語言的子集的解釋程序，之所以是子集，是由于考慮到本次畢業(yè)設(shè)計(jì)的時間上并不允許將整個C語言的解釋程序完成，事實(shí)上，若要將整個C語言的解釋程序完成，那將不是憑一己之力加上數(shù)月可以完成的。為此，結(jié)合所學(xué)的編譯...

  標(biāo)簽： Little C語言 程序 源代碼

  上傳時間： 2013-12-25

  上傳用戶：nanxia

• 本程序用Matlab語言實(shí)現(xiàn)了基于Arnold變換的圖像置亂算法免費(fèi)下載

  資源簡介：本程序用Matlab語言實(shí)現(xiàn)了基于Arnold變換的圖像置亂算法

  標(biāo)簽： Matlab Arnold 程序 變換

  上傳時間： 2015-03-24

  上傳用戶：hullow

• 用VHDL語言實(shí)現(xiàn)的ARM處理器的標(biāo)準(zhǔn)內(nèi)核的源代碼程序免費(fèi)下載

  資源簡介：用VHDL語言實(shí)現(xiàn)的ARM處理器的標(biāo)準(zhǔn)內(nèi)核的源代碼程序，可在重用

  標(biāo)簽： VHDL ARM 語言 處理器

  上傳時間： 2013-12-11

  上傳用戶：稀世之寶039

• 用C語言實(shí)現(xiàn)了LZ77算法。程序獨(dú)特之處在于使用了64KB大小的固定長度窗口免費(fèi)下載

  資源簡介：用C語言實(shí)現(xiàn)了LZ77算法。程序獨(dú)特之處在于使用了64KB大小的固定長度窗口，利用此方法可分塊壓縮數(shù)據(jù)。

  標(biāo)簽： 77 64 LZ KB

  上傳時間： 2015-04-05

  上傳用戶：hongmo

• 程序用C語言實(shí)現(xiàn)了貝葉斯在數(shù)據(jù)挖掘中分類和預(yù)測中的應(yīng)用免費(fèi)下載

  資源簡介：程序用C語言實(shí)現(xiàn)了貝葉斯在數(shù)據(jù)挖掘中分類和預(yù)測中的應(yīng)用，通過程序可以很好的進(jìn)行分類和預(yù)測。

  標(biāo)簽： 程序 C語言 數(shù)據(jù)挖掘 分類

  上傳時間： 2013-12-20

  上傳用戶：chongcongying

• 本程序用C語言實(shí)現(xiàn)了集成神經(jīng)網(wǎng)絡(luò)解決廣義異或問題。用神經(jīng)網(wǎng)絡(luò)集成方法做成表決網(wǎng),可克服初始權(quán)值的影響,對神經(jīng)網(wǎng)絡(luò)分類器來說:假設(shè)有N個獨(dú)立的子網(wǎng),采用絕對多數(shù)投票法,再假設(shè)每個子網(wǎng)以1-p的概率給出正免費(fèi)下載

  資源簡介：本程序用C語言實(shí)現(xiàn)了集成神經(jīng)網(wǎng)絡(luò)解決廣義異或問題。用神經(jīng)網(wǎng)絡(luò)集成方法做成表決網(wǎng),可克服初始權(quán)值的影響,對神經(jīng)網(wǎng)絡(luò)分類器來說:假設(shè)有N個獨(dú)立的子網(wǎng),采用絕對多數(shù)投票法,再假設(shè)每個子網(wǎng)以1-p的概率給出正確結(jié)果,且網(wǎng)絡(luò)之間的錯誤不相關(guān),則表決系統(tǒng)發(fā)生錯誤的...

  標(biāo)簽： 神經(jīng)網(wǎng)絡(luò) 子網(wǎng) 程序 C語言

  上傳時間： 2015-05-03

  上傳用戶：kiklkook

• 本程序是用VHDL語言實(shí)現(xiàn)異步通信控制器免費(fèi)下載

  資源簡介：本程序是用VHDL語言實(shí)現(xiàn)異步通信控制器， hao1.vhd為主程序，hao1.scf為仿真波形

  標(biāo)簽： VHDL 程序 異步通信 控制器

  上傳時間： 2015-05-25

  上傳用戶：yt1993410

• 該程序用C語言實(shí)現(xiàn)了大整數(shù)的加減乘除運(yùn)算免費(fèi)下載

  資源簡介：該程序用C語言實(shí)現(xiàn)了大整數(shù)的加減乘除運(yùn)算

  標(biāo)簽： 程序 C語言 整數(shù) 減

  上傳時間： 2015-05-28

  上傳用戶：zhangyi99104144

• 本程序用c++語言實(shí)現(xiàn)了wcdma系統(tǒng)當(dāng)中的信道預(yù)測算法免費(fèi)下載

  資源簡介：本程序用c++語言實(shí)現(xiàn)了wcdma系統(tǒng)當(dāng)中的信道預(yù)測算法，并給出了該算法的吞吐量以及誤碼率的性能

  標(biāo)簽： wcdma 程序 信道 語言

  上傳時間： 2013-12-22

  上傳用戶：zhuimenghuadie

• 用C語言實(shí)現(xiàn)了遺傳算法,上機(jī)調(diào)試即可應(yīng)用,很好的東西免費(fèi)下載

  資源簡介：用C語言實(shí)現(xiàn)了遺傳算法,上機(jī)調(diào)試即可應(yīng)用,很好的東西

  標(biāo)簽： C語言 算法 調(diào)試

  上傳時間： 2014-01-06

  上傳用戶：xiaohuanhuan

• 用VC++語言實(shí)現(xiàn)了基于距離免費(fèi)下載

  資源簡介：用VC++語言實(shí)現(xiàn)了基于距離，基于密度和改進(jìn)的數(shù)據(jù)聚類算法。

  標(biāo)簽： VC 語言

  上傳時間： 2013-12-24

  上傳用戶：wendy15

• 這是Atmel16單片機(jī)控制DDS芯片（AD9850）的源代碼。程序用C語言實(shí)現(xiàn)了兩個功能：一是控制DDS芯片輸出不同頻率的正弦波；二是并在LCD上顯示當(dāng)前頻率。免費(fèi)下載

  資源簡介：這是Atmel16單片機(jī)控制DDS芯片（AD9850）的源代碼。程序用C語言實(shí)現(xiàn)了兩個功能：一是控制DDS芯片輸出不同頻率的正弦波；二是并在LCD上顯示當(dāng)前頻率。

  標(biāo)簽： DDS Atmel 9850 LCD

  上傳時間： 2013-12-21

  上傳用戶：caixiaoxu26

• 用VHDL語言實(shí)現(xiàn)六分頻免費(fèi)下載

  資源簡介：用VHDL語言實(shí)現(xiàn)六分頻，并且已經(jīng)通過編譯和仿真。由此可舉一反三，實(shí)現(xiàn)任意偶數(shù)次分頻。

  標(biāo)簽： VHDL 語言 分頻

  上傳時間： 2015-09-19

  上傳用戶：yyq123456789

• 用java語言實(shí)現(xiàn)了B樣條曲線的做法。 可以自由輸入控制點(diǎn)免費(fèi)下載

  資源簡介：用java語言實(shí)現(xiàn)了B樣條曲線的做法。 可以自由輸入控制點(diǎn)，并可以通過鼠標(biāo)調(diào)節(jié)控制點(diǎn)的位置。

  標(biāo)簽： java 語言 控制 輸入

  上傳時間： 2015-10-14

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• 用VHDL語言實(shí)現(xiàn)DDS直接數(shù)字頻率合成器的設(shè)計(jì)免費(fèi)下載

  資源簡介：用VHDL語言實(shí)現(xiàn)DDS直接數(shù)字頻率合成器的設(shè)計(jì)，采用正弦RAM表，可實(shí)現(xiàn)頻率可控的正弦數(shù)字信號，編譯、仿真通過。

  標(biāo)簽： VHDL DDS 語言 數(shù)字頻率合成器

  上傳時間： 2014-01-04

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