隨著社會(huì)的發(fā)展，網(wǎng)絡(luò)視頻監(jiān)控系統(tǒng)已經(jīng)成為日常生產(chǎn)生活中的重要輔助設(shè)備，應(yīng)用十分廣泛。當(dāng)前視頻監(jiān)控系統(tǒng)正逐步由模擬化走向數(shù)字化，隨著視頻壓縮技術(shù)和網(wǎng)絡(luò)技術(shù)的發(fā)展，開發(fā)新一代的基于計(jì)算機(jī)網(wǎng)絡(luò)和多媒體MPEG-4壓縮算法的視頻監(jiān)控系統(tǒng)已成為整個(gè)行業(yè)技術(shù)發(fā)展的主要方向之一。人們有時(shí)會(huì)采用DSP與MPEG-4算法結(jié)合的方案來實(shí)現(xiàn)，也有的部門采用了片上系統(tǒng)(SOC)，但這些不但編程極度復(fù)雜，而且成本也過高。本文提出并研究設(shè)計(jì)了一種基于ARM微處理器S3C2410、MPEG-4專用壓縮芯片MPG440、以嵌入式Linux為操作系統(tǒng)的視頻監(jiān)控系統(tǒng)方案，不僅開發(fā)便捷、成本低廉，而且實(shí)時(shí)性較好，適應(yīng)范圍廣。 首先，采用軟硬件協(xié)同設(shè)計(jì)的思想提出了系統(tǒng)的總體設(shè)計(jì)方案，系統(tǒng)的整體架構(gòu)分為攝像頭、云臺(tái)控制器、網(wǎng)絡(luò)視頻服務(wù)器以及客戶端PC機(jī)等四大部分。 第二，以三星公司的S3C2410芯片和DAVICOM公司的DM9000以太網(wǎng)接口芯片為硬件核心，對(duì)整個(gè)系統(tǒng)進(jìn)行了模塊化的硬件電路的設(shè)計(jì)。根據(jù)S3C2410的特點(diǎn)及系統(tǒng)整體需求，完成了電源復(fù)位模塊、晶振模塊、存儲(chǔ)器接口模塊、視頻數(shù)據(jù)處理模塊、以太網(wǎng)接口模塊、云臺(tái)控制模塊等的硬件選型與電路連接。其中，在云臺(tái)控制模塊等的電路設(shè)計(jì)中充分體現(xiàn)了優(yōu)化設(shè)計(jì)的技巧，并重點(diǎn)對(duì)網(wǎng)絡(luò)接口部分和視頻數(shù)據(jù)處理部分進(jìn)行了詳細(xì)的硬件設(shè)計(jì)與說明。闡述了整個(gè)系統(tǒng)的工作流程。 第三，從應(yīng)用需求出發(fā)，選擇嵌入式Linux操作系統(tǒng)作為本系統(tǒng)的軟件平臺(tái)，搭建了交叉式的開發(fā)環(huán)境，對(duì)bootloader進(jìn)行了選擇，并給出了加載步驟。完成了對(duì)嵌入式Linux內(nèi)核的選擇及移植。 第四，采用基于任務(wù)的設(shè)計(jì)方法對(duì)服務(wù)器端的軟件進(jìn)行了總體設(shè)計(jì)，主要包括共用程序庫、config配置文件、日志文件以及多個(gè)任務(wù)等。并對(duì)運(yùn)行于客戶端的軟件設(shè)計(jì)進(jìn)行了簡(jiǎn)要說明。 第五，由于數(shù)字視頻傳輸?shù)膶?shí)時(shí)性能和通過網(wǎng)絡(luò)傳輸以后客戶端接收的視頻圖像質(zhì)量在本系統(tǒng)中至關(guān)重要，所以本文對(duì)傳輸信道和網(wǎng)絡(luò)協(xié)議進(jìn)行了優(yōu)化選擇，并詳細(xì)闡述了IP組播技術(shù)、流媒體傳輸協(xié)議等在圖像傳輸過程中的具體應(yīng)用。
標(biāo)簽： Linux ARM 嵌入式 網(wǎng)絡(luò)視頻
上傳時(shí)間： 2013-04-24
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嵌入式系統(tǒng)是以應(yīng)用為中心，以計(jì)算機(jī)為基礎(chǔ)，并且軟硬件可裁剪，適用于應(yīng)用系統(tǒng)對(duì)功能、可靠性、成本、體積、功耗有嚴(yán)格要求的專用計(jì)算機(jī)系統(tǒng)。嵌入式系統(tǒng)一般由嵌入式微處理器、外圍硬件設(shè)備、嵌入式操作系統(tǒng)以及用戶的應(yīng)用程序4部分組成，用于實(shí)現(xiàn)對(duì)其它設(shè)備的控制、監(jiān)視或管理等功能。其廣泛應(yīng)用于控制領(lǐng)域、消費(fèi)電子產(chǎn)品等行業(yè)，已成為現(xiàn)代電子領(lǐng)域的重要研究方向之一。而隨著電子技術(shù)，多媒體技術(shù)及網(wǎng)絡(luò)技術(shù)快速發(fā)展，視頻監(jiān)控系統(tǒng)也正在向嵌入式，數(shù)字化，網(wǎng)絡(luò)化方向發(fā)展。嵌入式視頻監(jiān)控系統(tǒng)充分利用大規(guī)模集成電路和網(wǎng)絡(luò)的科技成果，實(shí)現(xiàn)體積小巧，性能穩(wěn)定，通訊便利的監(jiān)控產(chǎn)品。本項(xiàng)的目的正是建立一個(gè)完整的基于 ARM9 核心處理器和嵌入式 Linux 操作系統(tǒng)的嵌入式視頻監(jiān)控系統(tǒng)。 本項(xiàng)目是在 ARM 微處理器平臺(tái)上，移植嵌入式Linux操作系統(tǒng)，并完成視頻采集、壓縮、傳輸任務(wù)。系統(tǒng)采用 ARM 微處理器 AT91RM9200作為主處理器，以視頻采集芯片 ADV7181 作為視頻采集設(shè)備，用 H.263視頻壓縮協(xié)議對(duì)視頻數(shù)據(jù)進(jìn)行壓縮，最后通過中興通信公司 MG815+CDMA通信模塊傳輸?shù)椒?wù)器上。 本論文主要分成五個(gè)章節(jié)： 第一章:首先介紹ARM和嵌入式Linux操作系統(tǒng)的特點(diǎn)和當(dāng)前的發(fā)展概況，然后說明了本文的課題背景及意義； 第二章:描述了硬件開發(fā)平臺(tái)。本系統(tǒng)采用了 ALTMEL 的AT91RM9200為核心的開發(fā)平臺(tái)，并擴(kuò)展了以視頻采集模塊和CDMA無線傳輸模塊； 第三章:描述了本系統(tǒng)的軟件開發(fā)平臺(tái)，包括嵌入式Linux開發(fā)流程以及移植到具體硬件平臺(tái)需要完成的工作，如 U-Boot 的移植、Linux內(nèi)核的編譯與裁剪、文件系統(tǒng)的制作等； 第四章:首先論述了本系統(tǒng)中的難點(diǎn) FIFO 設(shè)備的驅(qū)動(dòng)編寫，隨后在對(duì)H.263視頻壓縮編碼敘述的基礎(chǔ)上針對(duì)塊匹配運(yùn)動(dòng)估計(jì)給出了一種改進(jìn)的菱形搜索算法代替原有的三步搜索法，并且通過實(shí)驗(yàn)結(jié)果證明，經(jīng)算法改進(jìn)優(yōu)化的新菱形算法優(yōu)于原先的三步搜索法； 第五章:得出了實(shí)驗(yàn)結(jié)果，完成了視頻數(shù)據(jù)的無線網(wǎng)絡(luò)傳輸。
標(biāo)簽： LINUX ARM 嵌入式 無線視頻監(jiān)控系統(tǒng)
上傳時(shí)間： 2013-04-24
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大規(guī)模可編程邏輯器件CPLD和FPGA是當(dāng)今應(yīng)用最廣泛的兩類可編程專用集成電路(ASIC),電子設(shè)計(jì)工程師用它可以在辦公室或?qū)嶒?yàn)室里設(shè)計(jì)出所需的專用集成電路,從而大大縮短了產(chǎn)品上市時(shí)間,降低了開發(fā)成本.此外,可編程邏輯器件還具有靜態(tài)可重復(fù)編程和動(dòng)態(tài)系統(tǒng)重構(gòu)的特性,使得硬件的功能可以象軟件一樣通過編程來修改,這樣就極大地提高了電子系統(tǒng)設(shè)計(jì)的靈活性和通用性.該設(shè)計(jì)完成了在一片可編程邏輯器件上開發(fā)簡(jiǎn)易計(jì)算機(jī)的設(shè)計(jì)任務(wù),將單片機(jī)與單片機(jī)外圍電路集成化,能夠輸入指令、執(zhí)行指令、輸出結(jié)果,具有在電子系統(tǒng)中應(yīng)用的普遍意義,另外,也可以用于計(jì)算機(jī)組成原理的教學(xué)試驗(yàn).該文第一章簡(jiǎn)要介紹了可編程ASIC和EDA技術(shù)的歷史、現(xiàn)狀、未來并對(duì)本課題作了簡(jiǎn)要陳述.第二章在芯片設(shè)計(jì)的兩種輸入法即原理圖輸入法和HDL輸入法之間做出比較,決定選用HDL輸入法.第三章描述了具體的設(shè)計(jì)過程和設(shè)計(jì)手段,首先將簡(jiǎn)易計(jì)算機(jī)劃分為運(yùn)算器、CPU控制器、存儲(chǔ)器、鍵盤接口和顯示接口以及系統(tǒng)控制器,然后再往下分為下層子模塊.輸入法的語言使用的是Verilog HDL,鑒于篇幅所限,源代碼部分不在論文之中.第四章對(duì)設(shè)計(jì)的綜合與實(shí)現(xiàn)做了總結(jié),給出了時(shí)序仿真波形圖.該文針對(duì)FPGA和RISC這兩大課題,對(duì)RISC在FPGA上的實(shí)現(xiàn)進(jìn)行了初淺的探索與嘗試.從計(jì)算機(jī)體系結(jié)構(gòu)入手,剖析了精簡(jiǎn)指令集計(jì)算機(jī)的原理,通過該設(shè)計(jì)的實(shí)踐對(duì)ASIC和EDA的設(shè)計(jì)潛力有了更進(jìn)一步的領(lǐng)悟.
標(biāo)簽： FPGA 指令集 計(jì)算機(jī)
上傳時(shí)間： 2013-05-21
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目前,以互聯(lián)網(wǎng)業(yè)務(wù)為代表的網(wǎng)絡(luò)應(yīng)用,正快速地向包括數(shù)據(jù)、語音、圖像的綜合寬帶多媒體方向發(fā)展,構(gòu)建寬帶化、大容量、全業(yè)務(wù)、智能化的現(xiàn)代通信網(wǎng)絡(luò)已成為大勢(shì)所趨.寬帶無線接入(BWA)憑借其組網(wǎng)快速靈活、運(yùn)營維護(hù)方便及成本較低等競(jìng)爭(zhēng)優(yōu)勢(shì),迅速成為市場(chǎng)熱點(diǎn),各種微波、無線通信領(lǐng)域的先進(jìn)手段和方法不斷引入,各種寬帶無線接入技術(shù)迅速涌現(xiàn).由于BWA要用于非視距傳輸,所以必須考慮無線信道的多經(jīng)效應(yīng).而OFDM技術(shù)憑借著魯棒的對(duì)抗頻率選擇性衰落能力和極高頻譜效率引起了學(xué)術(shù)界和工業(yè)界的高度重視.其基本思想是把調(diào)制在單載波上的高速串行數(shù)據(jù)流,分成多路低速的數(shù)據(jù)流,調(diào)制到多個(gè)正交載波上并行傳輸,這樣在傳輸時(shí),雖然整個(gè)信道是頻率選擇性衰落,但是各個(gè)子信道卻是平坦衰落,有效對(duì)抗了多經(jīng)效應(yīng),同時(shí)由于各個(gè)子載波是正交的,極大提高了頻譜效率.可以預(yù)料的是,隨著通信系統(tǒng)將向基于IPv6核心網(wǎng)的全I(xiàn)P包的傳輸方向發(fā)展,越來越多的通信系統(tǒng)將具有"突發(fā)模式"的特征.本文關(guān)注的正是突發(fā)OFDM系統(tǒng)接收機(jī)設(shè)計(jì)和實(shí)現(xiàn).由于IEEE 802.11a無線局域網(wǎng)是OFDM技術(shù)第一次真正的應(yīng)用于突發(fā)系統(tǒng),實(shí)現(xiàn)了面向IP的無線寬帶傳輸,所以基于IEEE 802.11a的突發(fā)OFDM系統(tǒng)有著重要的借鑒和研究價(jià)值,本文也正是圍繞著這個(gè)中心而展開.本文的各章節(jié)安排如下:在第一章中主要介紹OFDM的技術(shù)原理和在寬帶無線接入中的應(yīng)用,同時(shí)引出本文所關(guān)注的突發(fā)OFDM接收機(jī)設(shè)計(jì).在第二章中先介紹了相干接收和信道估計(jì)的概念,重點(diǎn)分析了本文所采用的WLAN信道模型和信道估計(jì)算法,然后在得到同步誤差表達(dá)式的基礎(chǔ)上,先用星座圖直觀的表現(xiàn)OFDM系統(tǒng)中各種同步誤差的影響,再從信噪比損失的角度對(duì)符種同步誤差進(jìn)行分析.第三章是本文的重點(diǎn)之一,在本章中對(duì)基于IEEE 802.11a的各種同步算法包括幀檢測(cè)和符號(hào)定時(shí)、載波同步和采樣時(shí)鐘同步進(jìn)行仿真和比較,并針對(duì)適合FPGA實(shí)現(xiàn)的同步算法進(jìn)行了重點(diǎn)的分析.第四章也是本文的重點(diǎn)之一,提出了整個(gè)OFDM系統(tǒng)平臺(tái)的硬件結(jié)構(gòu)和基于IEEE 802.11a的接收機(jī)FPGA設(shè)計(jì)方案,然后從整體上介紹了接收機(jī)的實(shí)現(xiàn)結(jié)構(gòu),并給出了接收機(jī)各個(gè)模塊的具體設(shè)計(jì),最后對(duì)整個(gè)系統(tǒng)調(diào)試過程和測(cè)試結(jié)果進(jìn)行了分析.
上傳時(shí)間： 2013-04-24
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近年來，隨著計(jì)算機(jī)和通信技術(shù)的飛速發(fā)展，特別是網(wǎng)絡(luò)的迅速普及和3C(計(jì)算機(jī)、通信、消費(fèi)電子)合一的加速，微型化和專業(yè)化成為發(fā)展的新趨勢(shì)，嵌入式產(chǎn)品已經(jīng)成為了信息產(chǎn)業(yè)的主流，嵌入式系統(tǒng)技術(shù)也成為目前電子產(chǎn)品設(shè)計(jì)領(lǐng)域最為熱門的技術(shù)之一，目前已經(jīng)廣泛地應(yīng)用于軍事國防、消費(fèi)電子、網(wǎng)絡(luò)通信、工業(yè)控制等各個(gè)領(lǐng)域。本文在研究視頻采集發(fā)展現(xiàn)狀和趨勢(shì)的基礎(chǔ)上，設(shè)計(jì)了一種基于32位處理器的嵌入式圖像采集和傳輸系統(tǒng)。此套硬件系統(tǒng)可應(yīng)用于LCD顯示屏、桌面視頻、多媒體、數(shù)字電視機(jī)、圖像處理、可視電話和遠(yuǎn)程戶外圖像采集等領(lǐng)域。 該圖像采集系統(tǒng)在硬件系統(tǒng)上以ARM芯片S3C44BOX為核心，利用CMOS圖像傳感器采集圖像；以FIFO幀存儲(chǔ)器暫存圖像數(shù)據(jù)，解決了ARM芯片與圖像傳感器之間速率的不同步問題；并充分利用了FPGA/CPLD高性能、低功耗、低成本的優(yōu)點(diǎn)，用CPID器件控制整個(gè)圖像采集的時(shí)序邏輯。在軟件平臺(tái)移植了嵌入式操作系統(tǒng)’uClinux,并在此基礎(chǔ)上開發(fā)了底層的驅(qū)動(dòng)程序和應(yīng)用程序。體積小巧，具備圖像采集、顯示和遠(yuǎn)程傳輸功能和良好的可擴(kuò)展性。 全文共分為五個(gè)章節(jié)，第一章主要介紹了論文的課題背景和圖像采集技術(shù)的發(fā)展現(xiàn)狀，介紹了論文的研究目標(biāo)和研究內(nèi)容。第二章從硬件和軟件兩方面闡述了嵌入式圖像采集系統(tǒng)的總體設(shè)計(jì)方案，詳細(xì)介紹了硬件開發(fā)平臺(tái)嵌入式系統(tǒng)和軟件開發(fā)平臺(tái)嵌入式操作系統(tǒng)各自的定義和特點(diǎn)。第三章主要介紹基于ARM的圖像采集系統(tǒng)硬件設(shè)計(jì)方面的內(nèi)容，包括各個(gè)模塊的具體實(shí)現(xiàn)方案、系統(tǒng)硬件性能分析和硬件電路的抗干擾設(shè)計(jì)等。第四章研究了基于uClinux平臺(tái)的幾個(gè)主要模塊的軟件設(shè)計(jì)，主要包括圖像傳感芯片的初始化和采集程序的實(shí)現(xiàn)、LCD控制器的初始化和圖像顯示程序的實(shí)現(xiàn)、以太網(wǎng)控制器的初始化和圖像數(shù)據(jù)傳輸程序的實(shí)現(xiàn)。第五章是對(duì)全文的一個(gè)總結(jié)，概括了作者所做的工作，提出所存在的不足并對(duì)后續(xù)的研究工作做了進(jìn)一步的展望。
標(biāo)簽： ARM 圖像采集系統(tǒng)
上傳時(shí)間： 2013-04-24
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近幾年來，旅游業(yè)在國內(nèi)迅速發(fā)展，已成為規(guī)模最大的產(chǎn)業(yè)之一，在拉動(dòng)內(nèi)需，刺激消費(fèi)，發(fā)展經(jīng)濟(jì)，推動(dòng)城市化進(jìn)程中正發(fā)揮著極其重要的作用。然而旅游服務(wù)和旅游咨詢跟不上社會(huì)的發(fā)展需求，游客在旅途中存在各種不便。把嵌入式技術(shù)和嵌入式GIS技術(shù)結(jié)合的電子導(dǎo)游系統(tǒng)，能給游客提供各種旅途服務(wù)，方便游客出門旅游。 本文依托浙江省科技計(jì)劃重點(diǎn)項(xiàng)目開展研究，在開源軟件基礎(chǔ)上開發(fā)電子導(dǎo)游系統(tǒng)，以有效降低產(chǎn)品價(jià)格，適應(yīng)社會(huì)需要。以廣州斯道S3C2410 ARM開發(fā)板為底層硬件，采用Linux嵌入操作系統(tǒng)為軟件平臺(tái)，利用QT/Embedded GUI為圖形界面，對(duì)MapInfo文件格式進(jìn)行轉(zhuǎn)換，使之適應(yīng)嵌入式系統(tǒng)。通過C/C++編程開發(fā)嵌入式GIS模塊和電子導(dǎo)游應(yīng)用軟件模塊；把硬件、軟件相結(jié)合，使電子地圖顯示在觸摸屏上；最終實(shí)現(xiàn)了景點(diǎn)查詢和介紹、景區(qū)路徑規(guī)劃、距離測(cè)量、GIS操作等功能。 本文的主要研究工作有：第一在ARM S3C2410開發(fā)板上移植Linux內(nèi)核及驅(qū)動(dòng)程序。第二在自由軟件Linux平臺(tái)下研究和開發(fā)嵌入式GIS模塊。第三在QT/Embedded GUI圖形界面下開發(fā)電子導(dǎo)游應(yīng)用軟件。第四研究和設(shè)計(jì)基于模擬退火算法的景區(qū)路徑規(guī)劃算法。 最后，將本文的研究成果在西湖景區(qū)電子導(dǎo)游原型系統(tǒng)中實(shí)現(xiàn)，并取得良好效果。
標(biāo)簽： ARM GIS 嵌入式 電子導(dǎo)游
上傳時(shí)間： 2013-08-02
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語音編碼技術(shù)始終是語音研究的熱點(diǎn)。語音編碼作為多媒體通信中信息傳輸?shù)囊粋€(gè)重要環(huán)節(jié)，越來越受到廣泛的重視。G729是由美國、法國、日本和加拿大的幾家著名國際電信實(shí)體聯(lián)合開發(fā)的，國際電信聯(lián)盟(ITU-T)于1995年11月正式通過了G729。96年ITU-T又制定了G729的簡(jiǎn)化方案G729A，主要降低了計(jì)算的復(fù)雜度以便于實(shí)時(shí)實(shí)現(xiàn)。因其具有良好的合成語音質(zhì)量、適中的復(fù)雜度、較低的時(shí)延等優(yōu)點(diǎn)，G729A標(biāo)準(zhǔn)已被廣泛應(yīng)用在VOIP網(wǎng)關(guān)、IP電話中。 論文利用Altera公司的新一代可編程邏輯器件在數(shù)字信號(hào)處理領(lǐng)域的優(yōu)勢(shì)，對(duì)G729A語音編碼中的線性預(yù)測(cè)(LP)濾波器系數(shù)提取的FPGA(現(xiàn)場(chǎng)可編程門陣列，F(xiàn)ield Programmable Gate Array)實(shí)現(xiàn)進(jìn)行了深入研究。論文首先對(duì)語音信號(hào)處理及其發(fā)展進(jìn)行介紹，深入討論了G729A語音編解碼技術(shù)。第二，對(duì)Altera公司的Stratix系列可編程器件的內(nèi)部結(jié)構(gòu)進(jìn)行了研究，分析了在QuartusII開發(fā)平臺(tái)上進(jìn)行FPGA設(shè)計(jì)的流程。第三，基于FPGA，對(duì)G729A編碼系統(tǒng)的LP分析部分做了具體設(shè)計(jì)，其中包括自相關(guān)函數(shù)和杜賓(Durbin)遞推兩個(gè)主要功能模塊，并對(duì)其工作過程進(jìn)行了詳細(xì)的分析。第四，針對(duì)系統(tǒng)所使用的除法運(yùn)算都是商小于1的特點(diǎn)，設(shè)計(jì)并實(shí)現(xiàn)了一個(gè)系統(tǒng)專用的除法器模塊。最后，在Altera FPGA目標(biāo)芯片EP1S30F780C7上，對(duì)LP分析系統(tǒng)進(jìn)行了驗(yàn)證，證明了方案的可行性。
標(biāo)簽： G729A FPGA 語音編解碼 算法研究
上傳時(shí)間： 2013-04-24
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該課題通過對(duì)開放式數(shù)控技術(shù)的全面調(diào)研和對(duì)運(yùn)動(dòng)控制技術(shù)的深入研究,并針對(duì)國內(nèi)運(yùn)動(dòng)控制技術(shù)的研究起步較晚的現(xiàn)狀,結(jié)合激光雕刻領(lǐng)域的具體需要,緊跟當(dāng)前運(yùn)動(dòng)控制技術(shù)研究的發(fā)展趨勢(shì),吸收了世界開放式數(shù)控技術(shù)和相關(guān)運(yùn)動(dòng)控制技術(shù)的最新成果,采納了基于DSP和FPGA的方案,研制了一款比較新穎的、功能強(qiáng)大的、具有很大柔性的四軸多功能運(yùn)動(dòng)控制卡.該論文主要內(nèi)容如下:首先,通過對(duì)制造業(yè)、開放式數(shù)控系統(tǒng)、運(yùn)動(dòng)控制卡等行業(yè)現(xiàn)狀的全面調(diào)研,基于對(duì)運(yùn)動(dòng)系統(tǒng)控制技術(shù)的深入學(xué)習(xí),在比較了幾種常用的運(yùn)動(dòng)控制方案的基礎(chǔ)上,確定了基于DSP和FPGA的運(yùn)動(dòng)控制設(shè)計(jì)方案,并規(guī)劃了板卡的總體結(jié)構(gòu).其次,針對(duì)運(yùn)動(dòng)控制中的一些具體問題,如高速、高精度、運(yùn)動(dòng)平穩(wěn)性、實(shí)時(shí)控制以及多軸聯(lián)動(dòng)等,在FPGA上設(shè)計(jì)了功能相互獨(dú)立的四軸運(yùn)動(dòng)控制電路,仔細(xì)規(guī)劃并定義了各個(gè)寄存器的具體功能,設(shè)計(jì)了功能完善的加/減速控制電路、變頻分配電路、倍頻分頻電路和三個(gè)功能各異的計(jì)數(shù)器電路等,完全實(shí)現(xiàn)了S-曲線升降速運(yùn)動(dòng)、自動(dòng)降速點(diǎn)運(yùn)動(dòng)、A/B相編碼器倍頻計(jì)數(shù)電路等特殊功能.再次,介紹了DSP在運(yùn)動(dòng)控制中的作用,合理規(guī)劃了DSP指令的形成過程,并對(duì)DSP軟件的具體實(shí)現(xiàn)進(jìn)行了框架性的設(shè)計(jì).然后,根據(jù)光電隔離原理設(shè)計(jì)了數(shù)字輸入/輸出電路;結(jié)合DAC原理設(shè)計(jì)了四路模擬輸出電路;實(shí)現(xiàn)了PCI接口電路的設(shè)計(jì);并針對(duì)常見的干擾現(xiàn)象,提出了有效的抗干擾措施.最后,利用運(yùn)動(dòng)控制卡強(qiáng)大的運(yùn)動(dòng)控制功能,并針對(duì)激光雕刻行業(yè)進(jìn)行大幅圖形掃描時(shí)需要實(shí)時(shí)處理大量的圖形數(shù)據(jù)的特別需要,在板卡第四軸完全實(shí)現(xiàn)了激光控制功能,并基于FPGA內(nèi)部的16KBit塊RAM,開辟了大量數(shù)據(jù)區(qū)以便進(jìn)行大幅圖形的實(shí)時(shí)處理.
標(biāo)簽： FPGA DSP 運(yùn)動(dòng)控制
上傳時(shí)間： 2013-06-09
上傳用戶：youlongjian0
本文完成了一種高速高性能數(shù)字脈沖壓縮處理器的設(shè)計(jì)和FPGA實(shí)現(xiàn)，包括系統(tǒng)架構(gòu)設(shè)計(jì)、方案論證及仿真、算法實(shí)現(xiàn)、結(jié)果的測(cè)試等。 緒論部分首先闡明了本課題研究的背景和意義，概述了雷達(dá)數(shù)字脈沖壓縮系統(tǒng)的主要研究內(nèi)容，關(guān)鍵技術(shù)及其發(fā)展趨勢(shì)，然后介紹了數(shù)字脈沖壓縮系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn)的要求，最后給出了本文的主要研究內(nèi)容。 第二章敘述了線性調(diào)頻信號(hào)脈沖壓縮的基本原理，對(duì)系統(tǒng)設(shè)計(jì)的實(shí)現(xiàn)方法進(jìn)行了實(shí)時(shí)性方面的論證，并基于MATLAB做了仿真分析。 第三章從數(shù)字系統(tǒng)結(jié)構(gòu)化設(shè)計(jì)方面將本系統(tǒng)劃分為三個(gè)部分：輸入部分、脈壓計(jì)算部分、輸出部分，并在流程圖中對(duì)各部分所要實(shí)現(xiàn)的功能做了介紹。 第四章首先總結(jié)了數(shù)字脈沖壓縮的實(shí)現(xiàn)途徑；提出了基于自定制浮點(diǎn)數(shù)據(jù)格式和分時(shí)復(fù)用蝶型結(jié)構(gòu)的數(shù)字脈沖壓縮系統(tǒng)設(shè)計(jì)思想，對(duì)其關(guān)鍵技術(shù)進(jìn)行了深入的研究。 第五章對(duì)輸入輸出模塊的功能做了詳細(xì)的描述，設(shè)計(jì)了具體的結(jié)構(gòu)和電路。 第六章針對(duì)系統(tǒng)的測(cè)試驗(yàn)證，提出面向SOC的模塊驗(yàn)證和系統(tǒng)軟硬協(xié)同驗(yàn)證的驗(yàn)證策略。通過Link for Modelsim工具，實(shí)現(xiàn)MATAB與Modelsim之間對(duì)VHDL代碼的聯(lián)合仿真測(cè)試，通過在線邏輯分析工具ChipScope，完成系統(tǒng)的片上測(cè)試，并分析系統(tǒng)的性能，證明系統(tǒng)的可實(shí)用性。滿足設(shè)計(jì)的要求。 本文研制的數(shù)字脈沖壓縮處理器具有動(dòng)態(tài)范圍大、處理精度高、處理能力強(qiáng)、體積小、重量輕、實(shí)時(shí)性好的優(yōu)點(diǎn)，為設(shè)計(jì)高性能的現(xiàn)代雷達(dá)信號(hào)處理系統(tǒng)提供了可靠的保證。
標(biāo)簽： 線性調(diào)頻信號(hào) 脈沖壓縮
上傳時(shí)間： 2013-07-01
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可靠通信要求消息從信源到信宿盡量無誤傳輸，這就要求通信系統(tǒng)具有很好的糾錯(cuò)能力，如使用差錯(cuò)控制編碼。自仙農(nóng)定理提出以來，先后有許多糾錯(cuò)編碼被相繼提出，例如漢明碼，BCH碼和RS碼等，而C。Berrou等人于1993年提出的Turbo碼以其優(yōu)異的糾錯(cuò)性能成為通信界的一個(gè)里程碑。 然而，Turbo碼迭代譯碼復(fù)雜度大，導(dǎo)致其譯碼延時(shí)大，故而在工程中的應(yīng)用受到一定限制，而并行Turbo譯碼可以很好地解決上述問題。本論文的主要工作是通過硬件實(shí)現(xiàn)一種基于幀分裂和歸零處理的新型并行Turbo編譯碼算法。論文提出了一種基于多端口存儲(chǔ)器的并行子交織器解決方法，很好地解決了并行訪問存儲(chǔ)器沖突的問題。 本論文在現(xiàn)場(chǎng)可編程門陣列(FPGA)平臺(tái)上實(shí)現(xiàn)了一種基于幀分裂和籬笆圖歸零處理的并行Turbo編譯碼器。所實(shí)現(xiàn)的并行Turbo編譯碼器在時(shí)鐘頻率為33MHz，幀長為1024比特，并行子譯碼器數(shù)和最大迭代次數(shù)均為4時(shí)，可支持8.2Mbps的編譯碼數(shù)掘吞吐量，而譯碼時(shí)延小于124us。本文還使用EP2C35FPGA芯片設(shè)計(jì)了系統(tǒng)開發(fā)板。該開發(fā)板可提供高速以太網(wǎng)MAC／PHY和PCI接口，很好地滿足了通信系統(tǒng)需求。系統(tǒng)測(cè)試結(jié)果表明，本文所實(shí)現(xiàn)的并行Turbo編譯碼器及其開發(fā)板運(yùn)行正確、有效且可靠。 本論文主要分為五章，第一章為緒論，介紹Turbo碼背景和硬件實(shí)現(xiàn)相關(guān)技術(shù)。第二章為基于幀分裂和歸零的并行Turbo編碼的設(shè)計(jì)與實(shí)現(xiàn)，分別介紹了編碼器和譯碼器的RTL設(shè)計(jì)，還提出了一種基于多端口存儲(chǔ)器的并行子交織器和解交織器設(shè)計(jì)。第三章討論了使用NIOS處理器的SOC架構(gòu)，使用SOC架構(gòu)處理系統(tǒng)和基于NIOSII處理器和uC／0S一2操作系統(tǒng)的架構(gòu)。第四章介紹了FPGA系統(tǒng)開發(fā)板設(shè)計(jì)與調(diào)試的一些工作。最后一章為本文總結(jié)及其展望。
上傳時(shí)間： 2013-04-24
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