用vhdl設計的一個FIFO存儲器
資源簡介:用vhdl設計的一個FIFO存儲器
上傳時間: 2017-09-09
上傳用戶:stampede
資源簡介:用vhdl 編寫的一個16位的cpu 設計方案,可以執行8條指令。
上傳時間: 2015-07-19
上傳用戶:shawvi
資源簡介:這是一個用vhdl編的一個計數時鐘的設計,程序各個模塊都有,希望和大家多多交流
上傳時間: 2013-12-04
上傳用戶:stewart·
資源簡介:是用vhdl寫的一個常用的ALARM BUFFER,相信對電子設計的朋友有所幫助~
上傳時間: 2014-01-13
上傳用戶:yiwen213
資源簡介:用vhdl編寫的一個LED顯示程序,展示一種全新的LED設計
上傳時間: 2016-12-24
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資源簡介:我的文件是用VC設計的一個求解人工智能中8數碼問題的程序。
上傳時間: 2015-03-29
上傳用戶:sclyutian
資源簡介:在xilinx的ise環境下用vhdl編寫的一個時鐘程序。
上傳時間: 2015-06-06
上傳用戶:asddsd
資源簡介:一個用vhdl編寫的一個cmi解碼編碼程序。可以對數據進行編碼技術。加密。
上傳時間: 2015-07-18
上傳用戶:大三三
資源簡介:這是用vhdl設計的10ns和250ns脈寬的信號
上傳時間: 2015-09-08
上傳用戶:jing911003
資源簡介:用vhdl設計的3-8譯碼器,精簡~!
上傳時間: 2014-01-27
上傳用戶:chens000
資源簡介:用vhdl編寫的一個出租車計費器,起步6元計2公里,此后每半公里計0.8元,停車等待每2.5分計0.8元。通過仿真,但未下載到CPLD測試
上傳時間: 2013-12-24
上傳用戶:caixiaoxu26
資源簡介:自己用vhdl寫的一個串口程序,調試成功,并且用到了項目中,希望初學者可以借鑒下
上傳時間: 2016-01-24
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資源簡介:用vhdl設計的7人的搶答器,優點是代碼簡單,特別適合初學著作為練習和增強代碼編寫能力的練習,好處
上傳時間: 2016-01-26
上傳用戶:ggwz258
資源簡介:用vhdl寫的一個32位并行乘法器的源代碼,已經過驗證,可以直接使用
上傳時間: 2014-01-06
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資源簡介:用vhdl寫的一個小游戲,能夠支持視頻顯示,對初學者有些幫助吧
上傳時間: 2014-11-04
上傳用戶:gxrui1991
資源簡介:用vhdl編寫的一個出租車計費器,起步6元計2公里,此后每半公里計0.8元,停車等待每2.5分計0.8元。通過仿真,但未下載到CPLD測試
上傳時間: 2016-06-18
上傳用戶:asddsd
資源簡介:用C設計的一個編譯器,并帶有編譯器設計文檔,說明了設計的過程,值得借鑒一下。
上傳時間: 2016-06-25
上傳用戶:cjf0304
資源簡介:用Delphi設計的一個超市管理系統,分前臺和后臺
上傳時間: 2013-12-15
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資源簡介:用vhdl實現的一個uart控制器,輸入時鐘為33M
上傳時間: 2014-01-23
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資源簡介:用vhdl寫的一個5/8分頻器,希望對剛學習vhdl的朋友有幫助
上傳時間: 2014-01-12
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資源簡介:用vhdl寫的一個8位全加器的實驗程序,供新手參考
上傳時間: 2017-03-03
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資源簡介:用vhdl 設計的單時鐘同步十進制可逆計數器的設計
上傳時間: 2017-05-13
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資源簡介:用ASP設計的一個網上問卷系統,用于網上調查問卷系統的實現,
上傳時間: 2014-01-17
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資源簡介:這是用vhdl設計的十進制計數器,兩個vhdl程序分別說明了out和buffer的區別
上傳時間: 2014-01-22
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資源簡介:用vhdl編寫的一個直流電機控制器
上傳時間: 2017-09-09
上傳用戶:youke111
資源簡介:利用sram技術設計的一個FIFO
上傳時間: 2013-12-17
上傳用戶:agent
資源簡介:用vhdl編的一個程序,用來控制時鐘信號的頻率
上傳時間: 2013-12-23
上傳用戶:hongmo
資源簡介:用vhdl編寫的一個電梯控制程序,花了很長時間,應該很不錯的
上傳時間: 2014-11-12
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資源簡介:這是一個用vhdl層次化設計的一個九九乘法表源文件,還包含仿真波形
上傳時間: 2013-12-18
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資源簡介:用vhdl設計一個小游戲的例子,適合教學或自學使用
上傳時間: 2015-10-29
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