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本程序(狀態機)使用Verilog HDL語言編寫

  • 資源大小:76 K
  • 上傳時間: 2013-12-26
  • 上傳用戶:cnnotes
  • 資源積分:2 下載積分
  • 標      簽: Verilog HDL 程序 狀態

資 源 簡 介

本程序(狀態機)使用Verilog HDL語言編寫,并通過QuestaSim仿真。

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