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  上傳時間： 2016-05-27

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  上傳時間： 2013-12-17

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  上傳時間： 2013-12-24

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• This document is a simplified version of the Original. This version is not required to be treated as免費下載

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  標簽： version This simplified document

  上傳時間： 2014-12-08

  上傳用戶：zhangyi99104144

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  資源簡介：this is a verilog hdl language referance book , tell you the basic useage of this language.

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  上傳時間： 2016-02-06

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  標簽： Verilog source using this

  上傳時間： 2016-05-19

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  標簽： verilog-hdl simulation synthesize and

  上傳時間： 2016-11-03

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  標簽： Verilog HDL 10149 description

  上傳時間： 2017-02-18

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  標簽： nbsp Verilog HDL 硬件描述語言

  上傳時間： 2013-07-02

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• 基于Verilog HDL設計的多功能數字鐘免費下載

  資源簡介：本文利用Verilog HDL 語言自頂向下的設計方法設計多功能數字鐘，突出了其作為硬件描述語言的良好的可讀性、可移植性和易理解等優點，并通過Altera QuartusⅡ 4.1 和ModelSim SE 6.0 完成綜合、仿真。此程序通過下載到FPGA 芯片后，可應用于實際的數字鐘顯示中...

  標簽： Verilog HDL 多功能 數字

  上傳時間： 2013-11-10

  上傳用戶：hz07104032

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  標簽： nbsp Verilog Digital Design

  上傳時間： 2013-04-24

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  標簽： nbsp Synthesis Practical Verilog

  上傳時間： 2013-04-24

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  上傳時間： 2014-12-03

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  上傳時間： 2013-12-22

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  標簽： Lattice Verilog Primer Bench

  上傳時間： 2015-04-25

  上傳用戶：宋桃子

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  標簽： verilog uart HDL 硬件

  上傳時間： 2015-04-25

  上傳用戶：pompey

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  標簽： implements translator translates gameport

  上傳時間： 2015-04-26

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• UART verilog hdl 實現免費下載

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  標簽： verilog UART hdl

  上傳時間： 2014-01-11

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  上傳時間： 2013-12-12

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  標簽： Verilog FPGA CPLD uart

  上傳時間： 2013-12-28

  上傳用戶：lizhizheng88

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  上傳時間： 2015-07-14

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  上傳時間： 2014-08-10

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  資源簡介：Verilog HDL Synthesis, A Practical Primer 學習Verilog HDL一本很不錯的英文書，比較透徹

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  上傳時間： 2016-01-19

  上傳用戶：hongmo

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  資源簡介：占用資源少的verilog HDL uart接口；采用固定波特率115200，可以修改程序中的分頻來修改波特率，模式為1個啟始位，8位數據位，1個停止位；帶1字節緩存；當緩存空時輸出空信號

  標簽： verilog 115200 uart HDL

  上傳時間： 2013-12-28

  上傳用戶：kikye

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  上傳時間： 2016-02-08

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  上傳時間： 2013-12-18

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  上傳時間： 2014-09-05

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  資源簡介：UART轉I2C的Verilog HDL代碼，由北京郵電大學《VerilogHDL設計與EDA技術基礎》教師編寫

  標簽： Verilog UART I2C HDL

  上傳時間： 2014-08-03

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  標簽： VERILOG uart FPGA HDL

  上傳時間： 2014-01-04

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  標簽： Verilog UART HDL 實驗

  上傳時間： 2014-01-09

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