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VERILOG實現多時鐘,可以應用于流水線.輸入CLK,輸出CLK1,CLK2,CLK3

  • 資源大小:2 K
  • 上傳時間: 2016-01-26
  • 上傳用戶:l2335800
  • 資源積分:2 下載積分
  • 標      簽: CLK VERILOG 多時鐘 應用于

資 源 簡 介

VERILOG實現多時鐘,可以應用于流水線.輸入CLK,輸出CLK1,CLK2,CLK3

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