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通過用硬件描述語言(VHDL)描述除法器

  • 資源大?。?/b>50 K
  • 上傳時間: 2015-04-08
  • 上傳用戶:yangw1027
  • 資源積分:2 下載積分
  • 標      簽: VHDL 硬件描述語言 除法器

資 源 簡 介

通過用硬件描述語言(VHDL)描述除法器,并進行模擬驗證,加深對二進制數運算方法的理解。 設計平臺:MaxPlusII 壓縮文件內有詳細設計報告

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