相 關(guān) 資 源

• verilog編寫的流水線模塊免費下載

  資源簡介：verilog編寫的流水線模塊

  標簽： verilog 編寫 流水線 模塊

  上傳時間： 2015-03-09

  上傳用戶：杜瑩12345

• verilog編寫的alu模塊免費下載

  資源簡介：verilog編寫的alu模塊

  標簽： verilog alu 編寫 模塊

  上傳時間： 2015-03-09

  上傳用戶：qb1993225

• verilog編寫的計算百分比模塊免費下載

  資源簡介：verilog編寫的計算百分比模塊

  標簽： verilog 編寫 分 模塊

  上傳時間： 2013-12-17

  上傳用戶：wang0123456789

• verilog編寫的狀態(tài)機檢測00100序列. 實現(xiàn) input:...011000010010000... output:...000000000100100... 并且 用測試模塊來驗證狀免費下載

  資源簡介：verilog編寫的狀態(tài)機檢測00100序列. 實現(xiàn) input:...011000010010000... output:...000000000100100... 并且 用測試模塊來驗證狀態(tài)是否正確工作

  標簽： 000000000100100 011000010010000 verilog output

  上傳時間： 2015-07-14

  上傳用戶：ggwz258

• verilog 編寫的pic16c5x時鐘模塊免費下載

  資源簡介：verilog 編寫的pic16c5x時鐘模塊

  標簽： verilog pic 16c 16

  上傳時間： 2015-10-25

  上傳用戶：xiaodu1124

• 用verilog編寫的高速8路并行dds模塊免費下載

  資源簡介：用verilog編寫的高速8路并行dds模塊，用于與高速da(1ghz或以上)接口產(chǎn)生任意頻率正弦波，模塊已經(jīng)經(jīng)過工程驗證，用于產(chǎn)品中。

  標簽： verilog dds 8路 編寫

  上傳時間： 2014-01-04

  上傳用戶：ruan2570406

• 用verilog編寫的4位ALU免費下載

  資源簡介：用verilog編寫的4位ALU，由算術(shù)運算模塊、邏輯運算模塊、選擇模塊組成

  標簽： verilog ALU 編寫

  上傳時間： 2014-01-04

  上傳用戶：Amygdala

• 由verilog編寫的乘法器免費下載

  資源簡介：由verilog編寫的乘法器，通過兩個文件的調(diào)用實現(xiàn)。由于子模塊的調(diào)用使得程序簡化了許多。

  標簽： verilog 編寫 乘法器

  上傳時間： 2014-08-29

  上傳用戶：luopoguixiong

• 使用verilog編寫的同步FIFO免費下載

  資源簡介：使用verilog編寫的同步FIFO，可通過設(shè)置程序中的DEPTH設(shè)置FIFO的深度，F(xiàn)IFO_WRITE_CLOCK上升沿向FIFO中寫入數(shù)據(jù)，\r\nFIFO_READ_CLOCK上升沿讀取數(shù)據(jù)。本程序?qū)IFO上層操作簡單實用。

  標簽： verilog FIFO 編寫

  上傳時間： 2013-08-12

  上傳用戶：ljt101007

• verilog 編寫的I2c協(xié)議程序免費下載

  資源簡介：verilog 編寫的I2c協(xié)議程序，用于cpld讀寫EEPROM

  標簽： verilog I2c 編寫 協(xié)議

  上傳時間： 2013-08-31

  上傳用戶：csgcd001

• 用verilog編寫的多功能數(shù)字鐘免費下載

  資源簡介：用verilog編寫的多功能數(shù)字鐘

  標簽： verilog 編寫 多功能 數(shù)字

  上傳時間： 2015-02-25

  上傳用戶：王者A

• 這是一個很好的verilog 編寫的8位RISC CPU源碼（可做為MCU）免費下載

  資源簡介：這是一個很好的verilog 編寫的8位RISC CPU源碼（可做為MCU），并且包括完整的C 語言的測試代碼。

  標簽： verilog RISC CPU MCU

  上傳時間： 2014-01-05

  上傳用戶：李夢晗

• verilog編寫的32位浮點加法器免費下載

  資源簡介：verilog編寫的32位浮點加法器

  標簽： verilog 編寫 浮點 加法器

  上傳時間： 2015-03-09

  上傳用戶：372825274

• verilog編寫的全功能串口免費下載

  資源簡介：verilog編寫的全功能串口

  標簽： verilog 編寫 串口

  上傳時間： 2014-02-11

  上傳用戶：Breathe0125

• 加法器（使用verilog編寫的）,雖然簡單免費下載

  資源簡介：加法器（使用verilog編寫的）,雖然簡單，但是這也是學習verilog最基礎(chǔ)的東西！希望大家一起學習！

  標簽： verilog 加法器 編寫

  上傳時間： 2013-12-10

  上傳用戶：410805624

• 用verilog編寫的網(wǎng)卡芯片rtl級。前仿后仿都通過了免費下載

  資源簡介：用verilog編寫的網(wǎng)卡芯片rtl級。前仿后仿都通過了，可以在modelsim上運行察看

  標簽： verilog rtl 編寫 網(wǎng)卡芯片

  上傳時間： 2015-03-31

  上傳用戶：lxm

• 采用verilog編寫的串口通信程序免費下載

  資源簡介：采用verilog編寫的串口通信程序，采用了狀態(tài)機設(shè)計！程序簡單，消耗資源少

  標簽： verilog 編寫 串口通信 程序

  上傳時間： 2014-12-08

  上傳用戶：yd19890720

• verilog編寫的M序列發(fā)生器免費下載

  資源簡介：verilog編寫的M序列發(fā)生器，希望能對大家?guī)韼椭?/p>

  標簽： verilog M序列 編寫 發(fā)生器

  上傳時間： 2014-01-11

  上傳用戶：zhliu007

• VHDL語言編寫的中斷模塊,是個一般性的設(shè)計,可以很容易修改到你自己的設(shè)計中去.免費下載

  資源簡介：VHDL語言編寫的中斷模塊,是個一般性的設(shè)計,可以很容易修改到你自己的設(shè)計中去.

  標簽： VHDL 語言 編寫 中斷模塊

  上傳時間： 2015-06-03

  上傳用戶：英雄

• 一個非常簡單的cpu設(shè)計的原代碼,是用verilog編寫的免費下載

  資源簡介：一個非常簡單的cpu設(shè)計的原代碼,是用verilog編寫的

  標簽： verilog cpu 代碼 編寫

  上傳時間： 2014-12-08

  上傳用戶：siguazgb

• 用verilog編寫的pci——rtl級。免費下載

  資源簡介：用verilog編寫的pci——rtl級。

  標簽： verilog pci rtl 編寫

  上傳時間： 2015-06-06

  上傳用戶：亞亞娟娟123

• 一個用verilog編寫的模擬交通燈控制的源代碼。模擬在十字路口的雙向交通燈。免費下載

  資源簡介：一個用verilog編寫的模擬交通燈控制的源代碼。模擬在十字路口的雙向交通燈。

  標簽： verilog 編寫 模擬交通燈 控制

  上傳時間： 2014-01-21

  上傳用戶：ljmwh2000

• 一個用verilog編寫的編幀、解幀及碼速匹配的程序免費下載

  資源簡介：一個用verilog編寫的編幀、解幀及碼速匹配的程序，相當經(jīng)典

  標簽： verilog 幀 編寫 程序

  上傳時間： 2015-06-22

  上傳用戶：66666

• 用verilog編寫的程序,用來計算誤碼率的,可以在編碼和解碼過程中用的到的!免費下載

  資源簡介：用verilog編寫的程序,用來計算誤碼率的,可以在編碼和解碼過程中用的到的!

  標簽： verilog 編寫 程序 計算

  上傳時間： 2013-12-25

  上傳用戶：zhyiroy

• verilog編寫的簡單異步串口 完全原創(chuàng)免費下載

  資源簡介：verilog編寫的簡單異步串口 完全原創(chuàng)，站長請查看內(nèi)容

  標簽： verilog 編寫 異步串口

  上傳時間： 2014-01-13

  上傳用戶：LouieWu

• verilog 編寫的I2c協(xié)議程序免費下載

  資源簡介：verilog 編寫的I2c協(xié)議程序，用于cpld讀寫EEPROM

  標簽： verilog I2c 編寫 協(xié)議

  上傳時間： 2015-08-08

  上傳用戶：Thuan

• 用verilog編寫的fir濾波器程序免費下載

  資源簡介：用verilog編寫的fir濾波器程序，開發(fā)環(huán)境可以用ise quartus或active hdl等

  標簽： verilog fir 編寫 濾波器

  上傳時間： 2015-08-21

  上傳用戶：英雄

• 拿verilog編寫的som(自適應(yīng)神經(jīng)網(wǎng)絡(luò)算法)免費下載

  資源簡介：拿verilog編寫的som(自適應(yīng)神經(jīng)網(wǎng)絡(luò)算法)，用于障礙物檢測，基于FPGA可綜合實驗，已經(jīng)在altera的cylcone上實現(xiàn)

  標簽： verilog som 編寫 神經(jīng)網(wǎng)絡(luò)算法

  上傳時間： 2014-01-27

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• 一個關(guān)于MEMORY設(shè)計的原代碼,使用verilog編寫的 希望對大家有些幫助免費下載

  資源簡介：一個關(guān)于MEMORY設(shè)計的原代碼,使用verilog編寫的 希望對大家有些幫助

  標簽： verilog MEMORY 代碼 編寫

  上傳時間： 2013-12-24

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• 用verilog編寫的risc mcu免費下載

  資源簡介：用verilog編寫的risc mcu

  標簽： verilog risc mcu 編寫

  上傳時間： 2015-10-25

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