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Verilog-<b>hDl</b>

Verilog HDL語言的PPT教程。包括簡介、邏輯概念、語法和示例。

Verilog HDL語言的PPT教程。包括簡介、邏輯概念、語法和示例。

標簽： Verilog HDL 語言

上傳時間： 2013-12-08

上傳用戶：liglechongchong
基于MSP430單片機TimerB的數字->模擬信號轉換的設計.利用MSP430定時器B產生PWM,然后再通過RC濾波,得到直流或交流電壓信號.此方法成本低廉,可靠性高,易于使用.

基于MSP430單片機TimerB的數字->模擬信號轉換的設計.利用MSP430定時器B產生PWM,然后再通過RC濾波,得到直流或交流電壓信號.此方法成本低廉,可靠性高,易于使用.

標簽： MSP 430 TimerB PWM

上傳時間： 2013-11-26

上傳用戶：lanjisu111
c語言編寫的B+樹

c語言編寫的B+樹，可實現樹的構造和記錄查找。

標簽： c語言編寫樹

上傳時間： 2016-03-27

上傳用戶：朗朗乾坤
1.c企業發放的獎金根據利潤提成。 2.c 計算器 3.c 班級通信錄 4.c 求x的y方的低三位值 5.c a b 兩數組分別正逆序相加

1.c企業發放的獎金根據利潤提成。 2.c 計算器 3.c 班級通信錄 4.c 求x的y方的低三位值 5.c a b 兩數組分別正逆序相加

標簽： 利潤分計算器數組

上傳時間： 2014-08-24

上傳用戶：天涯
A* sudo sudo/* B* adduser script adduser C* rmuser script rmuser E* tout tout/*

A* sudo sudo/* B* adduser script adduser C* rmuser script rmuser E* tout tout/* F* dumdum dumdum G* lostfile lostfile H* Mkfl.localsys Makefile.localsys I* spacegripe spacegripe J* sendmail.cf sendmail.cf N* remote remote.c O* distributed conrol distrib/* P* hosts and name server makerevhosts Q* xargs xargs/*

標簽： adduser script rmuser sudo

上傳時間： 2016-03-29

上傳用戶：gxrui1991
設計CPU方法及流程！VERILOG hdl

設計CPU方法及流程！VERILOG hdl

標簽： VERILOG CPU hdl 流程

上傳時間： 2016-03-30

上傳用戶：2404
bool運算(~a)&(b)二進制十進制顯示

bool運算(~a)&(b)二進制十進制顯示

標簽： bool 運算二進制十進制

上傳時間： 2016-04-02

上傳用戶：小碼農lz
bool 運算(a)and(b)二進制十進制顯示

bool 運算(a)and(b)二進制十進制顯示

標簽： bool and 運算二進制

上傳時間： 2013-11-28

上傳用戶：waitingfy
bool 運算(a)OR(b)二進制十進制顯示

bool 運算(a)OR(b)二進制十進制顯示

標簽： bool OR 運算二進制

上傳時間： 2014-01-24

上傳用戶：思琦琦
深入C++系列 C++ Primer第三版。 Stanley B Lippman ＆ Josee Lajoie著潘愛民張麗譯

深入C++系列 C++ Primer第三版。 Stanley B Lippman ＆ Josee Lajoie著潘愛民張麗譯

標簽： Lippman Stanley Primer Lajoie

上傳時間： 2014-06-05

上傳用戶：zhouchang199

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