M_UART 介紹了通用異步收發(fā)器（UART）的原理，并以可編程邏輯器件FPGA為核心控制部件，基于超高速硬件描述語言VHDL在Xilinx公司的SpartanⅡ系列的2sc200PQ208-5芯片上編程完成UART的設(shè)計。經(jīng)測試，該設(shè)計完全達到了設(shè)計要求。
標簽： M_UART UART 異步收發(fā)器
上傳時間： 2014-06-06
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4位比較器，通過vhdl語言實現(xiàn)的四位比較器
標簽： 比較器
上傳時間： 2014-01-24
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一個用VHDL編程基于CPLD的EDA實驗板開發(fā)可以實現(xiàn)順計時和倒計時的秒表。要求計時的范圍為00.0S~99.9S，用三位數(shù)碼管顯示。 （1） 倒計時：通過小鍵盤可以實現(xiàn)設(shè)定計時時間（以秒為單位，最大計時時間為99.9秒）。通過鍵盤實現(xiàn)計時開始、計時結(jié)束。當所設(shè)定的倒計時間到達00.0S后，自動停止倒計時，同時響鈴。 （2） 順計時：初始值為00.0S，通過鍵盤實現(xiàn)開始計時和結(jié)束計時功能。計時結(jié)束后，顯示記錄的時間。 （3） 用三個發(fā)光二極管正確顯示以下狀態(tài)：倒計時狀態(tài)、順計時狀態(tài)、待機狀態(tài)。 （4） 每當接收到有效按鍵時，蜂鳴器發(fā)出提示聲。 順計時在一次計時中可以記錄三個不同的結(jié)束時間，并能通過按鍵顯示三次所記錄的時間。
標簽： VHDL CPLD 00.0 99.9
上傳時間： 2013-12-01
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用vhdl編寫的簡易電子中設(shè)計，經(jīng)過測試成功，且用記事本上載，無需閱讀器進行閱讀。
標簽： vhdl 編寫 電子
上傳時間： 2014-09-03
上傳用戶：思琦琦
定時器的編程，vhdl語言，可以實現(xiàn)24時制定時器
標簽： 定時器 編程
上傳時間： 2013-12-19
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用VHDL寫的源代碼程序，包涵三人表決器，七人表決器，全加器以及模24，模60的計數(shù)器，都是單文件的，由于程序小又多，所以集中在一起，供新學習VHDL語言的朋友們參考。
標簽： VHDL 源代碼 程序
上傳時間： 2016-10-28
上傳用戶：SimonQQ
本文介紹一種以CPLD[1]為核心、以VHDL[2]為開發(fā)工具的時間控制器，該控制器不僅具有時間功能，而且具有定時器功能，能在00：00～23：59之間任意設(shè)定開啟時間和關(guān)閉時間，其設(shè)置方便、靈活，廣泛應用于路燈、廣告燈箱、霓虹燈等處的定時控制。
標簽： CPLD VHDL 核心 開發(fā)工具
上傳時間： 2016-11-13
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VHDL常用實例，適合初學者，有計時器等常用例子
標簽： VHDL
上傳時間： 2016-11-18
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用VHDL編寫的PWM控制程序，通過寄存器控制20余路PWM輸出；qar是quartus的壓縮包格式
標簽： VHDL PWM 編寫 控制
上傳時間： 2014-01-23
上傳用戶：PresidentHuang
用VHDL編譯的源代碼，4bit加一器，輸入一個4位二進制數(shù)自動加一，解壓后直接用Quartus打開project即可
標簽： VHDL 編譯 源代碼
上傳時間： 2016-11-27
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