一個(gè)用VHDL編程基于CPLD的EDA實(shí)驗(yàn)板開(kāi)發(fā)可以實(shí)現(xiàn)順計(jì)時(shí)和倒計(jì)時(shí)的秒表。要求計(jì)時(shí)的范圍為00.0S~99.9S，用三位數(shù)碼管顯示。 （1） 倒計(jì)時(shí)：通過(guò)小鍵盤(pán)可以實(shí)現(xiàn)設(shè)定計(jì)時(shí)時(shí)間（以秒為單位，最大計(jì)時(shí)時(shí)間為99.9秒）。通過(guò)鍵盤(pán)實(shí)現(xiàn)計(jì)時(shí)開(kāi)始、計(jì)時(shí)結(jié)束。當(dāng)所設(shè)定的倒計(jì)時(shí)間到達(dá)00.0S后，自動(dòng)停止倒計(jì)時(shí)，同時(shí)響鈴。 （2） 順計(jì)時(shí)：初始值為00.0S，通過(guò)鍵盤(pán)實(shí)現(xiàn)開(kāi)始計(jì)時(shí)和結(jié)束計(jì)時(shí)功能。計(jì)時(shí)結(jié)束后，顯示記錄的時(shí)間。 （3） 用三個(gè)發(fā)光二極管正確顯示以下?tīng)顟B(tài)：倒計(jì)時(shí)狀態(tài)、順計(jì)時(shí)狀態(tài)、待機(jī)狀態(tài)。 （4） 每當(dāng)接收到有效按鍵時(shí)，蜂鳴器發(fā)出提示聲。 順計(jì)時(shí)在一次計(jì)時(shí)中可以記錄三個(gè)不同的結(jié)束時(shí)間，并能通過(guò)按鍵顯示三次所記錄的時(shí)間。
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上傳時(shí)間： 2013-12-01
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資源簡(jiǎn)介：設(shè)計(jì)一個(gè)可以順計(jì)時(shí)和倒計(jì)時(shí)的秒表。要求計(jì)時(shí)的范圍為00.0S~99.9S，用三位數(shù)碼管顯示。 （1） 倒計(jì)時(shí)：通過(guò)小鍵盤(pán)可以實(shí)現(xiàn)設(shè)定計(jì)時(shí)時(shí)間（以秒為單位，最大計(jì)時(shí)時(shí)間為99.9秒）。通過(guò)鍵盤(pán)實(shí)現(xiàn)計(jì)時(shí)開(kāi)始、計(jì)時(shí)結(jié)束。當(dāng)所設(shè)定的倒計(jì)時(shí)間到達(dá)00.0S后，自動(dòng)停止倒計(jì)...
上傳時(shí)間： 2013-12-29
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資源簡(jiǎn)介：建立一個(gè)聊天系統(tǒng),可以實(shí)現(xiàn)即時(shí)聊天和傳輸文件功能,通過(guò)獲取對(duì)方的IP對(duì)方建立連接
上傳時(shí)間： 2016-07-04
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資源簡(jiǎn)介：將提升小波用于目標(biāo)跟蹤。 小波提升的核心就是更新算法和預(yù)測(cè)算法,通過(guò)預(yù)測(cè)算法可以得到高頻信息,而通過(guò)更新算子可以得到正確的低頻信息.提升樣式可以實(shí)現(xiàn)原位計(jì)算和整數(shù)提升,并且變換的中間結(jié)果是交織排列的.其中原位計(jì)算和整數(shù)提升在硬件實(shí)現(xiàn)中很有價(jià)值.
上傳時(shí)間： 2013-12-11
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資源簡(jiǎn)介：用于 UNIX通信的代碼 可以實(shí)現(xiàn)客戶端和服務(wù)端通信。
上傳時(shí)間： 2017-05-24
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資源簡(jiǎn)介：針對(duì)目前MSP430單片機(jī)實(shí)驗(yàn)裝置較少、實(shí)驗(yàn)內(nèi)容少,而且無(wú)MSP430高端產(chǎn)品的實(shí)驗(yàn)裝置,研制了基于MSP430F5529單片機(jī)的綜合實(shí)驗(yàn)裝置,主要包括MSP430 Launch Pad和母板兩部分。較傳統(tǒng)的單片機(jī)實(shí)驗(yàn)裝置增加了模擬電路的設(shè)置,設(shè)計(jì)的實(shí)驗(yàn)?zāi)軌蚶脝纹瑱C(jī)的所有外設(shè),可進(jìn)...
上傳時(shí)間： 2022-04-13
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資源簡(jiǎn)介：一個(gè)用VHDL編寫(xiě)的在CPLD上實(shí)現(xiàn)模擬交通燈的程序源代碼
上傳時(shí)間： 2014-01-24
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資源簡(jiǎn)介：這是一個(gè)用VHDL +圖形法在CPLD內(nèi)部搭建的液晶顯示的驅(qū)動(dòng)程序。液晶是ocmj5*10系列
上傳時(shí)間： 2014-12-07
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資源簡(jiǎn)介：基于FPGA的UART實(shí)現(xiàn) 用VHDL編程
上傳時(shí)間： 2013-12-05
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資源簡(jiǎn)介：一個(gè)用VHDL語(yǔ)言編寫(xiě)的全加器，是數(shù)字電路EDA設(shè)計(jì)的一個(gè)例子，可能不太特別，但是應(yīng)該可以用一下的。
上傳時(shí)間： 2014-10-29
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資源簡(jiǎn)介：一個(gè)用VHDL語(yǔ)言（硬件描述語(yǔ)言）編寫(xiě)的fft實(shí)現(xiàn)程序。fft用途很廣，該程序可以在CPLD或fpga等硬件上實(shí)現(xiàn)，軟件壞境為maxplus10.0及以上或quartus2。
上傳時(shí)間： 2016-04-15
上傳用戶：nairui21
資源簡(jiǎn)介：用VHDL編程語(yǔ)言加上硬件實(shí)現(xiàn)一個(gè)4層電梯模擬，用了數(shù)字邏輯的相關(guān)知識(shí)。
上傳時(shí)間： 2017-03-03
上傳用戶：水中浮云
資源簡(jiǎn)介：用VHDL語(yǔ)言在CPLD/FPGA上實(shí)現(xiàn)浮點(diǎn)運(yùn)算的方法
上傳時(shí)間： 2013-09-05
上傳用戶：life840315
資源簡(jiǎn)介：這是一個(gè)用VHDL編的多功能電子秒表，可以記錄幾個(gè)人的時(shí)間，并且可以在跑秒的時(shí)候查看記錄。。〔原創(chuàng)〕
上傳時(shí)間： 2014-01-09
上傳用戶：kristycreasy
資源簡(jiǎn)介：是一個(gè)用VHDL語(yǔ)言編寫(xiě)的pwm程序，可以方便地用來(lái)和nios連接，實(shí)現(xiàn)對(duì)nios的功能擴(kuò)展。
上傳時(shí)間： 2015-04-04
上傳用戶：xiaohuanhuan
資源簡(jiǎn)介：用VHDL語(yǔ)言在CPLD/FPGA上實(shí)現(xiàn)浮點(diǎn)運(yùn)算的方法
上傳時(shí)間： 2015-04-27
上傳用戶：fandeshun
資源簡(jiǎn)介：用VHDL編程的智能尋跡小車.驅(qū)動(dòng)電機(jī)沿黑線運(yùn)動(dòng),轉(zhuǎn)彎的時(shí)候有燈顯示.可以綜合,實(shí)際硬件調(diào)試通過(guò).是學(xué)習(xí)VHDL的很好實(shí)例
上傳時(shí)間： 2015-06-05
上傳用戶：huangld
資源簡(jiǎn)介：一個(gè)用VHDL語(yǔ)言編成的可以讓蜂鳴器發(fā)聲的的程序。
上傳時(shí)間： 2015-06-06
上傳用戶：it男一枚
資源簡(jiǎn)介：一個(gè)用JSP編程實(shí)現(xiàn)的論壇BBS，非常實(shí)用，有原碼，供大家參考學(xué)習(xí)
上傳時(shí)間： 2013-12-29
上傳用戶：sjyy1001
資源簡(jiǎn)介：數(shù)字均衡器是通訊信道抗碼間干擾的重要環(huán)節(jié),這是一個(gè)用VHDL寫(xiě)的代碼以及用SYNPLIFY8.0綜合的RTL電路圖 它包含三個(gè)模塊FILTER,ERR_DECISION,ADJUST 希望對(duì)大家有用.
上傳時(shí)間： 2015-06-09
上傳用戶：cazjing
資源簡(jiǎn)介：這是一個(gè)用VHDL層次化設(shè)計(jì)的一個(gè)九九乘法表源文件,還包含仿真波形
上傳時(shí)間： 2013-12-18
上傳用戶：ainimao
資源簡(jiǎn)介：一個(gè)用VHDL完成的8位數(shù)顯的16進(jìn)制的頻率計(jì)
上傳時(shí)間： 2015-06-25
上傳用戶：風(fēng)之驕子
資源簡(jiǎn)介：一個(gè)用VHDL寫(xiě)的8051的內(nèi)核,很方便集成到FPGA里.
上傳時(shí)間： 2015-07-01
上傳用戶：waitingfy
資源簡(jiǎn)介：一個(gè)用VHDL編寫(xiě)的一個(gè)cmi解碼編碼程序。可以對(duì)數(shù)據(jù)進(jìn)行編碼技術(shù)。加密。
上傳時(shí)間： 2015-07-18
上傳用戶：大三三
資源簡(jiǎn)介：這是一個(gè)用VHDL語(yǔ)言編寫(xiě)的并口轉(zhuǎn)串口程序，在altera開(kāi)發(fā)系統(tǒng)下驗(yàn)證通過(guò)，運(yùn)用于開(kāi)發(fā)板與計(jì)算機(jī)之間的通信，源程序可以提供參考
上傳時(shí)間： 2014-12-21
上傳用戶：cylnpy
資源簡(jiǎn)介：一個(gè)用Java編程 Applet 實(shí)現(xiàn)的電子白板，嵌入在JSP頁(yè)面中，服務(wù)器端是servlet實(shí)現(xiàn)。
上傳時(shí)間： 2014-01-11
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資源簡(jiǎn)介：這是一個(gè)用VHDL編的一個(gè)計(jì)數(shù)時(shí)鐘的設(shè)計(jì),程序各個(gè)模塊都有,希望和大家多多交流
上傳時(shí)間： 2013-12-04
上傳用戶：stewart·
資源簡(jiǎn)介：《序列檢測(cè)器》絕對(duì)好用的EDA實(shí)驗(yàn)程序,已經(jīng)通過(guò)測(cè)試！VHDL語(yǔ)言編寫(xiě)
上傳時(shí)間： 2014-01-14
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資源簡(jiǎn)介：《分頻器設(shè)計(jì)》絕對(duì)好用的EDA實(shí)驗(yàn)程序！已經(jīng)通過(guò)測(cè)試。VHDL語(yǔ)言編寫(xiě)
上傳時(shí)間： 2013-11-29
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資源簡(jiǎn)介：智能全數(shù)字鎖相環(huán)的設(shè)計(jì)用VHDL語(yǔ)言在CPLD上實(shí)現(xiàn)串行通信
上傳時(shí)間： 2014-01-08
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