數字電路基礎課件
標簽： 數字電路基礎
上傳時間： 2013-11-20
上傳用戶：dgann
數電Verilog相關課件
標簽： Verilog 數電
上傳時間： 2013-10-23
上傳用戶：wangzeng
鎖相環是一種反饋系統，其中電壓控制振蕩器(VCO)和相位比較器相互連接，使得振蕩器可以相對于參考信號維持恒定的相位角度。鎖相環可用來從固定的低頻信號生成穩定的輸出高頻信號等。
標簽： PLL 鎖相環
上傳時間： 2013-11-22
上傳用戶：waixingren
利用鎖相環(PLL)和YTO相結合,設計出一種頻率合成器。實現了3～7 GHz的頻率覆蓋和低于0.2 Hz的頻率分辨率。全頻段相噪均在-108 dBc/Hz@10 kHz以下,具有較高的實用價值。
標簽： 寬帶 高分辨率 頻率合成器
上傳時間： 2013-10-31
上傳用戶：258彼岸
敘述了鎖相環的應用及其結構特點, 較詳細地介紹了鎖相集成電路CD4046的結構特點和應用。
標簽： 4046 CD 鎖相環技術
上傳時間： 2013-10-27
上傳用戶：gxm2052
基于圖形處理器單元（GPU）提出了一種幀間差分與模板匹配相結合的運動目標檢測算法。在CUDA-SIFT（基于統一計算設備架構的尺度不變特征變換）算法提取圖像匹配特征點的基礎上，優化隨機采樣一致性算法（RANSAC）剔除圖像中由于目標運動部分產生的誤匹配點，運用背景補償的方法將靜態背景下的幀間差分目標檢測算法應用于動態情況，實現了動態背景下的運動目標檢測，通過提取目標特征與后續多幀圖像進行特征匹配的方法最終實現自動目標檢測。實驗表明該方法對運動目標較小、有噪聲、有部分遮擋的圖像序列具有良好的目標檢測效果。
標簽： 幀間差分 模板匹配 運動目標檢測
上傳時間： 2013-10-09
上傳用戶：ifree2016
結合直接數字頻率合成（DDS）和鎖相環（PLL）技術完成了X波段低相噪本振跳頻源的設計。文章通過軟件仿真重點分析了本振跳頻源的低相噪設計方法，同時給出了主要的硬件選擇和詳細電路設計過程。最后對樣機的測試結果表明，本方案具有相位噪聲低、頻率控制靈活等優點，滿足了實際工程應用。
標簽： X波段 跳頻源
上傳時間： 2013-11-12
上傳用戶：jiwy
數字電路基礎課件PDF
標簽： 數字集成 電路基礎
上傳時間： 2013-10-08
上傳用戶：csgcd001
基于STM32、STM8處理器，設計完成了萬能試驗機的多個功能模塊。為了提高小信號的采集精度與速度，用多處理器設計了一種混合式的鎖相放大器，并運用數字處理進行進一步處理，具有很高的性價比。在位移信號采集中，運用STM8S實現了低成本的設計。實驗表明，本系統在速度與精度上滿足萬能試驗機要求，總體性價比高。
標簽： 鎖相放大器 試驗機 采集系統
上傳時間： 2013-12-26
上傳用戶：lili123
研究了一種利用corid 算法的矢量及旋轉模式對載波同步中相位偏移進行估計并校正的方法.設計并實現了基于corid 算法的數字鎖相環.通過仿真驗證了設計的有效性和高效性.
標簽： 載波同步 設計方案 鎖相環
上傳時間： 2013-11-21
上傳用戶：吾學吾舞
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