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PLL
鎖相環(
PLL
: Phase-locked loops)是一種利用反饋控制原理實現的頻率及相位的同步技術，其作用是將電路輸出的時鐘與其外部的參考時鐘保持同步。當參考時鐘的頻率或相位發生改變時，鎖相環會檢測到這種變化，并且通過其內部的反饋系統來調節輸出頻率，直到兩者重新同步，這種同步又稱為“鎖相”
PLL
電路
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PLL
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鎖相環
PLL
原理與應用.rar
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PLL
-MB1504-ASM.rar
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基于FPGA和
PLL
的函數信號發生器時鐘部分的實現
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XS128之鎖相環
PLL
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使用時鐘
PLL
的源同步系統時序分析
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Altera可重配置
PLL
使用手冊0414-3
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可重配置
PLL
使用手冊
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Altera可重配置
PLL
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