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PLL

鎖相環(PLL: Phase-locked loops)是一種利用反饋控制原理實現的頻率及相位的同步技術，其作用是將電路輸出的時鐘與其外部的參考時鐘保持同步。當參考時鐘的頻率或相位發生改變時，鎖相環會檢測到這種變化，并且通過其內部的反饋系統來調節輸出頻率，直到兩者重新同步，這種同步又稱為“鎖相”

PLL用Maltab編的

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連續的PLL鎖相

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無線傳送,DDS PLL 在頻率合成中的應用,經典文章.

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基于CD4046構成的PLL及應用 CD4046構成的PLL在通信、頻率處理、自動控制等技術領域中應用較為廣泛

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基于MC145159的PLL頻率合成器設計與實現介紹了鎖相環路頻率合成器的基本原理,分析了集成鎖相環芯片M C 145159的工作特性,給出了集成鎖相環芯片M C 145159的一個應用實例,為高

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AV系統數字調諧PLL頻率合成器的單片機控制文章利用LC7218PLL頻率合成器在AV領域的電調諧功能,提出了一個TV/FM/AM全景接收機設計方案,重點設計分析了LC7218與單片機之間的I/O

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Jitter is extremely important in systems using PLL-based clock drivers. The effects of jitter range

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Cypress Semiconductor makes a variety of PLL-based clock generators. This application note provides

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課程設計做的PLL

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用PIC控制ADF4016 PLL芯片,產生6G射頻信號

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