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DDR RAM控制器的VHDL源碼, 實現平臺是Lattice FPGA

  • 資源大小:662 K
  • 上傳時間: 2014-01-14
  • 上傳用戶:junbo2009
  • 資源積分:2 下載積分
  • 標      簽: Lattice FPGA VHDL DDR

資 源 簡 介

DDR RAM控制器的VHDL源碼, 實現平臺是Lattice FPGA

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