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DDR RAM控制器的VHDL源碼

  • 資源大?。?/b>663 K
  • 上傳時間: 2015-09-18
  • 上傳用戶:lanyunhan
  • 資源積分:2 下載積分
  • 標(biāo)      簽: VHDL DDR RAM 控制器

資 源 簡 介

DDR RAM控制器的VHDL源碼,實現(xiàn)平臺是Lattice FPGA,功能驗證通過

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