基于VHDL語言的32位單精度的浮點加法器
資源簡介:基于VHDL語言的32位單精度的浮點加法器
上傳時間: 2017-09-09
上傳用戶:manking0408
資源簡介:這是基于motorola公司的32位芯片的用于嵌入式linux的bootloader程序源碼。
上傳時間: 2013-12-01
上傳用戶:mhp0114
資源簡介:用VHDL語言在CPLD/FPGA上實現浮點運算的方法
上傳時間: 2013-09-05
上傳用戶:life840315
資源簡介:verilog編寫的32位浮點加法器
上傳時間: 2015-03-09
上傳用戶:372825274
資源簡介:用VHDL語言在CPLD/FPGA上實現浮點運算的方法
上傳時間: 2015-04-27
上傳用戶:fandeshun
資源簡介:一個3階的32位抽取的cic濾波器的verilog源代碼
上傳時間: 2016-02-21
上傳用戶:wmwai1314
資源簡介:32位單精度浮點加法器。進行用加法運算,仿真輸出
上傳時間: 2013-04-24
上傳用戶:x4587
資源簡介:浮點加法器的VHDL算法設計 浮點加法器的VHDL算法設計
上傳時間: 2014-01-13
上傳用戶:z754970244
資源簡介:純C寫的48位軟件模擬浮點運算,可移植 測試版,V0.0000.01 需進一步測試及優化
上傳時間: 2014-01-05
上傳用戶:songyue1991
資源簡介:利用verilog hdl編寫的浮點加法器運算單元,單精度。
上傳時間: 2013-11-29
上傳用戶:王慶才
資源簡介:介紹關于FPGA的浮點加法器運算單元設計
上傳時間: 2014-01-24
上傳用戶:kbnswdifs
資源簡介:浮點運算器的核心運算部件是浮點加法器,它是實現浮點指令各種運算的基礎,其設計優化對于提高浮點運算的速度和精度相當關鍵。文章從浮點加法器算法和電路實現的角度給出設計方法,通過VHDL語言在QuartusII中進行設計和驗證,此加法器通過狀態機控制運算,有...
上傳時間: 2014-01-19
上傳用戶:xauthu
資源簡介:基于fpga和sopc的用VHDL語言編寫的EDA的32位Nios CPU嵌入式系統軟硬件設計
上傳時間: 2016-02-04
上傳用戶:梧桐
資源簡介:基于fpga和sopc的用VHDL語言編寫的EDA的32位Nios CPU嵌入式系統及其DMA設計俄羅斯方塊游戲機
上傳時間: 2013-12-09
上傳用戶:GHF
資源簡介:這是用VHDL語言寫的32位分頻器的程序,可直接運行,看結果,歡迎使用。多指正,交流。
上傳時間: 2015-05-11
上傳用戶:chenlong
資源簡介:利用VHDL語言實現8位到32位的雙向數據轉換
上傳時間: 2014-01-26
上傳用戶:www240697738
資源簡介:4位數值比較器MC14585B.能夠將兩個輸入信號比較的各種情況送到輸出端口上.本程序基于VHDL語言,開發環境是MAXPLUS2
上傳時間: 2016-03-09
上傳用戶:363186
資源簡介:介紹了基于Altera 公司的CPLD 芯片FL EX10 K,以及利用VHDL 語言實現多位二進 制碼轉換成8421BCD 碼的原理、設計思路和軟件實現。
上傳時間: 2016-11-03
上傳用戶:manking0408
資源簡介:基于VHDL語言的設計8位CISC微處理器實例
上傳時間: 2013-12-20
上傳用戶:ryb
資源簡介:一個基于VHDL語言的8位SD卡讀取程序。含有源代碼和說明
上傳時間: 2014-09-06
上傳用戶:xiaodu1124
資源簡介:代碼基于VHDL語言的個文化代碼有用的但是可能有錯誤下在是傾銷心
上傳時間: 2015-07-24
上傳用戶:Avoid98
資源簡介:基于VHDL語言的HDB3碼編譯碼器的設計 HDB3 碼的全稱是三階高密度雙極性碼,它是數字基帶傳輸中的一種重要碼型,具有頻譜中無直流分量、能量集中、提取位同步信息方便等優點。HDB3 碼是在AMI碼(極性交替轉換碼)的基礎上發展起來的,解決了AMI碼在連0碼過多時...
上傳時間: 2015-12-21
上傳用戶:jeffery
資源簡介:基于VHDL語言的并串轉換程序,有四位的并行輸出轉換為串行輸出
上傳時間: 2016-09-19
上傳用戶:dongqiangqiang
資源簡介:原創:基于VHDL語言編寫的電子鐘。采用模塊化編寫,可以調整時間,采用動態掃描顯示時分秒
上傳時間: 2014-01-14
上傳用戶:朗朗乾坤
資源簡介:基于VHDL語言的函數發生器的設計,基于FPGA的波形發生器
上傳時間: 2017-07-17
上傳用戶:xymbian
資源簡介:隨著SOC技術、IP技術以及集成電路技術的發展,RISC軟核處理器的研究與開發設計開始受到了人們的重視。基于FPGA的RISC軟核處理器在各個行業開始得到了廣泛的應用,特別是在一些基于FPGA的嵌入式系統中有著越來越廣泛的應用前景。 該論文在研究了大量國內外技術...
上傳時間: 2013-07-21
上傳用戶:caozhizhi
資源簡介:本文在闡述卷積碼編解碼器基本工作原理的基礎上,提出了在MAX+PlusⅡ開發平臺上基于VHDL語言設計(2,1,6)卷積碼編解碼器的方法。
上傳時間: 2013-06-16
上傳用戶:zfh920401
資源簡介:基于VHDL語言的一個FFT快速傅里葉變換程序。采用4蝶形算法
上傳時間: 2013-08-10
上傳用戶:qlpqlq
資源簡介:基于VHDL語言 智力搶答器的設計 本人的課程設計
上傳時間: 2013-08-27
上傳用戶:CHINA526
資源簡介:用匯編和C寫的32位C語言編譯器,支持C++,也可編譯Windows程序和DLL文件
上傳時間: 2015-01-04
上傳用戶:Breathe0125