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一個基于VerilogHDL語言的16位的booth算法的乘法器及其測試代碼

  • 資源大小:2 K
  • 上傳時間: 2014-01-18
  • 上傳用戶:dan_che
  • 資源積分:2 下載積分
  • 標      簽: VerilogHDL booth 語言 算法

資 源 簡 介

一個基于VerilogHDL語言的16位的booth算法的乘法器及其測試代碼

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