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60秒秒表設計

  • 資源大?。?/b>327 K
  • 上傳時間: 2017-06-08
  • 上傳用戶:zxixi2007
  • 資源積分:2 下載積分
  • 標      簽: 秒表設計

資 源 簡 介

60秒秒表設計,可暫停和分段計數等,所有功能是利用verilog HDL來描述,最后下載到CPLD/FPGA才能運行。

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