基于vhdl的數字鬧鐘的設計。可實現計時、鬧鐘、調節時間功能。可以在FPGA上實現。
資源簡介:基于vhdl的數字鬧鐘的設計。可實現計時、鬧鐘、調節時間功能。可以在FPGA上實現。
上傳時間: 2014-08-07
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資源簡介:這是在FPGA上實現的數字電壓表,用vhdl編寫的,已通過編譯,仿真驗證。
上傳時間: 2015-10-24
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資源簡介:在FPGA上實現的出租車計價器vhdl源代碼\r\n能實現里程計價、誤時計價等功能
上傳時間: 2013-08-13
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資源簡介:數字信號處理在FPGA上實現的經典教材,本書詳細介紹了數字信號處理的算法,以及其在FPGA上用硬件描述語言實現
上傳時間: 2013-09-01
上傳用戶:frank1234
資源簡介:數字信號處理在FPGA上實現的經典教材,本書詳細介紹了數字信號處理的算法,以及其在FPGA上用硬件描述語言實現
上傳時間: 2015-10-22
上傳用戶:stella2015
資源簡介:這是在FPGA上實現的數字鐘功能,用VERILOG語言編程,已功過編譯,仿真驗證
上傳時間: 2013-12-18
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資源簡介::在FPGA 上實現了對高頻窄帶數字信號的下變頻和取樣率轉換,由于完全避免了需要大量邏輯資源的乘法 器和數字振蕩器,其結構大為簡化,再加上采用了流水處理結構,使其處理速度超過100M 樣點每秒,此外它還具有 結構簡單,重配置能力強的優點,具有廣闊的應...
上傳時間: 2014-01-17
上傳用戶:tonyshao
資源簡介:在FPGA上實現的出租車計價器vhdl源代碼 能實現里程計價、誤時計價等功能
上傳時間: 2017-02-04
上傳用戶:helmos
資源簡介:這是一個在FPGA上實現CRC算法的程序,包含了CRC-8,CRC-12,CRC-16,CRC-CCIT,CRC-32一共五種校驗形式。
上傳時間: 2016-09-28
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資源簡介:8051MCU在FPGA上實現的源代碼,用vhdl語言編寫
上傳時間: 2016-10-28
上傳用戶:lht618
資源簡介:這個是實現FTP客戶端的程序,這些程序代碼可以在ECLIPSE上實現.
上傳時間: 2014-08-03
上傳用戶:笨小孩
資源簡介:在FPGA上實現序列機 用的是Altera公司的DE1板子
上傳時間: 2016-05-19
上傳用戶:趙云興
資源簡介:用java的MIDlet,實現建立HTTP連接,可以在模擬器上實現效果,含圖片
上傳時間: 2013-12-15
上傳用戶:q123321
資源簡介:一個簡單的在FPGA上實現循環跑馬燈的程序
上傳時間: 2013-12-17
上傳用戶:15736969615
資源簡介:該程序可以在LCD1602上實現字符的顯示功能,
上傳時間: 2013-12-24
上傳用戶:zhangyigenius
資源簡介:用vhdl語言在FPGA上實現浮點運算,大家共享
上傳時間: 2013-08-19
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資源簡介:在顯示器上顯示漢字,在FPGA上實現,使用Verilog HDL 設計,完全可是直接使用
上傳時間: 2014-09-04
上傳用戶:zm7516678
資源簡介:用vhdl語言在FPGA上實現浮點運算,大家共享
上傳時間: 2013-12-24
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資源簡介:vhdl在FPGA上實現浮點運算,給初學者使用
上傳時間: 2013-12-19
上傳用戶:gtzj
資源簡介:本文通過對當前國際上現有的數字電視標準和數字電視中間件標準進行比較,根據我國市場的實際情況,選擇了歐洲數字電視(DVB)中間件標準DVB-MHP,深入分析了基于MHP的數字電視中間件模型.Java平臺是基于MHP中間件模型的核心,本文通過深入分析Java平臺的構成和Java...
上傳時間: 2013-07-02
上傳用戶:dba1592201
資源簡介:基于FPGA的數字信號處理教程,這是一本工具參考書,集中講解了如何在FPGA上實現數字信號處理,這些算法廣泛應用于無線數字前段、電網和工業控制領域。
上傳時間: 2022-03-18
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資源簡介:基于AT89C2051單片機的數字電容表設計。里面有源代碼、protues仿真圖
上傳時間: 2014-01-16
上傳用戶:cmc_68289287
資源簡介:用vhdl語言設計基于FPGA器件的高采樣率FIR濾波器,基于vhdl與CPLD器件的FIR數字濾波器的設計
上傳時間: 2017-08-05
上傳用戶:hwl453472107
資源簡介:基于PIC16F887單片機的數字鐘課程設計報告。
上傳時間: 2014-01-22
上傳用戶:manga135
資源簡介:基于AT89C2051單片機的數字電容表設計:AT89C2051單片機的P1.0、P1.1的模擬輸入阻抗很低,被測信號進行阻抗變換后,才能送入P1.0(電容積分信號)、P1.1(參考電壓)。通過測量電容的積分信號達到參考電壓的時間,來測量電容的容量大小。
上傳時間: 2013-11-14
上傳用戶:2404
資源簡介:基于ADSP-BF561的數字攝像系統設計Design of Digital Video Camera System Based on Digital Signal ProcessorADSP-BF561(浙江大學 信息與通信工程研究所,浙江 杭州 310027) 馬海杰, 劉云海摘要:介紹了基于ADI雙核的數字信號處理芯片ADSP-BF561 的數字攝...
上傳時間: 2013-11-10
上傳用戶:yl1140vista
資源簡介:關于我的數字鐘的設計,設計一個24小時的數字鬧鐘,該數字鬧鐘的面板如圖9.1所示,它包括以下幾個組成部分:(1)顯示屏,由7個七段數碼管組成,其中6個用于顯示當前時間(時:分:秒)或設置的鬧鐘時間,而另一個則用于顯示系統內部產生的周期性循環變化的待選預置...
上傳時間: 2013-12-10
上傳用戶:wsf950131
資源簡介:基于單片機設計的數字鐘的設計,該數字鐘功能教齊全有整點報,8路鬧鐘設置,年月日顯示,秒表記時功能.
上傳時間: 2016-04-10
上傳用戶:Zxcvbnm
資源簡介:是EDA設計的數字鐘的vhdl語言程序,可用Max+Plus2進行編譯,仿真并下載到芯片中。
上傳時間: 2016-04-30
上傳用戶:manlian
資源簡介:基于FPGA流水線CPU控制器的設計與實現:在FPGA上設計并實現了一種具有MIPS風格的CPU硬布線控制器。
上傳時間: 2013-08-06
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