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  上傳時(shí)間： 2014-06-15

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  上傳時(shí)間： 2016-01-15

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• 用于生成GF(2^m)有限域中常數(shù)乘法器的Verilog HDL源文件的C程序免費(fèi)下載

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  上傳時(shí)間： 2016-01-15

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• 用于生成GF(2^m)有限域元素求逆器的Verilog HDL源文件的C程序免費(fèi)下載

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  上傳時(shí)間： 2014-01-13

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• Verilog HDL 串口發(fā)送程序免費(fèi)下載

  資源簡介：Verilog HDL 串口發(fā)送程序，在ACTEL Fusion FPGA上實(shí)驗(yàn)成功 ，和大家一起分享！^_^

  標(biāo)簽： Verilog HDL 串口發(fā)送 程序

  上傳時(shí)間： 2016-07-17

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• 基于Verilog HDL的VGA驅(qū)動程序設(shè)計(jì)免費(fèi)下載

  資源簡介：基于Verilog HDL的VGA驅(qū)動程序設(shè)計(jì)

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  上傳時(shí)間： 2014-12-03

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• 基于Verilog HDL的流水燈程序設(shè)計(jì)免費(fèi)下載

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  上傳時(shí)間： 2013-12-03

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• 基于Verilog HDL的數(shù)碼管程序設(shè)計(jì)免費(fèi)下載

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  上傳時(shí)間： 2014-01-07

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• Verilog HDL程序 Verilog HDL程序免費(fèi)下載

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  標(biāo)簽： Verilog HDL 程序

  上傳時(shí)間： 2017-01-29

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• vHDL語言 和Verilog HDL語言的測試程序編寫免費(fèi)下載

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  上傳時(shí)間： 2014-01-21

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• 用Verilog HDL 寫的時(shí)鐘程序免費(fèi)下載

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  上傳時(shí)間： 2017-07-11

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• 用Verilog編寫的fir濾波器程序免費(fèi)下載

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  上傳時(shí)間： 2015-08-21

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• Verilog 編寫的I2c協(xié)議程序免費(fèi)下載

  資源簡介：Verilog 編寫的I2c協(xié)議程序，用于cpld讀寫EEPROM

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  上傳時(shí)間： 2013-08-31

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• 一個很好的利用Verilog編程實(shí)現(xiàn)的cpu程序免費(fèi)下載

  資源簡介：一個很好的利用Verilog編程實(shí)現(xiàn)的cpu程序，一定要好好利用。

  標(biāo)簽： Verilog cpu 編程實(shí)現(xiàn) 程序

  上傳時(shí)間： 2015-04-20

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• Verilog 編寫的I2c協(xié)議程序免費(fèi)下載

  資源簡介：Verilog 編寫的I2c協(xié)議程序，用于cpld讀寫EEPROM

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  上傳時(shí)間： 2015-08-08

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• 本文件中包含了多個Verilog實(shí)現(xiàn)的實(shí)用小程序免費(fèi)下載

  資源簡介：本文件中包含了多個Verilog實(shí)現(xiàn)的實(shí)用小程序，幫助初學(xué)者學(xué)習(xí)Verilog語言。

  標(biāo)簽： Verilog 程序

  上傳時(shí)間： 2016-01-07

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• 用Verilog實(shí)現(xiàn)的電子日歷程序,在Quartus II上編譯通過并成功實(shí)現(xiàn)免費(fèi)下載

  資源簡介：用Verilog實(shí)現(xiàn)的電子日歷程序,在Quartus II上編譯通過并成功實(shí)現(xiàn)

  標(biāo)簽： Verilog Quartus 電子日歷 程序

  上傳時(shí)間： 2014-01-08

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• 用Verilog實(shí)現(xiàn)的搶答器程序,在Quartus II上編譯通過并成功運(yùn)行免費(fèi)下載

  資源簡介：用Verilog實(shí)現(xiàn)的搶答器程序,在Quartus II上編譯通過并成功運(yùn)行

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  上傳時(shí)間： 2014-01-14

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• 模數(shù)轉(zhuǎn)換器AD976采樣控制器程序Verilog實(shí)現(xiàn)免費(fèi)下載

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  上傳時(shí)間： 2013-12-17

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• 實(shí)現(xiàn)了USB接口。介紹了如何使用Verilog語言實(shí)現(xiàn)USB的程序設(shè)計(jì)。免費(fèi)下載

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  上傳時(shí)間： 2016-05-01

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• 本程序用HDL語言實(shí)現(xiàn)閏年的判斷,在ISE8.21中調(diào)試通過,比較適合初學(xué)者.免費(fèi)下載

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  上傳時(shí)間： 2016-07-08

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• 代碼為Verilog編寫的流水等程序免費(fèi)下載

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  上傳時(shí)間： 2016-07-11

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• 一個異步的FIFO的Verilog程序,有測試程序免費(fèi)下載

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  上傳時(shí)間： 2016-08-14

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• 用Verilog語言編寫的電子琴程序.用GW48教學(xué)實(shí)驗(yàn)箱仿真的免費(fèi)下載

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• 用Verilog語言編寫的電子鐘程序.是用GW48教學(xué)實(shí)驗(yàn)箱仿真免費(fèi)下載

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  上傳時(shí)間： 2016-09-24

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• 此程序為Verilog控制ADC的全部程序免費(fèi)下載

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  標(biāo)簽： Verilog ADC 程序 控制

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• Verilog寫的分頻程序,可以對輸入的頻率分頻免費(fèi)下載

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  上傳時(shí)間： 2016-11-01

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• Verilog寫的頻率計(jì)程序的計(jì)數(shù)模塊,免費(fèi)下載

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• 用Verilog編寫的fir濾波器程序！免費(fèi)下載

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• 一個用Verilog編寫的總線仲裁程序。多個設(shè)備共享總線免費(fèi)下載

  資源簡介：一個用Verilog編寫的總線仲裁程序。多個設(shè)備共享總線，不同設(shè)備的優(yōu)先級是變化的，保證每個設(shè)備都有公平的使用總線的機(jī)會。

  標(biāo)簽： Verilog 編寫 總線仲裁 總線

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