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這是分別用vhdl和verilog語言編寫的源程序

  • 資源大小:387 K
  • 上傳時(shí)間: 2014-01-23
  • 上傳用戶:ZHANGYQ23
  • 資源積分:2 下載積分
  • 標(biāo)      簽: verilog vhdl 語言

資 源 簡 介

這是分別用vhdl和verilog語言編寫的源程序,里邊還附上了生成的電路器件圖。

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