用VHDL語言實現(xiàn)的除法器,可以處理非整除運算。精度0.004
資源簡介:用VHDL語言實現(xiàn)的除法器,可以處理非整除運算。精度0.004
上傳時間: 2014-01-26
上傳用戶:kr770906
資源簡介:這個是用VHDL語言編寫的除法器,僅僅供大家參考.
上傳時間: 2013-12-15
上傳用戶:金宜
資源簡介:一個用VHDL語言編寫的除法器程序,對從事硬件開發(fā)的同志有幫助的。
上傳時間: 2015-12-09
上傳用戶:gmh1314
資源簡介:用VHDL語言實現(xiàn)的基于FPGA的交換機設計
上傳時間: 2013-04-24
上傳用戶:歸海惜雪
資源簡介:用C語言實現(xiàn)的乘法器
上傳時間: 2013-12-08
上傳用戶:moerwang
資源簡介:用VHDL語言實現(xiàn)的ARM處理器的標準內(nèi)核的源代碼程序,可在重用
上傳時間: 2013-12-11
上傳用戶:稀世之寶039
資源簡介:用VHDL語言實現(xiàn)的控制DS18B20構(gòu)成測溫儀表的程序,包含了全部代碼,可顯示最高精度
上傳時間: 2015-11-04
上傳用戶:agent
資源簡介:一個用VHDL語言編寫的加法器,希望大家能夠得到啟示。
上傳時間: 2014-02-22
上傳用戶:wanghui2438
資源簡介:一個用VHDL語言編寫的乘法器程序,望大家多多支持啊。
上傳時間: 2015-12-09
上傳用戶:hewenzhi
資源簡介:用VHDL語言實現(xiàn)的以09449為橋接芯片的PCI接口,很高興與大家共享。
上傳時間: 2013-12-20
上傳用戶:wpt
資源簡介:用VHDL語言實現(xiàn)的高速數(shù)據(jù)采集中,計算數(shù)據(jù)采集速度的程序
上傳時間: 2016-04-28
上傳用戶:李夢晗
資源簡介:用VHDL語言實現(xiàn)的FFT源代碼,好使的程序,大家試試。QUARTUS II軟件開發(fā)
上傳時間: 2014-11-27
上傳用戶:wangchong
資源簡介:用VHDL語言實現(xiàn)的中值濾波,硬件需要DE2板
上傳時間: 2016-08-26
上傳用戶:youlongjian0
資源簡介:用VHDL語言實現(xiàn)的圖像傳感器TCD132D的時序驅(qū)動代碼,時序精準!
上傳時間: 2014-01-11
上傳用戶:ve3344
資源簡介:這是一個用VHDL語言實現(xiàn)的非常實用的表決器
上傳時間: 2016-11-10
上傳用戶:ardager
資源簡介:用VHDL語言實現(xiàn)的八個開關控制八個LED燈的亮滅,本程序經(jīng)過實驗箱認證,絕對可用。
上傳時間: 2013-11-28
上傳用戶:894898248
資源簡介:用VHDL語言實現(xiàn)的AVR_Core,對于研究SOC很有幫助
上傳時間: 2014-10-30
上傳用戶:ggwz258
資源簡介:用VHDL語言實現(xiàn)的pic16f84,研究SOC嵌入式系統(tǒng)設計很有幫助
上傳時間: 2016-12-23
上傳用戶:皇族傳媒
資源簡介:用VHDL語言實現(xiàn)的乒乓球比賽系統(tǒng).有計分,裁判,發(fā)球等功能。
上傳時間: 2014-08-24
上傳用戶:han_zh
資源簡介:這是一個用VHDL語言實現(xiàn)的移位器,可以實現(xiàn)移位功能
上傳時間: 2014-07-04
上傳用戶:gxrui1991
資源簡介:這是一個用VHDL語言實現(xiàn)的比較完整的ALU,可以用作其他cPU設計的部件
上傳時間: 2013-12-12
上傳用戶:王楚楚
資源簡介:該程序是用VHDL語言實現(xiàn)的時鐘程序,用六個數(shù)碼管分別顯示時分秒,而且可以實現(xiàn)控制功能。
上傳時間: 2013-12-23
上傳用戶:2525775
資源簡介:該程序是用VHDL語言實現(xiàn)的時鐘分頻程序,可以把高頻時鐘信號分成低頻時鐘信號,便于實際應用。
上傳時間: 2017-08-19
上傳用戶:wcl168881111111
資源簡介:該程序是用VHDL語言實現(xiàn)的揚聲器程序,可以通過不同的按鍵控制發(fā)出不同頻率的聲音。
上傳時間: 2014-01-23
上傳用戶:xfbs821
資源簡介:用VHDL實現(xiàn)的除法器
上傳時間: 2013-08-28
上傳用戶:wd450412225
資源簡介:用VHDL實現(xiàn)的除法器,非常好使,仿真通過了
上傳時間: 2015-11-29
上傳用戶:aeiouetla
資源簡介:用VHDL實現(xiàn)的除法器
上傳時間: 2016-01-03
上傳用戶:yyq123456789
資源簡介:利用一塊芯片完成除時鐘源、按鍵、揚聲器和顯示器(數(shù)碼管)之外的所有數(shù)字電路功能。所有數(shù)字邏輯功能都在CPLD器件上用VHDL語言實現(xiàn)。這樣設計具有體積小、設計周期短(設計過程中即可實現(xiàn)時序仿真)、調(diào)試方便、故障率低、修改升級容易等特點。 本設計采用...
上傳時間: 2014-01-02
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資源簡介:Quartus2實現(xiàn)的四位進制并行加法器 用VHDL語言實現(xiàn)
上傳時間: 2016-05-30
上傳用戶:yzhl1988
資源簡介:利用一塊芯片完成除時鐘源、按鍵、揚聲器和顯示器(數(shù)碼管)之外的所有數(shù)字電路功能。所有數(shù)字邏輯功能都在CPLD器件上用VHDL語言實現(xiàn)。這樣設計具有體積小、設計周期短(設計過程中即可實現(xiàn)時序仿真)、調(diào)試方便、故障率低、修改升級容易等特點
上傳時間: 2013-12-26
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