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FIFO的Verilog程序 已在modelsim中編譯通過 并且可以通過DC進(jìn)行綜合

  • 資源大小:60 K
  • 上傳時間: 2015-11-22
  • 上傳用戶:zh64077118
  • 資源積分:2 下載積分
  • 標(biāo)      簽: modelsim Verilog FIFO 程序

資 源 簡 介

FIFO的Verilog程序 已在modelsim中編譯通過 并且可以通過DC進(jìn)行綜合

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