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• 用一片CPLD實現數字鎖相環,用VHDL或V語言.rar免費下載

  資源簡介：用一片CPLD實現數字鎖相環,用VHDL或V語言

  標簽： CPLD VHDL 數字鎖相環

  上傳時間： 2013-05-27

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• 基于FPGA實現的一種新型數字鎖相環免費下載

  資源簡介：基于FPGA實現的一種新型數字鎖相環

  標簽： FPGA 新型數字 鎖相環

  上傳時間： 2013-08-07

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• 基于FPGA的全數字鎖相環設計免費下載

  資源簡介：基于FPGA的全數字鎖相環設計,內有設計過程和設計思想

  標簽： FPGA 全數字 鎖相環

  上傳時間： 2013-08-13

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• 基于FPGA設計數字鎖相環免費下載

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  標簽： FPGA 數字鎖相環

  上傳時間： 2013-08-19

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• 關于數字鎖相環的一點東西免費下載

  資源簡介：關于數字鎖相環的一點東西,可以下來看看\r\n

  標簽： 數字鎖相環

  上傳時間： 2013-08-26

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  資源簡介：PLL是數字鎖相環設計源程序, 其中, Fi是輸入頻率(接收數據), Fo(Q5)是本地輸出頻率. 目的是從輸入數據中提取時鐘信號(Q5), 其頻率與數據速率一致, 時鐘上升沿鎖定在數據的上升和下降沿上；頂層文件是PLL.GDF

  標簽： 數據 Q5 PLL 輸入

  上傳時間： 2014-06-09

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• 用VHDL寫的數字鎖相環程序 pll.vhd為源文件 pllTB.vhd為testbench免費下載

  資源簡介：用VHDL寫的數字鎖相環程序 pll.vhd為源文件 pllTB.vhd為testbench

  標簽： vhd testbench pllTB VHDL

  上傳時間： 2014-01-20

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• PLL是數字鎖相環設計源程序, 其中, Fi是輸入頻率(接收數據), 數字鎖相技術在通信領域應用非常廣泛免費下載

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  標簽： PLL 數字鎖相環 接收 數字

  上傳時間： 2013-12-31

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• 數字鎖相環DPLL實例程序免費下載

  資源簡介：數字鎖相環DPLL實例程序，幫助理解PLL的結構和詳細原理

  標簽： DPLL 數字鎖相環 實例程序

  上傳時間： 2014-08-14

  上傳用戶：saharawalker

• 數字鎖相環DPLL源程序免費下載

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  標簽： DPLL 數字鎖相環 源程序

  上傳時間： 2013-12-20

  上傳用戶：zl5712176

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  資源簡介：用verilog語言編寫的全數字鎖相環的源代碼,基于fpga平臺

  標簽： verilog fpga 語言 編寫

  上傳時間： 2015-06-13

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• 數字鎖相環程序免費下載

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  標簽： 數字鎖相環 程序

  上傳時間： 2015-06-20

  上傳用戶：363186

• 關于數字鎖相環的使用免費下載

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  標簽： 數字鎖相環

  上傳時間： 2013-12-29

  上傳用戶：蟲蟲蟲蟲蟲蟲

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  上傳時間： 2014-01-13

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  上傳時間： 2015-07-18

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  上傳時間： 2013-12-24

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  上傳時間： 2013-12-24

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  資源簡介：技術文章《自采樣比例積分控制全數字鎖相環的性能分析和實現》有一定參考價值

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  上傳時間： 2015-08-21

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• 用一片CPLD實現數字鎖相環,用VHDL或V語言.免費下載

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  標簽： CPLD VHDL 數字鎖相環 語言

  上傳時間： 2013-12-15

  上傳用戶：dsgkjgkjg

• 用一片CPLD實現數字鎖相環,用VHDL或V語言.免費下載

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  上傳時間： 2013-12-24

  上傳用戶：l254587896

• 用一片CPLD實現數字鎖相環,用VHDL或V語言.免費下載

  資源簡介：用一片CPLD實現數字鎖相環,用VHDL或V語言.

  標簽： CPLD VHDL 數字鎖相環 語言

  上傳時間： 2014-01-07

  上傳用戶：金宜

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  上傳時間： 2015-10-04

  上傳用戶：ma1301115706

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  上傳時間： 2013-12-30

  上傳用戶：zhangyi99104144

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  上傳時間： 2014-01-08

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  上傳時間： 2013-12-29

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  標簽： 寬帶 實現方法 數字鎖相環

  上傳時間： 2015-11-25

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  標簽： VHDL 數字鎖相環 源代碼 硬件編程

  上傳時間： 2014-01-02

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  上傳時間： 2013-12-25

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  資源簡介：一篇簡單易懂的關于數字鎖相環概念原理設計的經典文章

  標簽： 數字鎖相環

  上傳時間： 2014-01-04

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