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基于FPGA設計數字鎖相環

  • 資源大小:493 K
  • 上傳時間: 2013-08-19
  • 上傳用戶:marsjian
  • 資源積分:2 下載積分
  • 標      簽: FPGA 數字鎖相環

資 源 簡 介

基于FPGA設計數字鎖相環,提出了一種由微分超前/滯后型檢相器構成數字鎖相環的Verilog-HDL建模方案

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