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v-hdl

一個超前進位加法器（及其testbench) .v文件

一個超前進位加法器（及其testbench) .v文件

標簽： testbench 進位加法器

上傳時間： 2013-12-18

上傳用戶：chenbhdt
一個桶形移位寄存器的.v文件

一個桶形移位寄存器的.v文件，含testbench

標簽： 移位寄存器

上傳時間： 2014-12-04

上傳用戶：lingzhichao
一個簡單狀態機的.v文件

一個簡單狀態機的.v文件，含testbench

標簽： 狀態

上傳時間： 2014-01-19

上傳用戶：netwolf
非常經典的verlog hdl 語言學習教程及開發程序開發事例

非常經典的verlog hdl 語言學習教程及開發程序開發事例

標簽： verlog hdl 語言教程

上傳時間： 2016-07-21

上傳用戶：爺的氣質
C編譯器產生的可顯示機器碼/匯編代碼文件,其中附有源C v: v: @8 g: X& z代碼作為注釋 : z! [3 ) O&...UWOW Grave Composer音樂模塊(MOD)文件 + Q

C編譯器產生的可顯示機器碼/匯編代碼文件,其中附有源C v: v: @8 g: X& z代碼作為注釋 : z! [3 \) O&...UWOW Grave Composer音樂模塊(MOD)文件 + Q* T) \ z) R f$ a: H, iWP WordPerfect文檔 H! t7 D2 |...

標簽： Composer Grave UWOW MOD

上傳時間： 2013-12-14

上傳用戶：love_stanford
基于I2C 的語音采集與播放 Verilog HDL源代碼

基于I2C 的語音采集與播放 Verilog HDL源代碼

標簽： Verilog I2C HDL 語音采集

上傳時間： 2016-07-25

上傳用戶：ggwz258
《Verilog HDL 程序設計教程》及配套源碼

《Verilog HDL 程序設計教程》及配套源碼

標簽： Verilog HDL 程序設計教程

上傳時間： 2016-07-25

上傳用戶：lxm
北大verilog hdl課件！內部資料

北大verilog hdl課件！內部資料，內含大量的工程實例，是學習的好資料

標簽： verilog hdl

上傳時間： 2013-12-29

上傳用戶：s363994250
清華大學verilog hdl源碼例子

清華大學verilog hdl源碼例子，作業，內含源代碼，詳細的文檔說明，非常有用

標簽： verilog hdl 清華大學源碼

上傳時間： 2013-12-27

上傳用戶：cc1
Verilog HDL程序設計教程配套源碼

Verilog HDL程序設計教程配套源碼

標簽： Verilog HDL 程序設計教程

上傳時間： 2013-12-24

上傳用戶：stampede