共軛梯度法v共軛梯度法 共軛梯度法
標(biāo)簽： 梯度
上傳時(shí)間： 2015-08-13
上傳用戶：zmy123
HDL Synthesizer and Optimizer Modeling Style Guide
標(biāo)簽： Synthesizer Optimizer Modeling Guide
上傳時(shí)間： 2013-12-30
上傳用戶：ippler8
用veilog HDL編的七段譯碼顯示電路。自己做的第一個(gè)此類程序，編譯仿真通過，感覺不錯
標(biāo)簽： veilog HDL 譯碼 顯示電路
上傳時(shí)間： 2014-01-25
上傳用戶：gououo
advanced digital design with the verilog hdl
標(biāo)簽： advanced digital verilog design
上傳時(shí)間： 2013-12-15
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nvdajioh knadfioua v jdasku asjdgfosa9iu89y
標(biāo)簽： asjdgfosa9 knadfioua asjdgfosa nvdajioh
上傳時(shí)間： 2015-08-17
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verilog HDL實(shí)現(xiàn)先進(jìn)先出棧，不含測試文件
標(biāo)簽： verilog HDL 棧
上傳時(shí)間： 2015-08-20
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V《牛頓法解方程之混沌情況》源代碼(C完整應(yīng)用程序代碼)
標(biāo)簽： 牛頓 方程 應(yīng)用程序 代碼
上傳時(shí)間： 2015-08-22
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fgnfn f nfgn v v hjhgghgjghjgdjghjdghjm dghj ugdhjh
標(biāo)簽： hjhgghgjghjgdjghjdghjm ugdhjh fgnfn dghj
上傳時(shí)間： 2015-08-28
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不錯的VHDL講義?淮淼腣HDL講義
標(biāo)簽： VHDL HDL 講義
上傳時(shí)間： 2014-11-24
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MD5 加 密的V i s u a l C + + S o u r c e C o d e .
標(biāo)簽： MD5
上傳時(shí)間： 2014-01-04
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