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fpga-jpeg-verilog

用verilog語言編寫的全數(shù)字鎖相環(huán)的源代碼,基于fpga平臺

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鍵盤鼠標的原代碼,用FPGA實現(xiàn),使用Verilog HDL編寫,已經使用FPGA驗正過了,完全可以用

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在顯示器上顯示漢字,在FPGA上實現(xiàn),使用Verilog HDL 設計,完全可是直接使用

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使用FPGA控制蜂鳴器的程序,用Verilog HDL設計,可以是蜂鳴器發(fā)出各種不同的聲音

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FPGA/CPLD應用,uart的Verilog HDL原碼

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checksum fpga verilog

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本原碼是基于Verilog HDL語言的FPGA原程序

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利用FPGA實現(xiàn)浮點運算的verilog代碼希望能夠給需要做這方面研究的同仁有所幫助

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用Verilog實現(xiàn)基于FPGA的通用分頻器

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FPGA上的VERILOG語言編程。通過查找表實現(xiàn)直接數(shù)字頻率合成。在主控部分通過鍵盤選擇正弦波

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