精通verilog HDL語言編程源碼之1--常用加法器設計
標簽： verilog HDL 語言編程 源碼
上傳時間： 2014-12-03
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精通verilog HDL語言編程源碼之2--常用乘法器設計
上傳時間： 2014-11-28
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精通verilog HDL語言編程源碼之3--伽羅華域乘法器設計
上傳時間： 2013-12-18
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精通verilog HDL語言編程源碼之4--常用除法器設計
上傳時間： 2013-12-24
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精通verilog HDL語言編程源碼之5--CIC積分梳狀濾波器設計
標簽： verilog HDL CIC 語言編程
上傳時間： 2016-11-22
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精通verilog HDL語言編程源碼之6--CORDIC數字計算機的設計
標簽： verilog CORDIC HDL 語言編程
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精通verilog HDL語言編程源碼之7——偽隨機序列應用設計
上傳用戶：sz_hjbf
精通verilog HDL語言編程源碼之8——異步FIFO設計
標簽： verilog FIFO HDL 語言編程
上傳時間： 2013-12-16
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精通verilog HDL語言編程源碼9——RS(204,188)譯碼器的設計
標簽： verilog HDL 204 188
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Verilog HDL源碼，顯示器段數碼管數字累加，測試通過
標簽： Verilog HDL 源碼
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