一些接口電路的Verilog設計，主要包括IIC、PS2、矩陣鍵盤、RS232、還有一些基礎試驗的源代碼如：除法器、多路選擇器、加法器、減法器、8位優先編碼器等。
標簽： Verilog 接口電路
上傳時間： 2013-12-21
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幫助系統工程師，設計者，管理者在電視廣播上可以順利的傳輸類比訊號至數位訊號之基礎技術
標簽： 系統 工程
上傳時間： 2014-01-07
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用堆棧實現迷宮求解問題 基本思想: 若當前位置可以通過,則壓入棧中,否則探求下一位置,若走不通,則回朔,迷宮大小:M*N.迷宮設置自定義。 求解迷宮問題的簡單方法是：從入口出發，沿某一方向進行探索，若能走通，則繼續向前走；否則沿原路返回，換一方向再進行探索，直到所有可能的通路都探索到為止。 為避免走回到已經進入的點（包括已在當前路徑上的點和曾經在當前路徑上的點），凡是進入過的點都應做上記號。
標簽： 迷宮 堆棧 棧 自定義
上傳時間： 2017-06-17
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FPGA的集成開發環境ISE中課仿真的Verilog代碼集錦，基本是整個數字電路中的所有代碼
標簽： Verilog FPGA ISE 集成開發環境
上傳時間： 2017-07-02
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移位運算器SHIFTER 使用Verilog HDL 語言編寫，其輸入輸出端分別與鍵盤/顯示器LED 連接。移位運算器是時序電路，在J鐘信號到來時狀態產生變化， CLK 為其時鐘脈沖。由S0、S1 、M 控制移位運算的功能狀態，具有數據裝入、數據保持、循環右移、帶進位循環右移，循環左移、帶進位循環左移等功能。 CLK 是時鐘脈沖輸入，通過鍵5 產生高低電平M 控制工作模式， M=l 時帶進位循環移位，由鍵8 控制CO 為允許帶進位移位輸入，由鍵7 控制:S 控制移位模式0-3 ，由鍵6 控制，顯示在數碼管LED8 上 D[7..0]是移位數據輸入，由鍵2 和1 控制，顯示在數碼管2 和1 上 QB[7..0]是移位數據輸出，顯示在數碼管6 和5 上:cn 是移位數據輸出進位，顯示在數碼管7 上。
標簽： SHIFTER Verilog HDL 移位
上傳時間： 2014-01-16
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十字路口交通燈控制:分為主路和輔路，由verilog實現
標簽： 十字路口 交通燈控制 分
上傳時間： 2017-07-14
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VHDL與Verilog語言的簡明教程，介紹了用這兩種語言進行硬件設計的基本方法與思路。
標簽： Verilog VHDL 語言 簡明教程
上傳時間： 2017-08-15
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verilog基礎知識與快速提高練習,包括verilog的語法知識，以及一些基本操作
標簽： verilog 基礎知識
上傳時間： 2017-08-18
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電子鐘，實現自動計時。proteus開發
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上傳時間： 2014-01-24
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介紹Verilog HDL, 內容包括： – Verilog應用 – Verilog語言的構成元素 – 結構級描述及仿真 – 行為級描述及仿真 – 延時的特點及說明 – 介紹Verilog testbench • 激勵和控制和描述 • 結果的產生及驗證 – 任務task及函數function – 用戶定義的基本單元(primitive) – 可綜合的Verilog描述風格
標簽： Verilog HDL 仿真 語言
上傳時間： 2013-12-19
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