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一個(gè)關(guān)于4路CAN卡的硬件程序,用VHDL編寫(xiě)

一個(gè)關(guān)于4CAN卡的硬件程序,用VHDL編寫(xiě).就是4路CAN總線

標(biāo)簽： VHDL CAN 硬件 程序

上傳時(shí)間： 2013-08-20

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基于CPLD XC95018開(kāi)發(fā)的一段VHDL代碼

基于CPLD XC95018開(kāi)發(fā)的一段VHDL代碼，可實(shí)現(xiàn)多個(gè)8051單片機(jī)互相通訊，對(duì)多單片機(jī)系統(tǒng)的設(shè)計(jì)很有參考價(jià)值

標(biāo)簽： 95018 CPLD VHDL XC

上傳時(shí)間： 2013-08-20

上傳用戶：qijian11056

一個(gè)使用VHDL語(yǔ)言設(shè)計(jì)的電梯控制程序

這是一個(gè)使用VHDL語(yǔ)言設(shè)計(jì)的電梯控制程序，里面還有仿真時(shí)序圖。

標(biāo)簽： VHDL 語(yǔ)言 電梯控制 程序

上傳時(shí)間： 2013-08-20

上傳用戶：希醬大魔王

CPLD介紹，硬件結(jié)構(gòu)及VHDL語(yǔ)言應(yīng)用

對(duì)CPLD學(xué)習(xí)者有幫助，既講解了硬件的結(jié)構(gòu)，又講述了VHDL語(yǔ)言的應(yīng)用

標(biāo)簽： CPLD VHDL 硬件結(jié)構(gòu) 語(yǔ)言

上傳時(shí)間： 2013-08-20

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基于cpld的pwm控制設(shè)計(jì)采用vhdl.verilog語(yǔ)言設(shè)計(jì)

基于cpld的pwm控制設(shè)計(jì)\r\n采用vhdl.verilog語(yǔ)言設(shè)計(jì)\r\n對(duì)大家比較有用

標(biāo)簽： verilog cpld vhdl pwm

上傳時(shí)間： 2013-08-20

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用VHDL語(yǔ)言寫(xiě)的程序?qū)嵗?/a>

標(biāo)簽： VHDL 語(yǔ)言 上傳時(shí)間： 2013-08-20

國(guó)外最新出版的高級(jí)VHDL設(shè)計(jì)指南

國(guó)外最新出版的高級(jí)VHDL設(shè)計(jì)指南，內(nèi)容新，對(duì)從事VHDL設(shè)計(jì)的人員很有幫助，：）。

標(biāo)簽： VHDL 設(shè)計(jì)指南

上傳時(shí)間： 2013-08-21

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用FPGA實(shí)現(xiàn)RS232通信,此代碼是用VHDL語(yǔ)言編寫(xiě)

用FPGA實(shí)現(xiàn)RS232通信,此代碼是用VHDL語(yǔ)言編寫(xiě)，非常有用的好東東啊

標(biāo)簽： FPGA VHDL 232 RS

上傳時(shí)間： 2013-08-21

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VHDL語(yǔ)言編寫(xiě)的DAC0832代碼

VHDL語(yǔ)言編寫(xiě)的DAC0832代碼，簡(jiǎn)短而又易懂，可供參考

標(biāo)簽： VHDL 0832 DAC 語(yǔ)言

上傳時(shí)間： 2013-08-21

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用fpga實(shí)現(xiàn)dsp 的fft算法 其中有幾個(gè)文檔文件和用vhdl寫(xiě)的1024點(diǎn)的fft代碼

用fpga實(shí)現(xiàn)dsp 的fft算法 其中有幾個(gè)文檔文件和用vhdl寫(xiě)的1024點(diǎn)的fft代碼

標(biāo)簽： fft fpga 1024 vhdl

上傳時(shí)間： 2013-08-22

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