一個(gè)nc的源碼，也是嗅探器,請看源碼吧，煩，我最討厭寫文字了
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上傳時(shí)間： 2013-12-25
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ac97 VHDL core
標(biāo)簽： VHDL core ac 97
上傳時(shí)間： 2013-12-15
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USB 1.1 IP-CORE和設(shè)計(jì)范例 VHDL源代碼
標(biāo)簽： IP-CORE VHDL USB 1.1
上傳時(shí)間： 2013-12-19
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vhdl 語言入門
標(biāo)簽： vhdl 語言
上傳時(shí)間： 2013-12-17
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vhdl基于半加器的全加器描述及仿真
標(biāo)簽： vhdl 半加器 全加器 仿真
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基于vhdl的PWM發(fā)生器
標(biāo)簽： vhdl PWM 發(fā)生器
上傳時(shí)間： 2013-12-21
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VHDL的四選一選擇器
標(biāo)簽： VHDL 選擇器
上傳時(shí)間： 2014-01-03
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vhdl的3-8譯碼器
標(biāo)簽： vhdl 譯碼器
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全加器的VHDL程序?qū)崿F(xiàn)及仿真
標(biāo)簽： VHDL 全加器 仿真 程序
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vhdl寄存/計(jì)數(shù)器設(shè)計(jì)
標(biāo)簽： vhdl 寄存 計(jì)數(shù)器
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