vhdl
標(biāo)簽： vhdl
上傳時(shí)間： 2015-01-08
上傳用戶：zaizaibang
Xilinx Sdram控制器VHDL源代碼
標(biāo)簽： Xilinx Sdram VHDL 控制器
上傳時(shí)間： 2014-01-14
上傳用戶：gdgzhym
lattice sdram 控制器VHDL源代碼
標(biāo)簽： lattice sdram VHDL 控制器
上傳時(shí)間： 2015-01-09
上傳用戶：ruan2570406
用VHDL編寫DDR SDRAM Controller的源代碼
標(biāo)簽： Controller SDRAM VHDL DDR
上傳時(shí)間： 2013-12-19
上傳用戶：hn891122
本程序使用vhdl編寫的jtag接口實(shí)現(xiàn)程序,其中有些功能未能實(shí)現(xiàn),希望有人能夠幫忙完善!
標(biāo)簽： vhdl jtag 程序 接口
上傳時(shí)間： 2013-12-25
上傳用戶：kelimu
VHDL學(xué)習(xí)手冊(cè)
標(biāo)簽： VHDL 學(xué)習(xí)手冊(cè)
上傳時(shí)間： 2015-01-13
上傳用戶：hoperingcong
幾個(gè)VHDL的源代碼和和一個(gè)本人編寫的5級(jí)流水線RISC CPU的代碼
標(biāo)簽： VHDL RISC CPU 源代碼
上傳時(shí)間： 2013-12-02
上傳用戶：jyycc
可綜合的vhdl設(shè)計(jì)特點(diǎn).pdf
上傳時(shí)間： 2015-01-21
1024點(diǎn)FFT快速傅立葉變換,(vhdl代碼)
標(biāo)簽： 1024 vhdl FFT 傅立葉變換
上傳用戶：huql11633
8255參考設(shè)計(jì)VHDL源代碼
標(biāo)簽： 8255 VHDL 參考設(shè)計(jì) 源代碼
上傳時(shí)間： 2013-12-20
上傳用戶：李夢(mèng)晗
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