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IP內(nèi)核

  • 基于FPGA的UARTIP核設計與實現 pdf

    基于FPGA的UARTIP核設計與實現.pdf

    標簽: UARTIP FPGA

    上傳時間: 2013-08-22

    上傳用戶:kaje

  • 使用CPLD仿真8088核,內有源程序和說明

    使用CPLD仿真8088核,內有源程序和說明,可以參考

    標簽: CPLD 8088 仿真 有源

    上傳時間: 2013-08-22

    上傳用戶:eclipse

  • 基于MAXII CPLD的對1602字符型液晶進行讀寫操作

    基于MAXII CPLD的對1602字符型液晶進行讀寫操作,其中使用了一個CFI的IP核

    標簽: MAXII CPLD 1602 字符型液晶

    上傳時間: 2013-08-23

    上傳用戶:yeling1919

  • Run Pac-man Game Based on 8086/8088 FPGA IP Core

    Run Pac-man Game Based on 8086/8088 FPGA IP Core

    標簽: Pac-man Based Game 8086

    上傳時間: 2013-08-23

    上傳用戶:JamesB

  • xilinx ise 7.1下 實現sparten3 basys板上基于8086FPGA軟核的吃豆子游戲

    xilinx ise 7.1下 實現sparten3 basys板上基于8086FPGA軟核的吃豆子游戲

    標簽: sparten3 xilinx basys 8086

    上傳時間: 2013-08-23

    上傳用戶:417313137

  • 基于FPGA的DDS基本信號發生器的設計

      本設計基于DDS原理和FPGA技術按照順序存儲方式,將對正弦波、方波、三角波、鋸齒波四種波形的取樣數據依次全部存儲在ROM波形表里,通過外接設備撥扭開關和鍵盤控制所需波形信號的輸出,最終將波形信息顯示在LCD液晶顯示屏上。各硬件模塊之間的協調工作通過嵌入式軟核處理器NiosⅡ用編程實現控制。本設計所搭建的LCD12864控制器是通過編程實現的IP核。

    標簽: FPGA DDS 信號發生器

    上傳時間: 2013-11-09

    上傳用戶:xfbs821

  • NI MultiSIM 10(V10.0.144)電子仿真軟件漢化文件

    NI MultiSIM 10(V10.0.144)電子仿真軟件漢化文件

    標簽: MultiSIM 10 144 NI

    上傳時間: 2013-10-19

    上傳用戶:saharawalker

  • 單端10-bit SAR ADC IP核的設計

    本設計通過采用分割電容陣列對DAC進行優化,在減小了D/A轉換開關消耗的能量、提高速度的基礎上,實現了一款采樣速度為1 MS/s的10-bit單端逐次逼近型模數轉換器。使用cadence spectre 工具進行仿真,仿真結果表明,設計的D/A轉換器和比較器等電路滿足10-bit A/D 轉換的要求,逐次逼近A/D轉換器可以正常工作。

    標簽: bit SAR ADC 10

    上傳時間: 2013-11-21

    上傳用戶:chukeey

  • 充分利用IP以及拓撲規劃提高PCB設計效率

    本文探討的重點是PCB設計人員利用IP,并進一步采用拓撲規劃和布線工具來支持IP,快速完成整個PCB設計。從圖1可以看出,設計工程師的職責是通過布局少量必要元件、并在這些元件之間規劃關鍵互連路徑來獲取IP。一旦獲取到了IP,就可將這些IP信息提供給PCB設計人員,由他們完成剩余的設計。 圖1:設計工程師獲取IP,PCB設計人員進一步采用拓撲規劃和布線工具支持IP,快速完成整個PCB設計?,F在無需再通過設計工程師和PCB設計人員之間的交互和反復過程來獲取正確的設計意圖,設計工程師已經獲取這些信息,并且結果相當精確,這對PCB設計人員來說幫助很大。在很多設計中,設計工程師和PCB設計人員要進行交互式布局和布線,這會消耗雙方許多寶貴的時間。從以往的經歷來看交互操作是必要的,但很耗時間,且效率低下。設計工程師提供的最初規劃可能只是一個手工繪圖,沒有適當比例的元件、總線寬度或引腳輸出提示。隨著PCB設計人員參與到設計中來,雖然采用拓撲規劃技術的工程師可以獲取某些元件的布局和互連,不過,這個設計可能還需要布局其它元件、獲取其它IO及總線結構和所有互連才能完成。PCB設計人員需要采用拓撲規劃,并與經過布局的和尚未布局的元件進行交互,這樣做可以形成最佳的布局和交互規劃,從而提高PCB設計效率。隨著關鍵區域和高密區域布局完成及拓撲規劃被獲取,布局可能先于最終拓撲規劃完成。因此,一些拓撲路徑可能必須與現有布局一起工作。雖然它們的優先級較低,但仍需要進行連接。因而一部分規劃圍繞布局后的元件產生了。此外,這一級規劃可能需要更多細節來為其它信號提供必要的優先級。

    標簽: PCB 利用IP 拓撲規劃

    上傳時間: 2013-10-12

    上傳用戶:sjyy1001

  • EDA實用教程概述

    eda的發展趨勢: 在一個芯片上完成的系統級的集成已成為可能可編程邏輯器件開始進入傳統的ASIC市場EDA工具和IP核應用更為廣泛高性能的EDA工具得到長足的發展計算機硬件平臺性能大幅度提高,為復雜的SoC設計提供了物理基礎。

    標簽: EDA 實用教程

    上傳時間: 2013-11-05

    上傳用戶:Togetherheronce

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