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CPLD
采用CMOSEPROM、EEPROM、快閃存儲(chǔ)器和SRAM等編程技術(shù)，從而構(gòu)成了高密度、高速度和低功耗的可編程邏輯器件。cPCI總線
JTAG
CPLD
實(shí)現(xiàn)源代碼
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CPLD
與單片機(jī)接口設(shè)計(jì)
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CPLD
數(shù)字電路設(shè)計(jì)硬件描述語言一例
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一段控制1394芯片的
CPLD
的verilog程序
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詳細(xì)介紹了
CPLD
技術(shù)的基礎(chǔ)知識(shí)及其應(yīng)用開發(fā)原理
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CPLD
programming guide
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實(shí)現(xiàn)基于
CPLD
的CCD采集系統(tǒng)設(shè)計(jì)源碼
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51單片機(jī)系統(tǒng)擴(kuò)展超大容量存儲(chǔ)器接口設(shè)計(jì)的
CPLD
源碼。
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JTAG仿真器
CPLD
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用VHDL語言在
CPLD
/FPGA上實(shí)現(xiàn)浮點(diǎn)運(yùn)算的方法
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