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CPLD
CPLD
采用CMOSEPROM、EEPROM、快閃存儲器和SRAM等編程技術(shù)，從而構(gòu)成了高密度、高速度和低功耗的可編程邏輯器件。cPCI總線
dsp與
CPLD
的連接原理圖
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一種用
CPLD
設(shè)計GPS數(shù)字通道相關(guān)器中C／A碼產(chǎn)生囂的方法
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基于計算機(jī)總線方式利用
CPLD
進(jìn)行加密
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FPGA和
CPLD
設(shè)計時的經(jīng)驗(yàn)
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關(guān)于用
CPLD
和FPGA做插補(bǔ)算法的內(nèi)容,對于想用FPGA做控制的朋友是個好的借鑒!
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基于
CPLD
的多功能信號發(fā)生器設(shè)計
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用
CPLD
開發(fā)的激光控制器的源碼
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dsp下載器
CPLD
程序
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ju繼續(xù)上載
CPLD
的黃金參考源代碼
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里面介紹了＂
CPLD
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