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CPLD

CPLD采用CMOSEPROM、EEPROM、快閃存儲器和SRAM等編程技術，從而構成了高密度、高速度和低功耗的可編程邏輯器件。cPCI總線

CPLD下載電纜的詳細圖紙及說明

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數字設計——CPLD應用與VHDL源文件

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lattice CPLD優化技巧資料

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基于CPLD的FSK信號發生器的設計

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基于CPLD的二進制碼轉換為二十進制（BCD）碼的電路

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單片機和CPLD綜合應用的示例

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CPLD,非常好用的源碼

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CPLD與51單片機總線接

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CPLD的VerilogHDL總線代碼,在EPM7128SLC84-10+Quartus4平臺上運行通過.

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基于CPLD-FPGA的半整數分頻器的設計

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