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Altera-<b>fpga-cpld</b>

  • 基于Altera FPGA CPLD的電子系統設計及工程實踐

    講解到位,工程例子很全,適合下載學習。

    標簽: Altera FPGA CPLD 電子系統設計

    上傳時間: 2013-10-21

    上傳用戶:lhll918

  • FPGA/CPLD與USB技術的無損圖像采集卡

    介紹了外置式USB無損圖像采集卡的設計和實現方案,它用于特殊場合的圖像處理及其相關領域。針對圖像傳輸的特點,結合FPCA/CPLD和USB技術,給出了硬件實現框圖,同時給出了PPGA/CPLD內部時序控制圖和USB程序流程圖,結合框圖和部分程序源代碼,具體講述了課題中遇到的難點和相應的解決方案。

    標簽: FPGA CPLD USB 圖像采集卡

    上傳時間: 2013-10-29

    上傳用戶:qw12

  • 基于 FPGA 的 SDTV-HDTV 轉換的研究與設計

    一種采用Altera Cyclone Ⅲ FPGA將標準清晰度電視(SDTV)轉換成高清晰度電視(HDTV)的方法.用圖像插值技術,充分利用了原始圖像,實現視頻格式水平方向上行內像素點的增加及垂直方向上行數的提升,滿足高清晰度電視格式的標準輸出.整個上變換模塊的復雜度低,易于硬件實現,完成了專用格式轉換芯片的功能,在工程應用中有利于提高系統的集成度和靈活性.

    標簽: SDTV-HDTV FPGA 轉換

    上傳時間: 2013-11-19

    上傳用戶:jokey075

  • 2級流水線實現的8位全加器的VHDL代碼

    2級流水線實現的8位全加器的VHDL代碼,適用于altera系列的FPGA/CPLD

    標簽: VHDL 流水線 8位 全加器

    上傳時間: 2014-06-15

    上傳用戶:zhanditian

  • ARM,DSP,FPGA的區別:詳細介紹了ARM

    ARM,DSP,FPGA的區別:詳細介紹了ARM,DSP,FPGA/CPLD的異同。

    標簽: ARM FPGA DSP 詳細介紹

    上傳時間: 2014-01-26

    上傳用戶:aig85

  • fpga cpldXILINXCPLD-JTAG fpga cpldXILINXCPLD-JTAG

    \fpga cpld\XILINXCPLD-JTAG \fpga cpld\XILINXCPLD-JTAG

    標簽: cpldXILINXCPLD-JTAG fpga

    上傳時間: 2013-12-24

    上傳用戶:netwolf

  • 本文介紹了一個使用 VHDL 描述計數器的設計、綜合、仿真的全過程

    本文介紹了一個使用 VHDL 描述計數器的設計、綜合、仿真的全過程,作為我這一段 時間自學 FPGA/CPLD 的總結,如果有什么不正確的地方,敬請各位不幸看到這篇文章的 大俠們指正,在此表示感謝。當然,這是一個非常簡單的時序邏輯電路實例,主要是詳細 描述了一些軟件的使用方法。文章中涉及的軟件有Synplicity 公司出品的Synplify Pro 7.7.1; Altera 公司出品的 Quartus II 4.2;Mentor Graphics 公司出品的 ModelSim SE 6.0。

    標簽: VHDL 計數器 仿真 過程

    上傳時間: 2016-10-04

    上傳用戶:Yukiseop

  • Verilog HDl語言實現CPLD-EPC240與電腦的串口通訊QUARTUS邏輯工程源碼

    Verilog HDl語言實現CPLD-EPC240與電腦的串口通訊QUARTUS邏輯工程源碼 //本模塊的功能是驗證實現和PC機進行基本的串口通信的功能。需要在//PC機上安裝一個串口調試工具來驗證程序的功能。//程序實現了一個收發一幀10個bit(即無奇偶校驗位)的串口控//制器,10個bit是1位起始位,8個數據位,1個結束//位。串口的波特律由程序中定義的div_par參數決定,更改該參數可以實//現相應的波特率。程序當前設定的div_par 的值是0x145,對應的波特率是//9600。用一個8倍波特率的時鐘將發送或接受每一位bit的周期時間//劃分為8個時隙以使通信同步.//程序的工作過程是:串口處于全雙工工作狀態,按動key1,FPGA/CPLD向PC發送“21 EDA"//字符串(串口調試工具設成按ASCII碼接受方式);PC可隨時向FPGA/CPLD發送0-F的十六進制

    標簽: verilog hdl cpld 串口通訊 quartus

    上傳時間: 2022-02-18

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  • FPGA籃球計分計時器_QuartusII_verilog

    功能:計分員通過按鍵為兩支隊伍計分,每支隊伍個對應一個按鍵,積分按鍵每按下一次對應隊伍積分增加1(兩分和三分需要按下兩次和三次),數碼管顯示本節剩余時間和24s倒計時,分別對應一個按鍵來重置本節剩余時間和24s倒計時。使用說明:k1 k2分別是增加兩隊的分數 K3:重置單節時間 k4:重置24秒違例時間,reset是復位驗證:經過睿智Altera助學FPGA開發板驗證注意:本程序用到了LCD1602模塊,所以需要在睿智開發板外接LCD1602模塊,該開發板是自帶LCD1602模塊接口的,可以把LCD1602直接插上開發板。該工程有程序講解視頻,視頻太大無法上傳,可聯系作者郵箱索要:865021481@qq.com

    標簽: fpga 籃球計分計時器

    上傳時間: 2022-07-06

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  • VIP專區-嵌入式/單片機編程源碼精選合集系列(51)

    VIP專區-嵌入式/單片機編程源碼精選合集系列(51)資源包含以下內容:1. 上傳一個帶源代碼的嵌入式實時多任務操作系統CMX.2. 數字鐘可以說明的具體功能都在文件家中,請仔細參閱,希望大家可以相互學習,共同進步.3. i2c主模塊的底層驅動,使用方便簡單,可以用任何才c開發工具開發.4. Altare公司訓練新人的練習題下載 FPGA/CPLD.5. 該系統是一個溫度測控系統,傳感器采用tlc549,內付有proteus的仿真圖形,可以模擬外圍電路,程序采用c,開發環境是keil c..6. 該程序是iic程序的測試程序.7. 該程序是了解51,想深入了解嵌入式系統的很好的實例!本程序對us/os ii實現了成功的移植.8. 智能電動小車.9. 本人寫的51開發板的串口通信程序.10. cypress的an2131開發板原理圖.11. 嵌入式軟件模擬測試平臺的設計與實現技術.12. 基于ARM和μCOS_II的電液比例控制系統的設計.13. VxWorks操作系統在S3C4510B上的移植.14. 基于Linux的嵌入式LCD設計.15. s3c44b0下外部中斷測試程序。帶有按鍵及串口顯示。.16. ATMEL公司的AT91M55800芯片的開發板原理圖.17. 用PIC16F877實現的基于Hoarder board的C源程序.18. 基于RM9200主芯片.19. 這是非常好的vhdl例子.20. 嵌式系統設計與實例開發實驗教材1(清華大學出版社).魏洪興、周亦敏編著 基于S3C44B0的鍵盤掃描以及LED顯示實驗代碼.21. wince下drve驅動測試程序大家學習使用.22. 用在COM和嵌入系統開發的示例性程序源碼有詳細的開發說明..23. 新聞發布系統.24. 這是基于altera的片上處理器nios 的一個IP電話終端的設計,來源altera的電子設計文章大賽..25. 一個使用Mscomm控件編寫的串口通信軟件.26. nRF24L01 software driver running on AT89C5131A micrcontroller..27. 關于電力自動化遠動產品謠信、遙控的電路原理圖.28. 電力自動化通訊通道中電話MODEM的原理圖.29. 用c語言編寫MP3 源程序.30. uc/os2.83最新源代碼.31. 基于I2C的RTC(實時時鐘)的小程序,用c編寫的,實現的是年歷功能.32. xml解析器(在niosII環境下用C語言開發的).33. 基于CPLD的FSK信號發生器的設計.PDF.34. 基于CPLD的多功能信號發生器設計.PDF.35. CPU是S3C44B0X,是學習時可用來參考,很好的原理圖.36. vte 是linux下的一款控制終端程序.37. 通過一個實例.38. wisgo7007的開發方案的原理圖文件.39. 一款ccd攝像頭的原理圖設計.40. 這是單機測試串口發送和接收數據的程序,很簡單啊!完成基本的串口工作.

    標簽: 液壓系統 消除方法

    上傳時間: 2013-06-02

    上傳用戶:eeworm

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