數(shù)字式π/4-DQPSK是一種線性窄帶調(diào)制技術(shù)，具有頻譜利用率高、頻譜特性好、抗衰落性能強(qiáng)、可用非相干解調(diào)等突出特點(diǎn)。在移動(dòng)通信、衛(wèi)星通信中得到廣泛應(yīng)用。 本文介紹了π/4-DQPSK調(diào)制解調(diào)的基本原理和各個(gè)模塊的設(shè)計(jì)實(shí)現(xiàn)；完成了調(diào)制解調(diào)算法的Matlab仿真設(shè)計(jì)；采用VHDL硬件描述語(yǔ)言在Xilinx公司的ISE5.2開(kāi)發(fā)環(huán)境下設(shè)計(jì)實(shí)現(xiàn)各個(gè)模塊，通過(guò)了時(shí)序仿真，實(shí)現(xiàn)了正確解調(diào)；分析了在實(shí)現(xiàn)過(guò)程中，采用1bit差分檢測(cè)了誤碼率。文章由推出的誤碼率表達(dá)式得到靜態(tài)高斯噪聲下，信噪比為16dB時(shí)誤碼率可達(dá)10-8。用Protel99SE進(jìn)行PCB板設(shè)計(jì)，完成程序下載進(jìn)FPGA芯片以及電路調(diào)試，其輸入符號(hào)速率200kbps，調(diào)制中頻455kHz。測(cè)試結(jié)果驗(yàn)證了程序的正確，實(shí)現(xiàn)了π/4-DQPSK調(diào)制解調(diào)系統(tǒng)完成預(yù)定的目標(biāo)。
標(biāo)簽： DQPSK FPGA 數(shù)字式 調(diào)制解調(diào)
上傳時(shí)間： 2013-04-24
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頻率合成技術(shù)廣泛應(yīng)用于通信、航空航天、儀器儀表等領(lǐng)域。目前，常用的頻率合成技術(shù)有直接式頻率合成，鎖相頻率合成和直接數(shù)字頻率合成(DDS)。本次設(shè)計(jì)是利用FPGA完成一個(gè)DDS系統(tǒng)并利用該系統(tǒng)實(shí)現(xiàn)模擬信號(hào)的數(shù)字化調(diào)頻。 DDS是把一系列數(shù)字量形式的信號(hào)通過(guò)D/A轉(zhuǎn)換形成模擬量形式的信號(hào)的合成技術(shù)。主要是利用高速存儲(chǔ)器作查尋表，然后通過(guò)高速D/A轉(zhuǎn)換器產(chǎn)生已經(jīng)用數(shù)字形式存入的正弦波(或其他任意波形)。一個(gè)典型的DDS系統(tǒng)應(yīng)包括：相位累加器，可在時(shí)鐘的控制下完成相位的累加；相位碼—幅度碼轉(zhuǎn)換電路，一般由ROM實(shí)現(xiàn)；DA轉(zhuǎn)換電路，將數(shù)字形式的幅度碼轉(zhuǎn)換成模擬信號(hào)。DDS系統(tǒng)可以很方便地獲得頻率分辨率很精細(xì)且相位連續(xù)的信號(hào)，也可以通過(guò)改變相位字改變信號(hào)的相位，因此也廣泛用于數(shù)字調(diào)頻和調(diào)相。本次數(shù)字化調(diào)頻的基本思想是利用AD轉(zhuǎn)換電路將模擬信號(hào)轉(zhuǎn)換成數(shù)字信號(hào)，同時(shí)用該數(shù)字信號(hào)與一個(gè)固定的頻率字累加，形成一個(gè)受模擬信號(hào)幅度控制的頻率字，從而獲得一個(gè)頻率受模擬信號(hào)的幅度控制的正弦波，即實(shí)現(xiàn)了調(diào)頻。該DDS數(shù)字化調(diào)頻方案的硬件系統(tǒng)是以FPGA為核心實(shí)現(xiàn)的。使用Altera公司的ACEX1K系列FPGA，整個(gè)系統(tǒng)由VHDL語(yǔ)言編程，開(kāi)發(fā)軟件為MAX+PLUSⅡ。經(jīng)過(guò)實(shí)際測(cè)試，該系統(tǒng)在頻率較低時(shí)與理論值完全符合，但在高頻時(shí)，受器件速度的限制，波形有較大的失真。
標(biāo)簽： FPGA DDS 數(shù)字化 調(diào)頻
上傳時(shí)間： 2013-06-14
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隨著計(jì)算機(jī)、通信、電子技術(shù)的進(jìn)步，嵌入式系統(tǒng)和以太網(wǎng)技術(shù)的融合將成為嵌入式技術(shù)未來(lái)的重要發(fā)展方向。基于ARM的嵌入式系統(tǒng)由于具有低功耗、高性能、低成本、可以進(jìn)行多任務(wù)操作等優(yōu)點(diǎn)，在控制領(lǐng)域得到了越來(lái)越廣泛的應(yīng)用。 本選題來(lái)自中山大學(xué)與北京航天五院合作研制的流體網(wǎng)絡(luò)系統(tǒng)地面原理樣機(jī)控制器設(shè)計(jì)項(xiàng)目。論文研究的主要目的是利用基于ARM920T內(nèi)核的嵌入式微處理器AT91RM9200融合多傳感器設(shè)計(jì)一種可以在地面實(shí)驗(yàn)室環(huán)境中可靠運(yùn)行的數(shù)據(jù)采集與溫度控制系統(tǒng)。 本文從嵌入式測(cè)控系統(tǒng)的硬件實(shí)現(xiàn)和軟件設(shè)計(jì)兩方面進(jìn)行分析。在硬件設(shè)計(jì)上，主控制板以Atmel公司生產(chǎn)的AT91RM9200 CPU為核心，主要包括串口模塊、存儲(chǔ)模塊、以太網(wǎng)接口模塊、基于SPI串行接口設(shè)計(jì)的數(shù)據(jù)采集模塊（A/D）、基于I2C接口設(shè)計(jì)的PID控制信號(hào)輸出模塊（D/A）和采用PIO接口設(shè)計(jì)的開(kāi)關(guān)控制輸出模塊等電路，其中后三個(gè)模塊承擔(dān)了流體網(wǎng)絡(luò)回路的傳感器數(shù)據(jù)采集，關(guān)鍵點(diǎn)的溫度控制和多路電磁閥的開(kāi)關(guān)控制等任務(wù)，后文將重點(diǎn)介紹。在軟件設(shè)計(jì)方面，主要分兩個(gè)方面進(jìn)行討論，分別為主控制器上基于嵌入式Linux系統(tǒng)的軟件和上位機(jī)采用Visual C++編寫(xiě)的監(jiān)控軟件。主控制器軟件采用多線程進(jìn)行設(shè)計(jì)，包括主線程、服務(wù)器子線程和數(shù)據(jù)采集子線程，三個(gè)線程同時(shí)運(yùn)行，提高了系統(tǒng)的運(yùn)行效率。上位機(jī)和主控制器通過(guò)接入以太網(wǎng)中，然后由服務(wù)器線程和上位機(jī)客戶端利用socket套接字實(shí)現(xiàn)通信。同時(shí)上位機(jī)軟件也提供形象美觀的圖形用戶界面，配合主控制器實(shí)現(xiàn)特定的溫度、流量和壓力監(jiān)控。 本論文設(shè)計(jì)的嵌入式測(cè)控系統(tǒng)充分利用了AT91RM9200內(nèi)嵌的的強(qiáng)大功能模塊，包括SPI接口模塊和I2C接口模塊等，可廣泛應(yīng)用于控制領(lǐng)域。對(duì)該系統(tǒng)的一些研究成果和設(shè)計(jì)方法具有一定的先進(jìn)性和良好的實(shí)用性，具有良好的應(yīng)用前景。
標(biāo)簽： ARM 流體 網(wǎng)絡(luò)測(cè)控
上傳時(shí)間： 2013-06-30
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21世紀(jì)是“信息世紀(jì)”，隨著人們生活水平的不斷進(jìn)步，對(duì)于家居環(huán)境要求也日益增高。如何將信息產(chǎn)業(yè)的最新成果，應(yīng)用于構(gòu)建一個(gè)舒適和諧的家居環(huán)境，已日益引起人們的關(guān)注和重視。傳統(tǒng)的家庭電子電器類產(chǎn)品具有單個(gè)控制的特點(diǎn)，無(wú)法進(jìn)一步構(gòu)成網(wǎng)絡(luò)，和外界進(jìn)行信息交互。“智能家居”概念的提出，改變了這種這種狀況。智能家居系統(tǒng)可以將相對(duì)獨(dú)立的電器產(chǎn)品“智能”地連接在一起，提供全方位信息交換功能，幫助家庭內(nèi)部及外部實(shí)現(xiàn)信息暢通，從而優(yōu)化生活環(huán)境，提高生活質(zhì)量。 本文提出了一種基于GPRS網(wǎng)絡(luò)的以ARM和嵌入式Linux操作系統(tǒng)為基礎(chǔ)的家庭網(wǎng)關(guān)無(wú)線接入方案，能通過(guò)手機(jī)短信息對(duì)控制節(jié)點(diǎn)進(jìn)行遠(yuǎn)程控制，實(shí)時(shí)獲得當(dāng)前圖像信息和家居環(huán)境的各項(xiàng)物理參數(shù)。 本文所做的主要工作為： 1．調(diào)研了國(guó)內(nèi)外智能化家居系統(tǒng)的研究現(xiàn)狀和發(fā)展趨勢(shì)，并結(jié)合目前國(guó)內(nèi)智能家居的發(fā)展特點(diǎn)，設(shè)計(jì)了基于嵌入式系統(tǒng)的智能家居監(jiān)控系統(tǒng)。在設(shè)計(jì)中選用了ARM9 S3C2440處理器和嵌入式Linux操作系統(tǒng)，主要由基于ARM的主控模塊、GPRS短信發(fā)送模塊、基于nRF2401的無(wú)線（分）節(jié)點(diǎn)通信模塊幾個(gè)部分組成。 2．建立了嵌入式系統(tǒng)的平臺(tái)和開(kāi)發(fā)環(huán)境。主要包括嵌入式Linux的裁減、設(shè)備驅(qū)動(dòng)程序的編寫(xiě)，交叉編譯和串口驅(qū)動(dòng)的編寫(xiě)，完成了USB驅(qū)動(dòng)的移植。 3．在組網(wǎng)方式上選擇了nRF2401無(wú)線射頻模塊和GPRS模塊，完成了周邊器件的電路設(shè)計(jì)，實(shí)現(xiàn)了無(wú)線模塊的相互通信和信息傳輸。 4．實(shí)現(xiàn)了XMODOM協(xié)議，將圖片和物理信息傳送至GPRS模塊，并實(shí)現(xiàn)了彩信的MMS發(fā)送。 本文完成了智能家居監(jiān)控系統(tǒng)的硬件設(shè)計(jì)和軟件設(shè)計(jì)，并進(jìn)行了調(diào)試，驗(yàn)證了所設(shè)計(jì)系統(tǒng)的有效性和實(shí)用性。實(shí)驗(yàn)結(jié)果表明提出的監(jiān)控系統(tǒng)設(shè)計(jì)方法是可行的，且整個(gè)系統(tǒng)具有良好的通用性和可擴(kuò)展性。由于采用Linux作為嵌入式操作系統(tǒng)，符合嵌入式的發(fā)展潮流，方便了在該設(shè)計(jì)的基礎(chǔ)上進(jìn)行二次開(kāi)發(fā)和擴(kuò)展。
標(biāo)簽： GPRS ARM 智能家居 監(jiān)控系統(tǒng)
上傳時(shí)間： 2013-04-24
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隨著對(duì)高處理能力、網(wǎng)絡(luò)通信、實(shí)時(shí)多任務(wù),超低功耗這些需求的增長(zhǎng),傳統(tǒng)8位處理器已經(jīng)不能滿足新產(chǎn)品的要求了,高端嵌入式處理器已經(jīng)得到了普遍的重視和應(yīng)用.ARM是目前嵌入式領(lǐng)域應(yīng)用最廣泛的RISC微處理器結(jié)構(gòu),該文研究了基于ARM處理器的嵌入式系統(tǒng)的開(kāi)發(fā),介紹了利用一款A(yù)RM微處理器和FPGA設(shè)計(jì)的四路E1中繼板卡的硬件結(jié)構(gòu)和工作原理,并在這個(gè)硬件平臺(tái)上進(jìn)行軟件開(kāi)發(fā)的過(guò)程.該四路E1收發(fā)器能夠提供四條E1鏈路,把帶寬從2Mbps提高到8Mbps,能夠同時(shí)負(fù)載120個(gè)用戶的通信,解決了數(shù)字環(huán)路系統(tǒng)中卡槽數(shù)目限制的問(wèn)題.目前,建立在G. 703基礎(chǔ)上的El接口在分組網(wǎng)、幀中繼網(wǎng)、GSM移動(dòng)基站及軍事通信中得到廣泛的應(yīng)用,傳送語(yǔ)音信號(hào)、數(shù)據(jù)、圖像等業(yè)務(wù).文中首先分析了當(dāng)前數(shù)字環(huán)路系統(tǒng)的發(fā)展現(xiàn)狀和趨勢(shì),隨著網(wǎng)絡(luò)通信的用戶數(shù)目及信息量的猛增,拓寬數(shù)據(jù)傳輸?shù)耐ǖ朗且豁?xiàng)研究熱點(diǎn),這是開(kāi)發(fā)四路E1收發(fā)器的一個(gè)目的.接著敘述了數(shù)字環(huán)路系統(tǒng)的結(jié)構(gòu)和工作原理,即四路E1收發(fā)器的應(yīng)用環(huán)境,著重介紹了四路E1板卡在整個(gè)系統(tǒng)中所扮演的角色和嵌入式處理器ARM的體系結(jié)構(gòu)和特點(diǎn),鑒于數(shù)據(jù)傳輸中對(duì)時(shí)鐘的要求比較嚴(yán)格,該文還介紹了FPGA技術(shù),應(yīng)用它主要是為系統(tǒng)提供各個(gè)精確的時(shí)鐘.然后,在分析了四路E1收發(fā)器的工作原理和比較了各類處理器特點(diǎn)的基礎(chǔ)上,提出了四路E1收發(fā)器的硬件設(shè)計(jì),分別介紹了時(shí)鐘模塊、系統(tǒng)接口電路、存儲(chǔ)系統(tǒng)模塊、四通道E1合成器模塊、CPU模塊以及時(shí)隙交換模塊.接著,在研究分析了G.703和G.704等通信協(xié)議后,再根據(jù)系統(tǒng)要求提出了四路E1收發(fā)器的軟件設(shè)計(jì).先介紹了實(shí)時(shí)操作系統(tǒng)RTXC,詳細(xì)闡述了ARM處理器啟動(dòng)代碼程序的設(shè)計(jì),然后給出了在此操作系統(tǒng)下軟件設(shè)計(jì)的整體結(jié)構(gòu),分四個(gè)任務(wù)分別闡述此軟件功能,其中詳細(xì)介紹了信令處理模塊、接口中斷處理模塊、系統(tǒng)運(yùn)行監(jiān)測(cè)模塊和RC消息LC消息處理模塊.最后介紹了軟件和硬件的調(diào)試方法以及設(shè)計(jì)過(guò)程中的調(diào)試開(kāi)發(fā)過(guò)程,整個(gè)系統(tǒng)設(shè)計(jì)完成后,經(jīng)過(guò)反復(fù)調(diào)試、測(cè)驗(yàn)已達(dá)到了預(yù)期的效果,現(xiàn)正投入使用中.
標(biāo)簽： FPGA ARM 處理器 中的應(yīng)用
上傳時(shí)間： 2013-04-24
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擴(kuò)頻通信具有較強(qiáng)的抗干擾、抗偵查和抗衰落能力,可以實(shí)現(xiàn)碼分多址,目前廣泛應(yīng)用于通信抗干擾、衛(wèi)星通信、導(dǎo)航、保密通信、測(cè)距和定位等各個(gè)方面。另外,隨著集成電路技術(shù)的飛速發(fā)展,數(shù)字接收機(jī)和軟件無(wú)線電也已經(jīng)是現(xiàn)代通信研究的一個(gè)熱點(diǎn)。 本文正是順應(yīng)這種發(fā)展趨勢(shì),在某工程項(xiàng)目的通信分系統(tǒng)中建立CDMA直接序列擴(kuò)頻通信系統(tǒng)。 本文作者承擔(dān)了多點(diǎn)無(wú)線擴(kuò)頻通信系統(tǒng)的研究,建立了一個(gè)完整的仿真系統(tǒng)。提出了適合于本系統(tǒng)的實(shí)現(xiàn)算法,同時(shí)還建立了基于軟件無(wú)線電平臺(tái)的系統(tǒng)的全FPGA設(shè)計(jì)和實(shí)現(xiàn),包括各個(gè)模塊的測(cè)試和整個(gè)系統(tǒng)的聯(lián)合測(cè)試。 文章的主要內(nèi)容如下： 1.簡(jiǎn)述了擴(kuò)頻通信及軟件無(wú)線電的發(fā)展及現(xiàn)狀。 2. 對(duì)直擴(kuò)系統(tǒng)的基本原理和系統(tǒng)中采用的相關(guān)關(guān)鍵技術(shù)進(jìn)行了闡述。相關(guān)關(guān)鍵技術(shù)包括擴(kuò)頻碼的研究和選取,擴(kuò)頻碼同步的研究,包括捕獲算法和跟蹤算法的研究,以及自適應(yīng)門(mén)限的研究。 3.詳細(xì)討論了該多點(diǎn)無(wú)線通信系統(tǒng)的設(shè)計(jì)與實(shí)現(xiàn),提出了適合于本系統(tǒng)的算法。首先闡述了系統(tǒng)的總體設(shè)計(jì)方案和設(shè)計(jì)參數(shù),接著分為物理層和鏈路層詳細(xì)闡述了各個(gè)模塊的設(shè)計(jì)與仿真,包括matlab仿真和modelsim仿真,文中給出了大量的仿真結(jié)果圖。仿真結(jié)果證明算法的正確性,仿真性能也能滿足系統(tǒng)設(shè)計(jì)的要求。 4.介紹了該多點(diǎn)無(wú)線通信系統(tǒng)的硬件平臺(tái)與系統(tǒng)調(diào)試。首先介紹了系統(tǒng)的硬件平臺(tái)和硬件框圖,介紹了系統(tǒng)的相關(guān)器件及其配置,接著介紹了FPGA的開(kāi)發(fā)流程、開(kāi)發(fā)工具、設(shè)計(jì)原則及遇到的相關(guān)問(wèn)題,最后介紹了系統(tǒng)的設(shè)計(jì)驗(yàn)證與性能分析,給出了系統(tǒng)的調(diào)試方案和調(diào)試結(jié)果。 本文所討論的多點(diǎn)無(wú)線通信系統(tǒng)已經(jīng)在某工程項(xiàng)目的通信分系統(tǒng)中實(shí)現(xiàn)。目前工作正常,性能良好,具有通用性、可移植性,有重要的理論及實(shí)用價(jià)值。
標(biāo)簽： 多點(diǎn) 無(wú)線擴(kuò)頻 通信系統(tǒng)
上傳時(shí)間： 2013-04-24
上傳用戶：wzr0701
頻率合成技術(shù)廣泛應(yīng)用于通信、航空航天、儀器儀表等領(lǐng)域。目前，常用的頻率合成技術(shù)有直接式頻率合成、鎖相頻率合成和直接數(shù)字頻率合成(DDS)。DDS系統(tǒng)可以很方便地獲得頻率分辨率很精細(xì)且相位連續(xù)的信號(hào)，也可以通過(guò)改變相位字改變信號(hào)的相位，因此也廣泛用于數(shù)字通信領(lǐng)域。 本論文是利用FPGA完成一個(gè)DDS系統(tǒng)。DDS是把一系列數(shù)字量形式的信號(hào)通過(guò)D/A轉(zhuǎn)換形成模擬量形式的信號(hào)的合成技術(shù)。主要是利用高速存儲(chǔ)器作查尋表，然后通過(guò)高速D/A轉(zhuǎn)換器產(chǎn)生已經(jīng)用數(shù)字形式存入的正弦波(或其他任意波形)。一個(gè)典型的DDS系統(tǒng)應(yīng)包括：相位累加器，可在時(shí)鐘的控制下完成相位的累加(一般由ROM實(shí)現(xiàn))；DA轉(zhuǎn)換電路，將數(shù)字形式的幅度碼轉(zhuǎn)換成模擬信號(hào)。 本文根據(jù)設(shè)計(jì)指標(biāo)，進(jìn)行了DDS系統(tǒng)分析和設(shè)計(jì)，包括DDS系統(tǒng)框圖的設(shè)計(jì)，相位控制字和頻率控字的設(shè)計(jì)，以及軟件和硬件設(shè)計(jì)，重點(diǎn)在于利用FPGA改進(jìn)設(shè)計(jì)，包括控制系統(tǒng)(頻率控制器和初始相位控制器)，尋址系統(tǒng)(相位累加器和數(shù)據(jù)存儲(chǔ)器)，以及轉(zhuǎn)換系統(tǒng)(D/A轉(zhuǎn)換器和濾波器)的設(shè)計(jì)。介紹了利用現(xiàn)場(chǎng)可編程邏輯門(mén)陣列(FPGA)實(shí)現(xiàn)數(shù)控振蕩器(DNO，即DDS)的原理、電路結(jié)構(gòu)，重點(diǎn)介紹了DDS技術(shù)在FPGA中的實(shí)現(xiàn)方法，給出了采用ALTERA公司的FIEX1OK系列FPGA芯片EPF10K20TC144-4芯片進(jìn)行直接數(shù)字頻率合成的VHDL源程序。
上傳時(shí)間： 2013-04-24
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擴(kuò)頻通信技術(shù)是信息時(shí)代的三大高技術(shù)通信傳輸方式之一，與常規(guī)的通信技術(shù)相比。具有低截獲率、強(qiáng)抗噪聲、抗干擾性，具有信息隱蔽和多址通信等特點(diǎn)，目前已從軍事領(lǐng)域向民用領(lǐng)域迅速發(fā)展。在民用化之后，它被迅速推廣到各種公用和專用通信網(wǎng)絡(luò)之中，如衛(wèi)星通信、數(shù)據(jù)傳輸、定位、測(cè)距等系統(tǒng)中。 擴(kuò)頻通信技術(shù)中，最常見(jiàn)的是直接序列擴(kuò)頻通信(DSSS)系統(tǒng)，然而目前專用擴(kuò)頻芯片大部分功能都已固化。缺少產(chǎn)品開(kāi)發(fā)的靈活性。其次，目前用FPGA與DSP相結(jié)合實(shí)現(xiàn)的直接序列擴(kuò)頻的收發(fā)系統(tǒng)比較多，系統(tǒng)復(fù)雜且成本高。另外，現(xiàn)代擴(kuò)頻通信系統(tǒng)在接收和發(fā)送端需要完成許多快速?gòu)?fù)雜的信號(hào)處理，這對(duì)電路的可靠性和處理速度提出了更高的要求。因此，設(shè)計(jì)一個(gè)全部用FPGA技術(shù)實(shí)現(xiàn)的擴(kuò)頻通信收、發(fā)系統(tǒng)具有較強(qiáng)的實(shí)際應(yīng)用價(jià)值。 根據(jù)FPGA的高速并行處理能力和全硬件實(shí)現(xiàn)的特點(diǎn)，采用直接序列擴(kuò)頻技術(shù)，借助QuartusⅡ6.0及Protel99se工具，完成了系統(tǒng)的軟件仿真和硬件電路設(shè)計(jì)。實(shí)驗(yàn)結(jié)果表明，比用傳統(tǒng)的FPGA與DSP相結(jié)合實(shí)現(xiàn)方式，提高了處理速度，減少了硬件延時(shí)。同時(shí)采用了流水線技術(shù)，提高了系統(tǒng)并行處理的能力。并且系統(tǒng)功能可以通過(guò)程序來(lái)修改和升級(jí)，與專用擴(kuò)頻芯片相比，具有很大的靈活性。所有模塊都集成在一個(gè)芯片中，提高了系統(tǒng)的穩(wěn)定性和可靠性。
上傳時(shí)間： 2013-05-18
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可靠通信要求消息從信源到信宿盡量無(wú)誤傳輸，這就要求通信系統(tǒng)具有很好的糾錯(cuò)能力，如使用差錯(cuò)控制編碼。自仙農(nóng)定理提出以來(lái)，先后有許多糾錯(cuò)編碼被相繼提出，例如漢明碼，BCH碼和RS碼等，而C。Berrou等人于1993年提出的Turbo碼以其優(yōu)異的糾錯(cuò)性能成為通信界的一個(gè)里程碑。 然而，Turbo碼迭代譯碼復(fù)雜度大，導(dǎo)致其譯碼延時(shí)大，故而在工程中的應(yīng)用受到一定限制，而并行Turbo譯碼可以很好地解決上述問(wèn)題。本論文的主要工作是通過(guò)硬件實(shí)現(xiàn)一種基于幀分裂和歸零處理的新型并行Turbo編譯碼算法。論文提出了一種基于多端口存儲(chǔ)器的并行子交織器解決方法，很好地解決了并行訪問(wèn)存儲(chǔ)器沖突的問(wèn)題。 本論文在現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)平臺(tái)上實(shí)現(xiàn)了一種基于幀分裂和籬笆圖歸零處理的并行Turbo編譯碼器。所實(shí)現(xiàn)的并行Turbo編譯碼器在時(shí)鐘頻率為33MHz，幀長(zhǎng)為1024比特，并行子譯碼器數(shù)和最大迭代次數(shù)均為4時(shí)，可支持8.2Mbps的編譯碼數(shù)掘吞吐量，而譯碼時(shí)延小于124us。本文還使用EP2C35FPGA芯片設(shè)計(jì)了系統(tǒng)開(kāi)發(fā)板。該開(kāi)發(fā)板可提供高速以太網(wǎng)MAC／PHY和PCI接口，很好地滿足了通信系統(tǒng)需求。系統(tǒng)測(cè)試結(jié)果表明，本文所實(shí)現(xiàn)的并行Turbo編譯碼器及其開(kāi)發(fā)板運(yùn)行正確、有效且可靠。 本論文主要分為五章，第一章為緒論，介紹Turbo碼背景和硬件實(shí)現(xiàn)相關(guān)技術(shù)。第二章為基于幀分裂和歸零的并行Turbo編碼的設(shè)計(jì)與實(shí)現(xiàn)，分別介紹了編碼器和譯碼器的RTL設(shè)計(jì)，還提出了一種基于多端口存儲(chǔ)器的并行子交織器和解交織器設(shè)計(jì)。第三章討論了使用NIOS處理器的SOC架構(gòu)，使用SOC架構(gòu)處理系統(tǒng)和基于NIOSII處理器和uC／0S一2操作系統(tǒng)的架構(gòu)。第四章介紹了FPGA系統(tǒng)開(kāi)發(fā)板設(shè)計(jì)與調(diào)試的一些工作。最后一章為本文總結(jié)及其展望。
上傳時(shí)間： 2013-04-24
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差錯(cuò)控制編碼技術(shù)是現(xiàn)代通信技術(shù)中的關(guān)鍵技術(shù)之一，在移動(dòng)通信、數(shù)字電視、計(jì)算機(jī)存儲(chǔ)等數(shù)據(jù)通信系統(tǒng)中得到了廣泛應(yīng)用。在信道條件惡劣的情況中，常采用糾錯(cuò)能力更強(qiáng)的級(jí)聯(lián)編解碼方法，進(jìn)行差錯(cuò)控制。本課題以RS碼、LDPC 碼...
標(biāo)簽： LDPC FPGA RS碼 級(jí)聯(lián)
上傳時(shí)間： 2013-05-25
上傳用戶：hrzx1234
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